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微软新的开发语言,可以应用于EDA.将F#变为verilog.

微软新的开发语言,可以应用于EDA.将F#变为verilog.
2014-01-05 18:02:02 下载 101 查看 1,074
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VERILOG语言写的RS485通信程序,经调试可以直接使用

VERILOG语言写的RS485通信程序,经调试可以直接使用
2017-01-31 20:30:02 下载 133 查看 1,284
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verilog做的简化mips32指令系统。 有些小问题

verilog做的简化mips32指令系统。 有些小问题,用就能发现,是学习的好资料。 如果有必要,可以和我联系。
2014-08-11 21:15:02 下载 88 查看 1,052
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TFT液晶屏驱动模块Verilog源码。实现方法:XC95288+K6R4008

TFT液晶屏驱动模块Verilog源码。实现方法:XC95288+K6R4008,K6R4008主要用作帧缓冲区,此模块仅支持256色
2017-02-15 00:28:01 下载 115 查看 1,067
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Verilog直接完成倍频的算法,经过了quartus8.0的时序仿真

Verilog直接完成倍频的算法,经过了quartus8.0的时序仿真
2014-08-09 13:30:22 下载 179 查看 3,763
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verilog(一大牛写的)个人感觉很适合初学者使用

verilog(一大牛写的)个人感觉很适合初学者使用,讲解比较详细
2017-03-13 10:39:02 下载 198 查看 1,046
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璁茶Вsdram鐨勬搷浣滐紝闄勬湁verilog hdl浠g爜

璁茶Вsdram鐨勬搷浣滐紝闄勬湁verilog hdl浠g爜
2017-04-08 00:04:02 下载 162 查看 1,027
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verilog语言实现的数字下变频设计。 在ALTERA的QUARTUS ii下实现。实用

verilog语言实现的数字下变频设计。 在ALTERA的QUARTUS ii下实现。实用,好用。
2017-05-07 00:00:02 下载 186 查看 1,143
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Verilog编写的一个简单的产生伪随机序列的代码(m序列)

Verilog编写的一个简单的产生伪随机序列的代码(m序列),比较实用。
2017-06-27 20:01:01 下载 92 查看 1,315
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详尽介绍了VERILOG编程过程中的组合逻辑和时序逻辑设计方法

详尽介绍了VERILOG编程过程中的组合逻辑和时序逻辑设计方法,同时对仿真程序的编程和使用也做了完美的讲解,便于快速学习掌握
2013-12-11 18:44:03 下载 79 查看 1,116
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TI 的TMS320C54X的DSP的芯片软核verilog源代码

TI 的TMS320C54X的DSP的芯片软核verilog源代码,可以帮助初学者深入了解该系列DSP片内资源核结构,值得参考!
2013-12-24 09:20:06 下载 21 查看 1,098
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是数字信号处理的FPGA实现中所有程序(书中为VHDL)的verilog代码

是数字信号处理的FPGA实现中所有程序(书中为VHDL)的verilog代码,很好,很有用
2014-08-17 01:30:27 下载 143 查看 1,134
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Verilog 实现的电话计费器 信号定义:decide: 电话局反馈回来的信号

Verilog 实现的电话计费器 信号定义:decide: 电话局反馈回来的信号,代表话务种类,“01”表示市话,“10”表示长话,“11”表示特话;
2017-09-14 00:12:02 下载 56 查看 1,204
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基于FPGA设计的字符VGA LCD显示实验Verilog逻辑源码Quartus工程文件+文档说明

基于FPGA设计的字符VGA  LCD显示实验Verilog逻辑源码Quartus工程文件+文档说明,通过字符转换工具将字符转换为 8 进制 mif 文件存放到单端口的 ROM IP 核中

2021-12-18 21:30:01 下载 3 查看 5,665
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基于FPGA设计的sdram读写测试实验Verilog逻辑源码Quartus工程文件+文档说明 DR

基于FPGA设计的sdram读写测试实验Verilog逻辑源码Quartus工程文件+文档说明,DRAM选用海力士公司的 HY57V2562 型号,容量为的 256Mbit,采用了 54 引脚的<

2021-12-18 23:00:01 下载 9 查看 9,668
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基于FPGA设计的vga显示测试实验Verilog逻辑源码Quartus工程文件+文档说明 FPGA

基于FPGA设计的vga显示测试实验Verilog逻辑源码Quartus工程文件+文档说明,FPGA型号Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。

2021-12-19 00:30:01 下载 1 查看 4,326
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VERILOG 代码 包括UART_baudrate UART_rx UART_tx 三个逻辑模块

VERILOG串口 代码,包括UART_baudrate UART_rx  UART_tx 三个逻辑模块QUARTUS 18.0工程源码, 2022-02-04 05:30:01 下载 2 查看 1,144

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verilog 程序设计实例 学习基础教程 FPGA教学实验150例程源码

-1.png" alt="verilog 程序设计实例 学习基础教程 FPGA教学实验150例程源码" title="verilog 程序设计实例 学习基础教程 FPGA教学实验150例程源码">

2022-05-11 12:30:02 下载 9 查看 560
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Verilog写的cordic相位鉴别采用8级的流水线的硬件设计

Verilog写的cordic相位鉴别,采用8级的流水线的硬件设计,适合感兴趣的学习者学习,可以提高自己的能力,大家可以多交流哈

2022-05-16 08:30:01 下载 1 查看 2,274

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MDIO Verilog RTL代码,SOC可以通过MDIO接口来访问外部PHY等慢速外设

MDIO Verilog RTL代码,SOC可以通过MDIO接口来访问外部PHY等慢速外设

2022-06-26 15:00:01 下载 2 查看 5,952