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根据DDR2-SDRAM的特点，选择合适的内存调度方案，采用Verilog HDL语言设计实现了该高速实时数据采集系统，并对系统功能进行验证与分析，结果表明本设计完全能够满足系统的性能指标。
2013-06-24 00:40:01
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本论文中的主控制器采用Verilog HDL作为硬件描述语言，系统在QuartusⅡ，ModelSim和Synplify软件平台下开发，并在硬件上得到实现，达到了预期效果。
2013-07-21 02:00:01
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根据DDR2-SDRAM的特点，选择合适的内存调度方案，采用Verilog HDL语言设计实现了该高速实时数据采集系统，并对系统功能进行验证与分析，结果表明本设计完全能够满足系统的性能指标。
2013-06-24 06:50:02
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的寄存器传输级设计和SystemC的可综合语言子集，以及根据作者设计经历归结的RTL设计准则和经验；接口、端口和通道等SystemC行为建模实例——片上总线系统；SystemC与VHDL/Verilog HDL
2014-11-29 12:06:02
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FPGA技巧Xilinx.pdf
HuaWei Verilog 约束.rar
Synplify工具使用指南(华为文档)[1].rar.rar
Verilog HDL
2021-11-05 15:00:01
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SystemVerilog 语言简介
SystemVerilog是一种硬件描述和验证语言（HDVL），它基于IEEE 1364-2001Verilog硬件描述语言（HDL），并对其进行了扩展
2022-07-01 01:50:02
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根据DDR2-SDRAM的特点，选择合适的内存调度方案，采用Verilog HDL语言设计实现了该高速实时数据采集系统，并对系统功能进行验证与分析，结果表明本设计完全能够满足系统的性能指标。
2023-06-26 23:10:03
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根据DDR2-SDRAM的特点，选择合适的内存调度方案，采用Verilog HDL语言设计实现了该高速实时数据采集系统，并对系统功能进行验证与分析，结果表明本设计完全能够满足系统的性能指标。
2024-04-05 09:50:01
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信道编码方案进行了详细的阐述,这是本人制定信道内码解码方案的基础.然后,在对内码解码所有模块进行C语言和MATLAB算法仿真的基础上,完成了内码解码总模块的FPGA设计,系统所有的硬件电路设计都采用了Verilog HDL
2024-05-09 22:50:01
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接着采用自顶向下的IC设计方法，通过Verilog HDL语言编程设计了I2C的主、从IP固核。
2024-05-28 01:00:03
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The entire circuit is designed to be completed by flexible Verilog HDL language，and
verified by Cadence
2024-10-03 08:50:02
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/>一款用于对 WLAN 通信系统的物理层进行仿真、分析和测试的新产品
代码生成Embedded Coder
编译器指令生成，将信号维度作为 #define 进行实施
HDL
2016-07-26 09:43:22
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关键字：CRC;卷积编码;块重复;交织;长码;沃尔什;PN序列
2013-11-02 18:24:01
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..................................................................26
4.3.1 BL8 Burst order with CRC
2022-01-09 19:30:01
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数字电路部分处理完整的ISO
14443A帧和错误检测（奇偶&CRC）。MFRC522支持MIFARE Classic（如，MIFARE标准）器件。
2022-06-29 20:10:02
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此系列单片机具有多种外设，如ADC、I2C、USART、UART、SPI、I2S、PDMA、 GPTM、MCTM、SCI、EBI、CRC-16/32、AES-128/256、USB2.0 FS、SDIO
2022-09-27 02:30:02
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一个菜单的例子
程序四 DS1820单芯片温度测量
程序五 keilc 6.20c版直接嵌入汇编的方法
程序六 用计算机并口模拟SPI通信的C源程序
程序七 CRC16
2022-09-29 05:30:02
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并在ISE软件平台上，用硬件描述语言(verilog HDL)对算法部分严格按照FPGA代码风格进行了RTL 硬件建模，并对C++算法进行了优化处理，通过仿真与软件算法结果进行比对，评估误差，最后在VirtexII
2013-07-13 23:20:01
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并在ISE软件平台上，用硬件描述语言(verilog HDL)对算法部分严格按照FPGA代码风格进行了RTL 硬件建模，并对C++算法进行了优化处理，通过仿真与软件算法结果进行比对，评估误差，最后在VirtexII
2023-06-27 10:40:11
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在本课题中我所完成的工作如下： 1、查阅相关文献，熟悉CAVLC及CABAC算法，对其中的k阶指数哥伦布码形式、归一化模块、model_number取值、非零系数幅值编码原理等理论进行了分析与研究； 2、采用Verilog HDL
2023-10-04 09:30:01
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