has_task.v
来自「verilog代码集锦.rar」· Verilog 代码 · 共 15 行
V
15 行
module Has_Task; parameter MAXBITS=8; task Revers_Bits; input [MAXBITS-1:0]Din; output [MAXBITS-1:0]Dout;l integer k; begin for(k=0;k<MAXBIST;k=k+1) Dout[MAXBIST-1-k]=Din[k]; end endtask endmodule
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