📄 bjqcondff.fit.rpt
字号:
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; ready ; 56 ; 1 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; rsdsp ; 50 ; 1 ; 0 ; 4 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; spisomi ; 124 ; 3 ; 35 ; 2 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Bidir Pins ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; d[0] ; 108 ; 4 ; 30 ; 0 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[10] ; 98 ; 4 ; 22 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[11] ; 97 ; 4 ; 22 ; 0 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[12] ; 96 ; 4 ; 22 ; 0 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[13] ; 95 ; 4 ; 20 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[14] ; 94 ; 4 ; 20 ; 0 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[15] ; 93 ; 4 ; 20 ; 0 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[1] ; 107 ; 4 ; 28 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[2] ; 106 ; 4 ; 28 ; 0 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[3] ; 105 ; 4 ; 28 ; 0 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[4] ; 104 ; 4 ; 26 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[5] ; 103 ; 4 ; 26 ; 0 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[6] ; 102 ; 4 ; 26 ; 0 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[7] ; 101 ; 4 ; 24 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[8] ; 100 ; 4 ; 24 ; 0 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; d[9] ; 99 ; 4 ; 24 ; 0 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 10 / 44 ( 22 % ) ; 3.3V ; -- ;
; 2 ; 0 / 48 ( 0 % ) ; 3.3V ; -- ;
; 3 ; 4 / 45 ( 8 % ) ; 3.3V ; -- ;
; 4 ; 35 / 48 ( 72 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+--------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------------+--------+--------------+---------+------------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ;
+----------+------------+----------+----------------------+--------+--------------+---------+------------+-----------------+
; 1 ; 0 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 2 ; 1 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 3 ; 2 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 4 ; 3 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 5 ; 4 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 6 ; 5 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 7 ; 6 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 8 ; 7 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 9 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 10 ; ; ; GND ; gnd ; ; ; -- ; ;
; 11 ; 8 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 12 ; 9 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 13 ; 10 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 14 ; 11 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 15 ; 12 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 16 ; 13 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 17 ; 14 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 18 ; 15 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 19 ; 16 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 20 ; 17 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 21 ; 18 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 22 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 23 ; 19 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 24 ; 20 ; 1 ; *~nCSO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 25 ; 21 ; 1 ; ^DATA0 ; input ; ; ; -- ; ;
; 26 ; 22 ; 1 ; ^nCONFIG ; ; ; ; -- ; ;
; 27 ; ; ; VCCA_PLL1 ; power ; ; 1.5V ; -- ; ;
; 28 ; 23 ; 1 ; clk ; input ; LVTTL ; ; Row I/O ; Y ;
; 29 ; 24 ; 1 ; GND+ ; ; ; ; Row I/O ; ;
; 30 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ;
; 31 ; ; ; GNDG_PLL1 ; gnd ; ; ; -- ; ;
; 32 ; 25 ; 1 ; ^nCEO ; ; ; ; -- ; ;
; 33 ; 26 ; 1 ; ^nCE ; ; ; ; -- ; ;
; 34 ; 27 ; 1 ; ^MSEL0 ; ; ; ; -- ; ;
; 35 ; 28 ; 1 ; ^MSEL1 ; ; ; ; -- ; ;
; 36 ; 29 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ;
; 37 ; 30 ; 1 ; *~ASDO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 38 ; 31 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 39 ; 32 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 40 ; ; ; GND ; gnd ; ; ; -- ; ;
; 41 ; 33 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 42 ; 34 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 43 ; 35 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 44 ; 36 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 45 ; 37 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 46 ; 38 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 47 ; 39 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 48 ; 40 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 49 ; 41 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 50 ; 42 ; 1 ; rsdsp ; output ; LVTTL ; ; Row I/O ; Y ;
; 51 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 52 ; ; ; GND ; gnd ; ; ; -- ; ;
; 53 ; 43 ; 1 ; GND* ; ; ; ; Row I/O ; ;
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