📄 alu.fit.rpt
字号:
; SERDES ; ; ; ; ; ; ; ; ;
; -- RX ; 0 ; 0 / 17 ; 0 / 21 ; 0 / 31 ; 0 / 31 ; 0 / 46 ; 0 / 92 ; 0 / 116 ;
; -- TX ; 0 ; 0 / 18 ; 0 / 19 ; 0 / 29 ; 0 / 29 ; 0 / 44 ; 0 / 88 ; 0 / 116 ;
; Configuration ; ; ; ; ; ; ; ; ;
; -- CRC ; 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ;
; -- ASMI ; 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ;
; -- Remote Update ; 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ; 0 / 0 ;
; -- JTAG ; 0 ; 0 / 1 ; 0 / 1 ; 0 / 1 ; 0 / 1 ; 0 / 1 ; 0 / 1 ; 0 / 1 ;
+---------------------------------+----------------------+--------------+--------------+--------------+--------------+---------------+---------------+---------------+
* The selected FPGA device cannot migrate to any HardCopy device, regardless of the design. Try this design with a different FPGA device.
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/lab/alu/alu.pin.
+----------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+----------------------------------------------+-----------------------+
; Resource ; Usage ;
+----------------------------------------------+-----------------------+
; ALUTs Used ; 17 / 12,480 ( < 1 % ) ;
; Dedicated logic registers ; 0 / 12,480 ( 0 % ) ;
; ; ;
; ALUTs Unavailable ; 4 ;
; -- Due to unpartnered 7 input function ; 0 ;
; -- Due to unpartnered 6 input function ; 4 ;
; ; ;
; Combinational ALUT usage by number of inputs ; ;
; -- 7 input functions ; 0 ;
; -- 6 input functions ; 8 ;
; -- 5 input functions ; 0 ;
; -- 4 input functions ; 0 ;
; -- <=3 input functions ; 9 ;
; ; ;
; Combinational ALUTs by mode ; ;
; -- normal mode ; 8 ;
; -- extended LUT mode ; 0 ;
; -- arithmetic mode ; 9 ;
; -- shared arithmetic mode ; 0 ;
; ; ;
; Logic utilization ; 21 / 12,480 ( < 1 % ) ;
; -- ALUT/register pairs used ; 17 ;
; -- Combinational with no register ; 17 ;
; -- Register only ; 0 ;
; -- Combinational with a register ; 0 ;
; -- ALUT/register pairs unavailable ; 4 ;
; ; ;
; Total registers* ; 0 / 14,410 ( 0 % ) ;
; -- Dedicated logic registers ; 0 / 12,480 ( 0 % ) ;
; -- I/O registers ; 0 / 1,930 ( 0 % ) ;
; ; ;
; ALMs: partially or completely used ; 13 / 6,240 ( < 1 % ) ;
; ; ;
; Total LABs: partially or completely used ; 2 / 780 ( < 1 % ) ;
; ; ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 27 / 343 ( 8 % ) ;
; -- Clock pins ; 4 / 16 ( 25 % ) ;
; Global signals ; 0 ;
; M512s ; 0 / 104 ( 0 % ) ;
; M4Ks ; 0 / 78 ( 0 % ) ;
; Total block memory bits ; 0 / 419,328 ( 0 % ) ;
; Total block memory implementation bits ; 0 / 419,328 ( 0 % ) ;
; DSP block 9-bit elements ; 0 / 96 ( 0 % ) ;
; PLLs ; 0 / 6 ( 0 % ) ;
; Global clocks ; 0 / 16 ( 0 % ) ;
; Regional clocks ; 0 / 32 ( 0 % ) ;
; SERDES transmitters ; 0 / 38 ( 0 % ) ;
; SERDES receivers ; 0 / 42 ( 0 % ) ;
; JTAGs ; 0 / 1 ( 0 % ) ;
; Average interconnect usage (total/H/V) ; 0% / 0% / 0% ;
; Peak interconnect usage (total/H/V) ; 0% / 0% / 0% ;
; Maximum fan-out node ; opcode[0] ;
; Maximum fan-out ; 17 ;
; Highest non-global fan-out signal ; opcode[0] ;
; Highest non-global fan-out ; 17 ;
; Total fan-out ; 89 ;
; Average fan-out ; 1.98 ;
+----------------------------------------------+-----------------------+
* Register count does not include registers inside block RAM or DSP blocks.
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; a[0] ; Y22 ; 1 ; 0 ; 1 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; a[1] ; Y10 ; 7 ; 22 ; 0 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; a[2] ; Y14 ; 8 ; 7 ; 0 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; a[3] ; T13 ; 8 ; 13 ; 0 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; a[4] ; V18 ; 1 ; 0 ; 3 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; a[5] ; B12 ; 4 ; 22 ; 27 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; a[6] ; W12 ; 8 ; 17 ; 0 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; a[7] ; U12 ; 8 ; 15 ; 0 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; b[0] ; AA15 ; 8 ; 14 ; 0 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; b[1] ; V22 ; 1 ; 0 ; 3 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; b[2] ; R7 ; 6 ; 40 ; 3 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; b[3] ; AA16 ; 8 ; 13 ; 0 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; b[4] ; W13 ; 8 ; 15 ; 0 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; b[5] ; Y21 ; 1 ; 0 ; 1 ; 3 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; b[6] ; T14 ; 8 ; 7 ; 0 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; b[7] ; AA9 ; 10 ; 25 ; 0 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; opcode[0] ; V12 ; 8 ; 17 ; 0 ; 1 ; 17 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; opcode[1] ; V13 ; 8 ; 10 ; 0 ; 1 ; 8 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
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