tryfunct.sim.rpt

verilog hdl经典例程

; |tryfunct|result[18]~reg0                                                                                                     ; |tryfunct|result[18]~reg0                                                                                                     ; regout           ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[3]                                                                   ; dataout39        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[4]                                                                   ; dataout40        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[6]                                                                   ; dataout42        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[9]                                                                   ; dataout45        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[10]                                                                  ; dataout46        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[11]                                                                  ; dataout47        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[12]                                                                  ; dataout48        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[13]                                                                  ; dataout49        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[14]                                                                  ; dataout50        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[15]                                                                  ; dataout51        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[16]                                                                  ; dataout52        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[20]                                                                  ; dataout56        ;
; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|mac_out5                                                                    ; |tryfunct|lpm_mult:Mult2|mult_pu01:auto_generated|result[21]                                                                  ; dataout57        ;
; |tryfunct|lpm_divide:Div0|lpm_divide_hfm:auto_generated|sign_div_unsign_plh:divider|alt_u_div_m3f:divider|op_24~51            ; |tryfunct|lpm_divide:Div0|lpm_divide_hfm:auto_generated|sign_div_unsign_plh:divider|alt_u_div_m3f:divider|op_24~51            ; sumout           ;
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; |tryfunct|lpm_divide:Div0|lpm_divide_hfm:auto_generated|sign_div_unsign_plh:divider|alt_u_div_m3f:divider|op_27~54            ; |tryfunct|lpm_divide:Div0|lpm_divide_hfm:auto_generated|sign_div_unsign_plh:divider|alt_u_div_m3f:divider|op_27~54            ; sumout           ;
; |tryfunct|lpm_divide:Div0|lpm_divide_hfm:auto_generated|sign_div_unsign_plh:divider|alt_u_div_m3f:divider|op_28~56            ; |tryfunct|lpm_divide:Div0|lpm_divide_hfm:auto_generated|sign_div_unsign_plh:divider|alt_u_div_m3f:divider|op_28~56            ; sumout           ;
; |tryfunct|lpm_divide:Div0|lpm_divide_hfm:auto_generated|sign_div_unsign_plh:divider|alt_u_div_m3f:divider|op_28~60            ; |tryfunct|lpm_divide:Div0|lpm_divide_hfm:auto_generated|sign_div_unsign_plh:divider|alt_u_div_m3f:divider|op_28~60            ; sumout           ;
; |tryfunct|lpm_divide:Div0|lpm_divide_hfm:auto_generated|sign_div_unsign_plh:divider|alt_u_div_m3f:divider|op_29~56            ; |tryfunct|lpm_divide:Div0|lpm_divide_hfm:auto_generated|sign_div_unsign_plh:divider|alt_u_div_m3f:divider|op_29~56            ; sumout           ;
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