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📄 sort4.fit.rpt

📁 verilog hdl经典例程
💻 RPT
📖 第 1 页 / 共 5 页
字号:
;   -- M4K blocks & M512 blocks   ; 0                    ; 0 / 190      ; 0 / 190      ; 0 / 408      ; 0 / 408      ; 0 / 614       ; 0 / 816       ; 0 / 816       ;
; PLLs                            ;                      ;              ;              ;              ;              ;               ;               ;               ;
;   -- Enhanced                   ; 0                    ; 0 / 2        ; 0 / 2        ; 0 / 2        ; 0 / 2        ; 0 / 4         ; 0 / 4         ; 0 / 4         ;
;   -- Fast                       ; 0                    ; 0 / 2        ; 0 / 2        ; 0 / 2        ; 0 / 2        ; 0 / 4         ; 0 / 8         ; 0 / 8         ;
; DLLs                            ; 0                    ; 0 / 1        ; 0 / 1        ; 0 / 1        ; 0 / 1        ; 0 / 2         ; 0 / 2         ; 0 / 2         ;
; SERDES                          ;                      ;              ;              ;              ;              ;               ;               ;               ;
;   -- RX                         ; 0                    ; 0 / 17       ; 0 / 21       ; 0 / 31       ; 0 / 31       ; 0 / 46        ; 0 / 92        ; 0 / 116       ;
;   -- TX                         ; 0                    ; 0 / 18       ; 0 / 19       ; 0 / 29       ; 0 / 29       ; 0 / 44        ; 0 / 88        ; 0 / 116       ;
; Configuration                   ;                      ;              ;              ;              ;              ;               ;               ;               ;
;   -- CRC                        ; 0                    ; 0 / 0        ; 0 / 0        ; 0 / 0        ; 0 / 0        ; 0 / 0         ; 0 / 0         ; 0 / 0         ;
;   -- ASMI                       ; 0                    ; 0 / 0        ; 0 / 0        ; 0 / 0        ; 0 / 0        ; 0 / 0         ; 0 / 0         ; 0 / 0         ;
;   -- Remote Update              ; 0                    ; 0 / 0        ; 0 / 0        ; 0 / 0        ; 0 / 0        ; 0 / 0         ; 0 / 0         ; 0 / 0         ;
;   -- JTAG                       ; 0                    ; 0 / 1        ; 0 / 1        ; 0 / 1        ; 0 / 1        ; 0 / 1         ; 0 / 1         ; 0 / 1         ;
+---------------------------------+----------------------+--------------+--------------+--------------+--------------+---------------+---------------+---------------+
*  The selected FPGA device cannot migrate to any HardCopy device, regardless of the design. Try this design with a different FPGA device.



+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/lab/sort4/sort4.pin.


+----------------------------------------------------------------------+
; Fitter Resource Usage Summary                                        ;
+----------------------------------------------+-----------------------+
; Resource                                     ; Usage                 ;
+----------------------------------------------+-----------------------+
; ALUTs Used                                   ; 39 / 12,480 ( < 1 % ) ;
; Dedicated logic registers                    ; 0 / 12,480 ( 0 % )    ;
;                                              ;                       ;
; ALUTs Unavailable                            ; 1                     ;
;     -- Due to unpartnered 7 input function   ; 0                     ;
;     -- Due to unpartnered 6 input function   ; 1                     ;
;                                              ;                       ;
; Combinational ALUT usage by number of inputs ;                       ;
;     -- 7 input functions                     ; 0                     ;
;     -- 6 input functions                     ; 1                     ;
;     -- 5 input functions                     ; 6                     ;
;     -- 4 input functions                     ; 4                     ;
;     -- <=3 input functions                   ; 28                    ;
;                                              ;                       ;
; Combinational ALUTs by mode                  ;                       ;
;     -- normal mode                           ; 39                    ;
;     -- extended LUT mode                     ; 0                     ;
;     -- arithmetic mode                       ; 0                     ;
;     -- shared arithmetic mode                ; 0                     ;
;                                              ;                       ;
; Logic utilization                            ; 40 / 12,480 ( < 1 % ) ;
;     -- ALUT/register pairs used              ; 39                    ;
;         -- Combinational with no register    ; 39                    ;
;         -- Register only                     ; 0                     ;
;         -- Combinational with a register     ; 0                     ;
;     -- ALUT/register pairs unavailable       ; 1                     ;
;                                              ;                       ;
; Total registers*                             ; 0 / 14,410 ( 0 % )    ;
;     -- Dedicated logic registers             ; 0 / 12,480 ( 0 % )    ;
;     -- I/O registers                         ; 0 / 1,930 ( 0 % )     ;
;                                              ;                       ;
; ALMs:  partially or completely used          ; 20 / 6,240 ( < 1 % )  ;
;                                              ;                       ;
; Total LABs:  partially or completely used    ; 4 / 780 ( < 1 % )     ;
;                                              ;                       ;
; User inserted logic elements                 ; 0                     ;
; Virtual pins                                 ; 0                     ;
; I/O pins                                     ; 32 / 343 ( 9 % )      ;
;     -- Clock pins                            ; 5 / 16 ( 31 % )       ;
; Global signals                               ; 0                     ;
; M512s                                        ; 0 / 104 ( 0 % )       ;
; M4Ks                                         ; 0 / 78 ( 0 % )        ;
; Total block memory bits                      ; 0 / 419,328 ( 0 % )   ;
; Total block memory implementation bits       ; 0 / 419,328 ( 0 % )   ;
; DSP block 9-bit elements                     ; 0 / 96 ( 0 % )        ;
; PLLs                                         ; 0 / 6 ( 0 % )         ;
; Global clocks                                ; 0 / 16 ( 0 % )        ;
; Regional clocks                              ; 0 / 32 ( 0 % )        ;
; SERDES transmitters                          ; 0 / 38 ( 0 % )        ;
; SERDES receivers                             ; 0 / 42 ( 0 % )        ;
; JTAGs                                        ; 0 / 1 ( 0 % )         ;
; Average interconnect usage (total/H/V)       ; 0% / 0% / 0%          ;
; Peak interconnect usage (total/H/V)          ; 0% / 0% / 0%          ;
; Maximum fan-out node                         ; LessThan1~305         ;
; Maximum fan-out                              ; 10                    ;
; Highest non-global fan-out signal            ; LessThan1~305         ;
; Highest non-global fan-out                   ; 10                    ;
; Total fan-out                                ; 151                   ;
; Average fan-out                              ; 2.10                  ;
+----------------------------------------------+-----------------------+
*  Register count does not include registers inside block RAM or DSP blocks.



+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins                                                                                                                                                                                                                                                 ;
+------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; a[0] ; N20   ; 1        ; 0            ; 10           ; 1           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; a[1] ; Y12   ; 8        ; 18           ; 0            ; 2           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; a[2] ; J5    ; 5        ; 40           ; 20           ; 1           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; a[3] ; N21   ; 1        ; 0            ; 10           ; 3           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; b[0] ; Y7    ; 7        ; 29           ; 0            ; 1           ; 5                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; b[1] ; AA10  ; 10       ; 25           ; 0            ; 0           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; b[2] ; U2    ; 6        ; 40           ; 5            ; 3           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; b[3] ; AB13  ; 8        ; 18           ; 0            ; 0           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; c[0] ; N19   ; 1        ; 0            ; 10           ; 2           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; c[1] ; W13   ; 8        ; 15           ; 0            ; 2           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; c[2] ; H16   ; 3        ; 5            ; 27           ; 2           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; c[3] ; N22   ; 1        ; 0            ; 10           ; 0           ; 3                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;
; d[0] ; AA13  ; 8        ; 18           ; 0            ; 3           ; 5                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; Fitter               ;

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