📄 sreg8b.fit.rpt
字号:
; 39 ; 31 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 40 ; 32 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 41 ; 33 ; 4 ; a[6] ; input ; LVTTL ; ; Column I/O ; N ;
; 42 ; 34 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 43 ; ; ; GND ; gnd ; ; ; -- ; ;
; 44 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 45 ; ; ; GND ; gnd ; ; ; -- ; ;
; 46 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 47 ; 35 ; 4 ; a[3] ; input ; LVTTL ; ; Column I/O ; N ;
; 48 ; 36 ; 4 ; a[4] ; input ; LVTTL ; ; Column I/O ; N ;
; 49 ; 37 ; 4 ; a[5] ; input ; LVTTL ; ; Column I/O ; N ;
; 50 ; 38 ; 4 ; a[7] ; input ; LVTTL ; ; Column I/O ; N ;
; 51 ; 39 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 52 ; 40 ; 4 ; dout[1] ; output ; LVTTL ; ; Column I/O ; N ;
; 53 ; 41 ; 4 ; dout[2] ; output ; LVTTL ; ; Column I/O ; N ;
; 54 ; 42 ; 4 ; dout[0] ; output ; LVTTL ; ; Column I/O ; N ;
; 55 ; 43 ; 4 ; dout[3] ; output ; LVTTL ; ; Column I/O ; N ;
; 56 ; 44 ; 4 ; dout[4] ; output ; LVTTL ; ; Column I/O ; N ;
; 57 ; 45 ; 4 ; dout[6] ; output ; LVTTL ; ; Column I/O ; N ;
; 58 ; 46 ; 4 ; dout[5] ; output ; LVTTL ; ; Column I/O ; N ;
; 59 ; 47 ; 4 ; dout[7] ; output ; LVTTL ; ; Column I/O ; N ;
; 60 ; 48 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 61 ; 49 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 62 ; 50 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 63 ; ; ; GND ; gnd ; ; ; -- ; ;
; 64 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 65 ; ; ; GND ; gnd ; ; ; -- ; ;
; 66 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 67 ; 51 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 68 ; 52 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 69 ; 53 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 70 ; 54 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 71 ; 55 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 72 ; 56 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 73 ; 57 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 74 ; 58 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 75 ; 59 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 76 ; 60 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 77 ; 61 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 78 ; 62 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 79 ; 63 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 80 ; ; ; GND ; gnd ; ; ; -- ; ;
; 81 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ;
; 82 ; 64 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 83 ; 65 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 84 ; 66 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 85 ; 67 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 86 ; 68 ; 3 ; ^CONF_DONE ; ; ; ; -- ; ;
; 87 ; 69 ; 3 ; ^nSTATUS ; ; ; ; -- ; ;
; 88 ; 70 ; 3 ; #TCK ; input ; ; ; -- ; ;
; 89 ; 71 ; 3 ; #TMS ; input ; ; ; -- ; ;
; 90 ; 72 ; 3 ; #TDO ; output ; ; ; -- ; ;
; 91 ; 73 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 92 ; 74 ; 3 ; GND+ ; ; ; ; Row I/O ; ;
; 93 ; 75 ; 3 ; GND+ ; ; ; ; Row I/O ; ;
; 94 ; 76 ; 3 ; b[4] ; input ; LVTTL ; ; Row I/O ; N ;
; 95 ; 77 ; 3 ; #TDI ; input ; ; ; -- ; ;
; 96 ; 78 ; 3 ; dout[12] ; output ; LVTTL ; ; Row I/O ; N ;
; 97 ; 79 ; 3 ; a[2] ; input ; LVTTL ; ; Row I/O ; N ;
; 98 ; 80 ; 3 ; dout[10] ; output ; LVTTL ; ; Row I/O ; N ;
; 99 ; 81 ; 3 ; b[1] ; input ; LVTTL ; ; Row I/O ; N ;
; 100 ; 82 ; 3 ; dout[15] ; output ; LVTTL ; ; Row I/O ; N ;
; 101 ; ; ; GND ; gnd ; ; ; -- ; ;
; 102 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ;
; 103 ; 83 ; 3 ; dout[8] ; output ; LVTTL ; ; Row I/O ; N ;
; 104 ; 84 ; 3 ; a[0] ; input ; LVTTL ; ; Row I/O ; N ;
; 105 ; 85 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 106 ; 86 ; 3 ; b[6] ; input ; LVTTL ; ; Row I/O ; N ;
; 107 ; 87 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 108 ; 88 ; 3 ; GND* ; ; ; ; Row I/O ; ;
; 109 ; 89 ; 2 ; b[5] ; input ; LVTTL ; ; Column I/O ; N ;
; 110 ; 90 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 111 ; 91 ; 2 ; b[3] ; input ; LVTTL ; ; Column I/O ; N ;
; 112 ; 92 ; 2 ; b[2] ; input ; LVTTL ; ; Column I/O ; N ;
; 113 ; 93 ; 2 ; a[1] ; input ; LVTTL ; ; Column I/O ; N ;
; 114 ; 94 ; 2 ; b[7] ; input ; LVTTL ; ; Column I/O ; N ;
; 115 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 116 ; ; ; GND ; gnd ; ; ; -- ; ;
; 117 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 118 ; ; ; GND ; gnd ; ; ; -- ; ;
; 119 ; 95 ; 2 ; b[0] ; input ; LVTTL ; ; Column I/O ; N ;
; 120 ; 96 ; 2 ; dout[11] ; output ; LVTTL ; ; Column I/O ; N ;
; 121 ; 97 ; 2 ; dout[13] ; output ; LVTTL ; ; Column I/O ; N ;
; 122 ; 98 ; 2 ; dout[9] ; output ; LVTTL ; ; Column I/O ; N ;
; 123 ; 99 ; 2 ; dout[14] ; output ; LVTTL ; ; Column I/O ; N ;
; 124 ; 100 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 125 ; 101 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 126 ; 102 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 127 ; 103 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 128 ; 104 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 129 ; 105 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 130 ; 106 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 131 ; 107 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 132 ; 108 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 133 ; 109 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 134 ; 110 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 135 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 136 ; ; ; GND ; gnd ; ; ; -- ; ;
; 137 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; 138 ; ; ; GND ; gnd ; ; ; -- ; ;
; 139 ; 111 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 140 ; 112 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 141 ; 113 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 142 ; 114 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 143 ; 115 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; 144 ; 116 ; 2 ; GND* ; ; ; ; Column I/O ; ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 30 pF ; (See SSTL-2) ;
; LVDS ; 4 pF ; 100 Ohm (Differential) ;
; RSDS ; 0 pF ; 100 Ohm (Differential) ;
+---------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+--------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+--------------------------+
; |multi8x8 ; 37 (0) ; 29 ; 0 ; 35 ; 0 ; 8 (0) ; 8 (0) ; 21 (0) ; 9 (0) ; |multi8x8 ;
; |andarith:inst1| ; 8 (8) ; 0 ; 0 ; 0 ; 0 ; 8 (8) ; 0 (0) ; 0 (0) ; 0 (0) ; |multi8x8|andarith:inst1 ;
; |arictl:inst2| ; 5 (5) ; 5 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 5 (5) ; 0 (0) ; |multi8x8|arictl:inst2 ;
; |reg16b:inst3| ; 16 (16) ; 16 ; 0 ; 0 ; 0 ; 0 (0) ; 7 (7) ; 9 (9) ; 9 (9) ; |multi8x8|reg16b:inst3 ;
; |sreg8b:inst4| ; 8 (8) ; 8 ; 0 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 7 (7) ; 0 (0) ; |multi8x8|sreg8b:inst4 ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+--------------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
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