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📁 Alera 的8051 IP core的示例文件5个
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// Copyright (C) 1991-2005 Altera Corporation
// Your use of Altera Corporation's design tools, logic functions 
// and other software and tools, and its AMPP partner logic 
// functions, and any output files any of the foregoing 
// (including device programming or simulation files), and any 
// associated documentation or information are expressly subject 
// to the terms and conditions of the Altera Program License 
// Subscription Agreement, Altera MegaCore Function License 
// Agreement, or other applicable license agreement, including, 
// without limitation, that your use is for the sole purpose of 
// programming logic devices manufactured by Altera and sold by 
// Altera or its authorized distributors.  Please refer to the 
// applicable agreement for further details.

// VENDOR "Altera"
// PROGRAM "Quartus II"
// VERSION "Version 5.1 Build 176 10/26/2005 Service Pack 0.15 SJ Full Version"

// DATE "12/01/2008 03:44:36"

module 	FTEST (
	DC,
	BCLK,
	TCLK,
	CLR,
	CL,
	SPUL,
	SEL,
	RST,
	
	START,
	EEND,
	DATA);
output 	START;
input 	BCLK;
input 	TCLK;
input 	CLR;
input 	CL;
input 	DC;
input 	SPUL;
input 	RST;
input 	[2:0] SEL;
output 	EEND;
output 	[7:0] DATA;
wire \etester:inst|TSQ[31] ;
wire \etester:inst|DATA[7]~644 ;
wire \etester:inst|DATA[7]~645 ;
wire \etester:inst|TSQ[22] ;
wire \etester:inst|TSQ[30] ;
wire \etester:inst|DATA[6]~649 ;
wire \etester:inst|TSQ[6] ;
wire \etester:inst|DATA[6]~650 ;
wire \etester:inst|DATA[6]~651 ;
wire \etester:inst|TSQ[21] ;
wire \etester:inst|TSQ[29] ;
wire \etester:inst|DATA[5]~654 ;
wire \etester:inst|TSQ[5] ;
wire \etester:inst|DATA[5]~655 ;
wire \etester:inst|BZQ[28] ;
wire \etester:inst|TSQ[19] ;
wire \etester:inst|DATA[3]~664 ;
wire \etester:inst|TSQ[3] ;
wire \etester:inst|DATA[3]~665 ;
wire \etester:inst|TSQ[10] ;
wire \etester:inst|TSQ[26] ;
wire \etester:inst|DATA[2]~669 ;
wire \etester:inst|DATA[2]~670 ;
wire \etester:inst|TSQ[24] ;
wire \etester:inst|DATA[0]~679 ;
wire \etester:inst|Q1 ;
wire \etester:inst|CLK2 ;
wire \etester:inst|BZQ[28]~344 ;
wire \etester:inst|TSQ[3]~294 ;
wire \etester:inst|TSQ[5]~298 ;
wire \etester:inst|TSQ[6]~300 ;
wire \etester:inst|TSQ[10]~308 ;
wire \etester:inst|TSQ[19]~326 ;
wire \etester:inst|TSQ[21]~330 ;
wire \etester:inst|TSQ[22]~332 ;
wire \etester:inst|TSQ[24]~336 ;
wire \etester:inst|TSQ[26]~340 ;
wire \etester:inst|TSQ[28]~345 ;
wire \etester:inst|TSQ[29]~347 ;
wire \etester:inst|TSQ[29]~346 ;
wire \etester:inst|TSQ[30]~349 ;
wire \etester:inst|TSQ[30]~348 ;
wire \etester:inst|TSQ[31]~350 ;
wire \etester:inst|MA~19 ;
wire \BCLK~clkctrl ;
wire \etester:inst|CLK2~clkctrl ;
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wire \TCLK~clkctrl ;
wire inst7;
wire \CLR~clkctrl ;
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wire \etester:inst|Q2 ;
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wire \etester:inst|Q3 ;
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wire \etester:inst|BZQ[1] ;
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wire \etester:inst|BZQ[2] ;
wire \etester:inst|BZQ[2]~293 ;
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wire \etester:inst|BZQ[4]~296 ;
wire \etester:inst|BZQ[4] ;
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wire \etester:inst|BZQ[5]~299 ;
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wire \etester:inst|BZQ[7]~302 ;
wire \etester:inst|BZQ[7] ;
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wire \etester:inst|BZQ[9] ;
wire \etester:inst|BZQ[9]~307 ;
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wire \etester:inst|BZQ[11] ;
wire \etester:inst|BZQ[11]~311 ;
wire \etester:inst|BZQ[12]~313 ;
wire \etester:inst|BZQ[13]~314 ;
wire \etester:inst|BZQ[13] ;
wire \etester:inst|BZQ[13]~315 ;
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wire \etester:inst|BZQ[14] ;
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wire \etester:inst|BZQ[15] ;
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wire \etester:inst|BZQ[17] ;
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wire \etester:inst|DATA[7]~646 ;
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wire \etester:inst|BZQ[24]~337 ;
wire \etester:inst|BZQ[25]~338 ;
wire \etester:inst|BZQ[25] ;
wire \etester:inst|BZQ[25]~339 ;
wire \etester:inst|BZQ[26]~341 ;
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wire \etester:inst|BZQ[27] ;
wire \etester:inst|BZQ[27]~343 ;
wire \etester:inst|BZQ[28]~345 ;
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wire \etester:inst|BZQ[29] ;
wire \etester:inst|BZQ[29]~347 ;
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wire \etester:inst|BZQ[30] ;
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wire \rtl~60 ;
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wire \etester:inst|BZQ[12] ;
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wire \etester:inst|TSQ[1] ;
wire \etester:inst|TSQ[1]~291 ;
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wire \etester:inst|TSQ[2] ;
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wire \etester:inst|TSQ[4]~296 ;
wire \etester:inst|TSQ[4] ;
wire \etester:inst|TSQ[4]~297 ;
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wire \etester:inst|TSQ[7] ;
wire \etester:inst|TSQ[7]~303 ;
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wire \etester:inst|TSQ[9] ;
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wire \etester:inst|TSQ[11]~310 ;
wire \etester:inst|TSQ[11] ;
wire \etester:inst|TSQ[11]~311 ;
wire \etester:inst|TSQ[12]~313 ;
wire \etester:inst|TSQ[13]~314 ;
wire \etester:inst|TSQ[13] ;
wire \etester:inst|TSQ[13]~315 ;
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wire \etester:inst|TSQ[14] ;
wire \etester:inst|TSQ[14]~317 ;
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wire \etester:inst|TSQ[15] ;
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wire \etester:inst|TSQ[20] ;
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wire \etester:inst|TSQ[21]~331 ;
wire \etester:inst|TSQ[22]~333 ;
wire \etester:inst|TSQ[23]~334 ;
wire \etester:inst|TSQ[23] ;
wire \etester:inst|TSQ[23]~335 ;
wire \etester:inst|TSQ[24]~337 ;
wire \etester:inst|TSQ[25]~338 ;
wire \etester:inst|TSQ[25] ;
wire \etester:inst|TSQ[25]~339 ;
wire \etester:inst|TSQ[26]~341 ;
wire \etester:inst|TSQ[27]~342 ;
wire \etester:inst|TSQ[27] ;
wire \etester:inst|TSQ[27]~343 ;
wire \etester:inst|TSQ[28]~344 ;
wire \etester:inst|TSQ[28] ;
wire \etester:inst|DATA[7]~643 ;
wire \etester:inst|DATA[4]~659 ;
wire \etester:inst|TSQ[12]~312 ;
wire \etester:inst|TSQ[12] ;
wire \etester:inst|DATA[4]~660 ;
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wire \etester:inst|DATA[4]~663 ;
wire \etester:inst|BZQ[19]~326 ;
wire \etester:inst|BZQ[19] ;
wire \etester:inst|DATA[3]~666 ;
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wire \etester:inst|BZQ[3] ;
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wire \etester:inst|BZQ[26]~340 ;
wire \etester:inst|BZQ[26] ;
wire \etester:inst|DATA[2]~671 ;
wire \etester:inst|BZQ[10]~308 ;
wire \etester:inst|BZQ[10] ;
wire \etester:inst|DATA[2]~672 ;
wire \etester:inst|DATA[2]~673 ;
wire \etester:inst|DATA[1]~674 ;
wire \etester:inst|DATA[1]~675 ;
wire \etester:inst|DATA[1]~676 ;
wire \etester:inst|DATA[1]~677 ;
wire \etester:inst|DATA[1]~678 ;
wire \etester:inst|BZQ[8]~304 ;
wire \etester:inst|BZQ[8] ;
wire \etester:inst|TSQ[8]~304 ;
wire \etester:inst|TSQ[8] ;
wire \etester:inst|DATA[0]~680 ;
wire \etester:inst|BZQ[24]~336 ;
wire \etester:inst|BZQ[24] ;
wire \etester:inst|DATA[0]~681 ;
wire \etester:inst|DATA[0]~682 ;
wire \etester:inst|DATA[0]~683 ;
wire [31:0] \etester:inst|BZQ ;
wire [31:0] \etester:inst|TSQ ;

wire \etester:inst|__ALT_INV__CLK2~clkctrl ;

wire gnd;
wire vcc;

assign gnd = 1'b0;
assign vcc = 1'b1;

assign \etester:inst|__ALT_INV__CLK2~clkctrl  = ~ \etester:inst|CLK2~clkctrl ;

cycloneii_lcell_ff \etester:inst|TSQ[31]~I (
	.clk(\TCLK~clkctrl ),
	.datain(\etester:inst|TSQ[31]~350 ),
	.aclr(\CLR~clkctrl ),
	.ena(\etester:inst|ENA ),
	.regout(\etester:inst|TSQ[31] ));

cycloneii_lcell_comb \etester:inst|DATA[7]~644_I (
	.dataa(\etester:inst|DATA[7]~642 ),
	.datab(\etester:inst|TSQ[31] ),
	.datac(\etester:inst|TSQ[15] ),
	.datad(\etester:inst|DATA[7]~643 ),
	.combout(\etester:inst|DATA[7]~644 ));
defparam \etester:inst|DATA[7]~644_I .sum_lutc_input = "datac";
defparam \etester:inst|DATA[7]~644_I .lut_mask = "FA44";

cycloneii_lcell_comb \etester:inst|DATA[7]~645_I (
	.dataa(\etester:inst|DATA[7]~642 ),
	.datab(\etester:inst|DATA[7]~644 ),
	.datac(\etester:inst|TSQ[23] ),
	.datad(\etester:inst|TSQ[7] ),
	.combout(\etester:inst|DATA[7]~645 ));
defparam \etester:inst|DATA[7]~645_I .sum_lutc_input = "datac";
defparam \etester:inst|DATA[7]~645_I .lut_mask = "EC64";

cycloneii_lcell_ff \etester:inst|TSQ[22]~I (
	.clk(\TCLK~clkctrl ),
	.datain(\etester:inst|TSQ[22]~332 ),
	.aclr(\CLR~clkctrl ),
	.ena(\etester:inst|ENA ),
	.regout(\etester:inst|TSQ[22] ));

cycloneii_lcell_ff \etester:inst|TSQ[30]~I (
	.clk(\TCLK~clkctrl ),
	.datain(\etester:inst|TSQ[30]~348 ),
	.aclr(\CLR~clkctrl ),
	.ena(\etester:inst|ENA ),
	.regout(\etester:inst|TSQ[30] ));

cycloneii_lcell_comb \etester:inst|DATA[6]~649_I (
	.dataa(\etester:inst|DATA[7]~642 ),
	.datab(\etester:inst|TSQ[30] ),
	.datac(\etester:inst|TSQ[22] ),
	.datad(\etester:inst|DATA[7]~643 ),
	.combout(\etester:inst|DATA[6]~649 ));
defparam \etester:inst|DATA[6]~649_I .sum_lutc_input = "datac";
defparam \etester:inst|DATA[6]~649_I .lut_mask = "AAE4";

cycloneii_lcell_ff \etester:inst|TSQ[6]~I (
	.clk(\TCLK~clkctrl ),
	.datain(\etester:inst|TSQ[6]~300 ),
	.aclr(\CLR~clkctrl ),
	.ena(\etester:inst|ENA ),
	.regout(\etester:inst|TSQ[6] ));

cycloneii_lcell_comb \etester:inst|DATA[6]~650_I (
	.dataa(\etester:inst|TSQ[6] ),
	.datab(\etester:inst|TSQ[14] ),
	.datac(\etester:inst|DATA[6]~649 ),
	.datad(\etester:inst|DATA[7]~643 ),
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