📄 multi8x8.fit.rpt
字号:
; 10 ; 12 ; 1 ; clk ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 11 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 12 ; 14 ; 1 ; ^nCEO ; ; ; ; -- ; ; -- ; -- ;
; 13 ; 15 ; 1 ; ^nCE ; ; ; ; -- ; ; -- ; -- ;
; 14 ; 16 ; 1 ; ^MSEL0 ; ; ; ; -- ; ; -- ; -- ;
; 15 ; 17 ; 1 ; ^MSEL1 ; ; ; ; -- ; ; -- ; -- ;
; 16 ; 18 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ; -- ; -- ;
; 17 ; 19 ; 1 ; +~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 18 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 20 ; 23 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 21 ; 24 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 22 ; 25 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 23 ; 26 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 24 ; 27 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 25 ; 28 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 26 ; 29 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 27 ; 30 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 28 ; 33 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 29 ; 34 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 30 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 31 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 32 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 33 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 34 ; 35 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 35 ; 36 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 36 ; 39 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 37 ; 40 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 38 ; 44 ; 4 ; dtout[0] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 39 ; 45 ; 4 ; a[2] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 40 ; 46 ; 4 ; dtout[4] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 41 ; 49 ; 4 ; dtout[6] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 42 ; 50 ; 4 ; dtout[3] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 43 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 44 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 45 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 46 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 47 ; 51 ; 4 ; dtout[1] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 48 ; 52 ; 4 ; dtout[2] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 49 ; 55 ; 4 ; a[5] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 50 ; 56 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 51 ; 57 ; 3 ; dtout[5] ; output ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 52 ; 58 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 53 ; 59 ; 3 ; dtout[7] ; output ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 54 ; 60 ; 3 ; a[0] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 55 ; 61 ; 3 ; a[4] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 56 ; 62 ; 3 ; a[3] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 57 ; 63 ; 3 ; a[6] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 58 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 59 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 60 ; 68 ; 3 ; ^CONF_DONE ; ; ; ; -- ; ; -- ; -- ;
; 61 ; 69 ; 3 ; ^nSTATUS ; ; ; ; -- ; ; -- ; -- ;
; 62 ; 70 ; 3 ; #TCK ; input ; ; ; -- ; ; -- ; -- ;
; 63 ; 71 ; 3 ; #TMS ; input ; ; ; -- ; ; -- ; -- ;
; 64 ; 72 ; 3 ; #TDO ; output ; ; ; -- ; ; -- ; -- ;
; 65 ; 73 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 66 ; 75 ; 3 ; start ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 67 ; 77 ; 3 ; #TDI ; input ; ; ; -- ; ; -- ; -- ;
; 68 ; 78 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 69 ; 79 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 70 ; 80 ; 3 ; b[7] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 71 ; 81 ; 3 ; b[6] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 72 ; 82 ; 3 ; b[3] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 73 ; 84 ; 3 ; dtout[14] ; output ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 74 ; 87 ; 3 ; b[5] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 75 ; 88 ; 3 ; dtout[13] ; output ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 76 ; 89 ; 2 ; a[7] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 77 ; 90 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 78 ; 93 ; 2 ; b[4] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 79 ; 94 ; 2 ; a[1] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 80 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 81 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 82 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 83 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 84 ; 95 ; 2 ; b[1] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 85 ; 96 ; 2 ; dtout[10] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 86 ; 99 ; 2 ; dtout[8] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 87 ; 100 ; 2 ; b[0] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 88 ; 101 ; 2 ; dtout[12] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 89 ; 105 ; 2 ; b[2] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 90 ; 106 ; 2 ; dtout[15] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 91 ; 109 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 92 ; 110 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 93 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 94 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 95 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 96 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 97 ; 111 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 98 ; 112 ; 2 ; ariend ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 99 ; 115 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 100 ; 116 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
+----------+------------+----------+-------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 30 pF ; (See SSTL-2) ;
+---------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+--------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+--------------------------+
; |multi8x8 ; 37 (0) ; 27 ; 0 ; 35 ; 0 ; 10 (0) ; 13 (0) ; 14 (0) ; 9 (0) ; 0 (0) ; |multi8x8 ;
; |ANDARITH:inst4| ; 8 (8) ; 0 ; 0 ; 0 ; 0 ; 8 (8) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |multi8x8|ANDARITH:inst4 ;
; |ARICTL:inst| ; 6 (6) ; 4 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |multi8x8|ARICTL:inst ;
; |REG16B:inst3| ; 16 (16) ; 16 ; 0 ; 0 ; 0 ; 0 (0) ; 7 (7) ; 9 (9) ; 9 (9) ; 0 (0) ; |multi8x8|REG16B:inst3 ;
; |SREG8B:inst1| ; 7 (7) ; 7 ; 0 ; 0 ; 0 ; 0 (0) ; 6 (6) ; 1 (1) ; 0 (0) ; 0 (0) ; |multi8x8|SREG8B:inst1 ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+--------------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+------------------------------------------------------------------------------------+
; Delay Chain Summary ;
+-----------+----------+---------------+---------------+-----------------------+-----+
; Name ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+-----------+----------+---------------+---------------+-----------------------+-----+
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