📄 lcd.fit.rpt
字号:
; 61 ; VCC_IO ; ;
; 62 ; GND* ; ;
; 63 ; GND* ; ;
; 64 ; GND* ; ;
; 65 ; GND* ; ;
; 66 ; GND_INT ; ;
; 67 ; GND* ; ;
; 68 ; GND* ; ;
; 69 ; GND* ; ;
; 70 ; GND* ; ;
; 71 ; VCC_IO ; ;
; 72 ; GND* ; ;
; 73 ; GND* ; ;
; 74 ; ^nCONFIG ; ;
; 75 ; VCC_INT ; ;
; 76 ; ^MSEL1 ; ;
; 77 ; ^MSEL0 ; ;
; 78 ; GND* ; ;
; 79 ; GND* ; ;
; 80 ; GND* ; ;
; 81 ; GND* ; ;
; 82 ; GND* ; ;
; 83 ; GND* ; ;
; 84 ; GND_INT ; ;
; 85 ; VCC_INT ; ;
; 86 ; GND* ; ;
; 87 ; GND* ; ;
; 88 ; GND* ; ;
; 89 ; GND* ; ;
; 90 ; GND* ; ;
; 91 ; GND* ; ;
; 92 ; GND* ; ;
; 93 ; GND_INT ; ;
; 94 ; VCC_IO ; ;
; 95 ; GND* ; ;
; 96 ; GND* ; ;
; 97 ; GND* ; ;
; 98 ; GND* ; ;
; 99 ; GND* ; ;
; 100 ; GND* ; ;
; 101 ; rs ; LVTTL/LVCMOS ;
; 102 ; rw ; LVTTL/LVCMOS ;
; 103 ; VCC_INT ; ;
; 104 ; GND_INT ; ;
; 105 ; #TDI ; ;
; 106 ; ^nCE ; ;
; 107 ; ^DCLK ; ;
; 108 ; ^DATA0 ; ;
; 109 ; en ; LVTTL/LVCMOS ;
; 110 ; GND* ; ;
; 111 ; cs1 ; LVTTL/LVCMOS ;
; 112 ; cs2 ; LVTTL/LVCMOS ;
; 113 ; GND* ; ;
; 114 ; GND* ; ;
; 115 ; VCC_IO ; ;
; 116 ; GND* ; ;
; 117 ; GND* ; ;
; 118 ; GND* ; ;
; 119 ; GND* ; ;
; 120 ; GND* ; ;
; 121 ; GND* ; ;
; 122 ; GND* ; ;
; 123 ; GND_INT ; ;
; 124 ; GND+ ; ;
; 125 ; GND+ ; ;
; 126 ; GND+ ; ;
; 127 ; VCC_INT ; ;
; 128 ; GND* ; ;
; 129 ; GND_INT ; ;
; 130 ; GND* ; ;
; 131 ; test[3] ; LVTTL/LVCMOS ;
; 132 ; test[2] ; LVTTL/LVCMOS ;
; 133 ; test[1] ; LVTTL/LVCMOS ;
; 134 ; VCC_IO ; ;
; 135 ; test[0] ; LVTTL/LVCMOS ;
; 136 ; data[7] ; LVTTL/LVCMOS ;
; 137 ; data[6] ; LVTTL/LVCMOS ;
; 138 ; data[5] ; LVTTL/LVCMOS ;
; 139 ; GND_INT ; ;
; 140 ; data[4] ; LVTTL/LVCMOS ;
; 141 ; data[3] ; LVTTL/LVCMOS ;
; 142 ; data[2] ; LVTTL/LVCMOS ;
; 143 ; data[1] ; LVTTL/LVCMOS ;
; 144 ; data[0] ; LVTTL/LVCMOS ;
+-------+------------+--------------+
+----------------------------------------------------------+
; Control Signals ;
+---------+--------+---------+--------------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+---------+--------+---------+--------------+--------------+
; clk ; 55 ; 4 ; Clock ; Pin ;
; en~reg0 ; LC1_A2 ; 56 ; Clock ; Internal ;
; rst ; 56 ; 99 ; Clock enable ; Non-global ;
+---------+--------+---------+--------------+--------------+
+-------------------------------------+
; Global & Other Fast Signals ;
+---------+--------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+---------+--------+---------+--------+
; clk ; 55 ; 4 ; yes ;
; en~reg0 ; LC1_A2 ; 56 ; yes ;
; rst ; 56 ; 99 ; no ;
+---------+--------+---------+--------+
+---------------------------------------------+
; Carry Chains ;
+--------------------+------------------------+
; Carry Chain Length ; Number of Carry Chains ;
+--------------------+------------------------+
; 0 ; 0 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 1 ;
; 7 ; 1 ;
; 8 ; 1 ;
+--------------------+------------------------+
+----------------+
; Cascade Chains ;
+--------+-------+
; Length ; Count ;
+--------+-------+
; 2 ; 12 ;
; 3 ; 3 ;
+--------+-------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+----------------+----------------+
; Name ; Fan-Out ;
+----------------+----------------+
; rst ; 99 ;
; addr[1]~320 ; 38 ;
; addr[0]~321 ; 38 ;
; addr[2]~317 ; 37 ;
; addr[4]~318 ; 34 ;
; addr[3]~319 ; 31 ;
; state~1919 ; 20 ;
; state.s16~42 ; 18 ;
; state.s18~54 ; 16 ;
; state.s11~44 ; 16 ;
; state.s13~56 ; 15 ;
; data~4610 ; 14 ;
; addr1[6]~51 ; 11 ;
; LessThan~189 ; 11 ;
; reduce_or~100 ; 11 ;
; Select~3523 ; 11 ;
; state.s19~24 ; 11 ;
; cs1~77 ; 10 ;
; LessThan~191 ; 10 ;
; cs2~37 ; 10 ;
; addr[5]~323 ; 9 ;
; state.s4~70 ; 8 ;
; state.s8~68 ; 8 ;
; LessThan~190 ; 7 ;
; state.s5~38 ; 7 ;
; addr[6]~322 ; 7 ;
; xpage[6]~1994 ; 6 ;
; reduce_or~101 ; 6 ;
; Select~3525 ; 6 ;
; xpage[7]~1992 ; 6 ;
; state.s9~53 ; 6 ;
; state.01110~53 ; 6 ;
; xpage[5]~1991 ; 5 ;
; xpage[4]~1990 ; 5 ;
; xpage[3]~1989 ; 5 ;
; state.s1~44 ; 5 ;
; Select~3527 ; 5 ;
; xpage[1]~1995 ; 5 ;
; xpage[0]~1996 ; 5 ;
; xpage[2]~1993 ; 5 ;
; state.s15~28 ; 5 ;
; data~4599 ; 4 ;
; state.s2~22 ; 4 ;
; state.s6~22 ; 4 ;
; state.s10~23 ; 4 ;
; xpage~1998 ; 4 ;
; reduce_or~98 ; 4 ;
; count[0]~8 ; 4 ;
; state.s17~37 ; 4 ;
; state.s12~37 ; 4 ;
+----------------+----------------+
+---------------------------------------------------------------------------------------------+
; Peripheral Signals ;
+-------------------+--------+-------+-----------------+---------------------------+----------+
; Peripheral Signal ; Source ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+-------------------+--------+-------+-----------------+---------------------------+----------+
; en~reg0 ; LC1_A2 ; Clock ; no ; yes ; -ve ;
+-------------------+--------+-------+-----------------+---------------------------+----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 178 ;
; 1 ; 3 ;
; 2 ; 2 ;
; 3 ; 0 ;
; 4 ; 2 ;
; 5 ; 1 ;
; 6 ; 1 ;
; 7 ; 1 ;
; 8 ; 28 ;
+--------------------------+----------------+
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