filter.sim.rpt

图像处理技术中3*3模板的滤波电路的VHDL实现.

; Coverage Summary                                                   ;
+-----------------------------------------------------+--------------+
; Type                                                ; Value        ;
+-----------------------------------------------------+--------------+
; Total coverage as a percentage                      ;      74.15 % ;
; Total nodes checked                                 ; 236          ;
; Total output ports checked                          ; 236          ;
; Total output ports with complete 1/0-value coverage ; 175          ;
; Total output ports with no 1/0-value coverage       ; 35           ;
; Total output ports with no 1-value coverage         ; 35           ;
; Total output ports with no 0-value coverage         ; 61           ;
+-----------------------------------------------------+--------------+


The following table displays output ports that toggle between 1 and 0 during simulation.
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Complete 1/0-Value Coverage                                                                                                                                                  ;
+-----------------------------------------------------------------------------+-----------------------------------------------------------------------------+------------------+
; Node Name                                                                   ; Output Port Name                                                            ; Output Port Type ;
+-----------------------------------------------------------------------------+-----------------------------------------------------------------------------+------------------+
; |filter|in_data1[0]                                                         ; |filter|in_data1[0]                                                         ; regout           ;
; |filter|in_data1[1]                                                         ; |filter|in_data1[1]                                                         ; regout           ;
; |filter|in_data1[2]                                                         ; |filter|in_data1[2]                                                         ; regout           ;
; |filter|in_data1[3]                                                         ; |filter|in_data1[3]                                                         ; regout           ;
; |filter|in_data1[4]                                                         ; |filter|in_data1[4]                                                         ; regout           ;
; |filter|in_data1[5]                                                         ; |filter|in_data1[5]                                                         ; regout           ;
; |filter|out_data[0]                                                         ; |filter|out_data[0]                                                         ; pin_out          ;
; |filter|out_data[1]                                                         ; |filter|out_data[1]                                                         ; pin_out          ;
; |filter|out_data[2]                                                         ; |filter|out_data[2]                                                         ; pin_out          ;
; |filter|out_data[3]                                                         ; |filter|out_data[3]                                                         ; pin_out          ;
; |filter|out_data[4]                                                         ; |filter|out_data[4]                                                         ; pin_out          ;
; |filter|out_data[5]                                                         ; |filter|out_data[5]                                                         ; pin_out          ;
; |filter|out_data[6]                                                         ; |filter|out_data[6]                                                         ; pin_out          ;
; |filter|in_data[0]                                                          ; |filter|in_data[0]                                                          ; out              ;
; |filter|in_data[1]                                                          ; |filter|in_data[1]                                                          ; out              ;
; |filter|in_data[2]                                                          ; |filter|in_data[2]                                                          ; out              ;
; |filter|in_data[3]                                                          ; |filter|in_data[3]                                                          ; out              ;
; |filter|in_data[4]                                                          ; |filter|in_data[4]                                                          ; out              ;
; |filter|in_data[5]                                                          ; |filter|in_data[5]                                                          ; out              ;
; |filter|clk                                                                 ; |filter|clk                                                                 ; out              ;
; |filter|add_1p:add9|s[6]                                                    ; |filter|add_1p:add9|s[6]                                                    ; regout           ;
; |filter|add_1p:add9|s[5]                                                    ; |filter|add_1p:add9|s[5]                                                    ; regout           ;
; |filter|add_1p:add9|s[4]                                                    ; |filter|add_1p:add9|s[4]                                                    ; regout           ;
; |filter|add_1p:add9|s[3]                                                    ; |filter|add_1p:add9|s[3]                                                    ; regout           ;
; |filter|add_1p:add9|s[2]                                                    ; |filter|add_1p:add9|s[2]                                                    ; regout           ;
; |filter|add_1p:add9|s[1]                                                    ; |filter|add_1p:add9|s[1]                                                    ; regout           ;
; |filter|add_1p:add9|s[0]                                                    ; |filter|add_1p:add9|s[0]                                                    ; regout           ;
; |filter|add_1p:add9|l2[0]                                                   ; |filter|add_1p:add9|l2[0]                                                   ; regout           ;
; |filter|add_1p:add9|l2[1]                                                   ; |filter|add_1p:add9|l2[1]                                                   ; regout           ;
; |filter|add_1p:add9|l2[2]                                                   ; |filter|add_1p:add9|l2[2]                                                   ; regout           ;
; |filter|add_1p:add9|l2[3]                                                   ; |filter|add_1p:add9|l2[3]                                                   ; regout           ;
; |filter|add_1p:add9|l2[4]                                                   ; |filter|add_1p:add9|l2[4]                                                   ; regout           ;
; |filter|add_1p:add9|l2[5]                                                   ; |filter|add_1p:add9|l2[5]                                                   ; regout           ;
; |filter|add_1p:add9|l1[1]                                                   ; |filter|add_1p:add9|l1[1]                                                   ; regout           ;
; |filter|add_1p:add9|l1[2]                                                   ; |filter|add_1p:add9|l1[2]                                                   ; regout           ;
; |filter|add_1p:add9|l1[3]                                                   ; |filter|add_1p:add9|l1[3]                                                   ; regout           ;
; |filter|add_1p:add9|l1[4]                                                   ; |filter|add_1p:add9|l1[4]                                                   ; regout           ;
; |filter|add_1p:add9|l1[5]                                                   ; |filter|add_1p:add9|l1[5]                                                   ; regout           ;
; |filter|add_1p:add9|l1[6]                                                   ; |filter|add_1p:add9|l1[6]                                                   ; regout           ;
; |filter|add_1p:add9|lpm_ff:reg_2|dffs[0]                                    ; |filter|add_1p:add9|lpm_ff:reg_2|dffs[0]                                    ; regout           ;
; |filter|add_1p:add9|lpm_ff:reg_1|dffs[6]                                    ; |filter|add_1p:add9|lpm_ff:reg_1|dffs[6]                                    ; regout           ;
; |filter|add_1p:add9|lpm_ff:reg_1|dffs[5]                                    ; |filter|add_1p:add9|lpm_ff:reg_1|dffs[5]                                    ; regout           ;
; |filter|add_1p:add9|lpm_ff:reg_1|dffs[4]                                    ; |filter|add_1p:add9|lpm_ff:reg_1|dffs[4]                                    ; regout           ;
; |filter|add_1p:add9|lpm_ff:reg_1|dffs[3]                                    ; |filter|add_1p:add9|lpm_ff:reg_1|dffs[3]                                    ; regout           ;
; |filter|add_1p:add9|lpm_ff:reg_1|dffs[2]                                    ; |filter|add_1p:add9|lpm_ff:reg_1|dffs[2]                                    ; regout           ;
; |filter|add_1p:add9|lpm_ff:reg_1|dffs[1]                                    ; |filter|add_1p:add9|lpm_ff:reg_1|dffs[1]                                    ; regout           ;
; |filter|add_1p:add9|lpm_ff:reg_1|dffs[0]                                    ; |filter|add_1p:add9|lpm_ff:reg_1|dffs[0]                                    ; regout           ;
; |filter|add8_9:add8_92|s[5]                                                 ; |filter|add8_9:add8_92|s[5]                                                 ; regout           ;
; |filter|add8_9:add8_92|s[4]                                                 ; |filter|add8_9:add8_92|s[4]                                                 ; regout           ;
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