addr_mux.v

来自「一个验证过的CAM源码（CAM=Content Address Memory）。」· Verilog 代码 · 共 50 行

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//      Block Name      : addr_mux.v
//      Author          : Jason Kassoff
//      Date            : 01/28/01
//      Last Revision   : 01/28/01 (by Jason Kassoff)
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//      Block Description :
//          This block models the multiplexor that selects between
//          the RAM address from the priority block and the address
//          from the bus
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// Controls: amx_sel_s2
// Inputs: amx_pri_addr_v2, amx_cam_addr_s2
// Outputs: amx_addr_out_v2
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`include "definitions.v"
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module addr_mux ( amx_sel_s2, amx_pri_addr_v2, amx_cam_addr_s2,
                  amx_addr_out_v2 );
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// Port Declarations
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input amx_sel_s2;
input [19:0] amx_pri_addr_v2;
input [19:0] amx_cam_addr_s2;
output [19:0] amx_addr_out_v2;

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// Internal Variable Declarations
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wire [19:0] amx_addr_out_v2;

// select output based on amx_sel_s2

assign amx_addr_out_v2 = (amx_sel_s2 == `ADDR_SEL_PRI) ?
                         amx_pri_addr_v2 : amx_cam_addr_s2;

endmodule // addr_mux