📄 clock.tan.rpt
字号:
; Number of destination nodes to report ; 10 ; ; ; ;
; Number of paths to report ; 200 ; ; ; ;
; Report Minimum Timing Checks ; Off ; ; ; ;
; Use Fast Timing Models ; Off ; ; ; ;
; Report IO Paths Separately ; Off ; ; ; ;
; Default hold multicycle ; Same as Multicycle ; ; ; ;
; Cut paths between unrelated clock domains ; On ; ; ; ;
; Cut off read during write signal paths ; On ; ; ; ;
; Cut off feedback from I/O pins ; On ; ; ; ;
; Report Combined Fast/Slow Timing ; Off ; ; ; ;
; Ignore Clock Settings ; Off ; ; ; ;
; Analyze latches as synchronous elements ; Off ; ; ; ;
; Enable Recovery/Removal analysis ; Off ; ; ; ;
; Enable Clock Latency ; Off ; ; ; ;
+-------------------------------------------------------+--------------------+------+----+-------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; CLK_50 ; ; User Pin ; NONE ; 0.000 ns ; 0.000 ns ; NONE ; N/A ; N/A ; N/A ; ;
; SEThour ; ; User Pin ; NONE ; 0.000 ns ; 0.000 ns ; NONE ; N/A ; N/A ; N/A ; ;
; SETmin ; ; User Pin ; NONE ; 0.000 ns ; 0.000 ns ; NONE ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'CLK_50' ;
+-----------------------------------------+-----------------------------------------------------+----------------------+----------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+----------------------+----------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 47.51 MHz ( period = 21.047 ns ) ; HOUR:19|cnt0[1] ; HOUR:19|cnt1[1] ; CLK_50 ; CLK_50 ; None ; None ; 4.791 ns ;
; N/A ; 48.69 MHz ( period = 20.539 ns ) ; HOUR:19|cnt1[1] ; HOUR:19|cnt0[1] ; CLK_50 ; CLK_50 ; None ; None ; 4.283 ns ;
; N/A ; 48.90 MHz ( period = 20.449 ns ) ; HOUR:19|cnt0[1] ; HOUR:19|cnt1[3] ; CLK_50 ; CLK_50 ; None ; None ; 4.193 ns ;
; N/A ; 49.00 MHz ( period = 20.410 ns ) ; HOUR:19|cnt0[0] ; HOUR:19|cnt0[1] ; CLK_50 ; CLK_50 ; None ; None ; 4.154 ns ;
; N/A ; 49.28 MHz ( period = 20.291 ns ) ; HOUR:19|cnt1[1] ; HOUR:19|cnt0[3] ; CLK_50 ; CLK_50 ; None ; None ; 4.035 ns ;
; N/A ; 49.29 MHz ( period = 20.290 ns ) ; HOUR:19|cnt1[1] ; HOUR:19|cnt0[2] ; CLK_50 ; CLK_50 ; None ; None ; 4.034 ns ;
; N/A ; 49.30 MHz ( period = 20.285 ns ) ; HOUR:19|cnt0[3] ; HOUR:19|cnt1[1] ; CLK_50 ; CLK_50 ; None ; None ; 4.029 ns ;
; N/A ; 49.39 MHz ( period = 20.247 ns ) ; HOUR:19|cnt0[1] ; HOUR:19|cnt0[1] ; CLK_50 ; CLK_50 ; None ; None ; 3.991 ns ;
; N/A ; 49.56 MHz ( period = 20.179 ns ) ; HOUR:19|cnt0[0] ; HOUR:19|cnt1[1] ; CLK_50 ; CLK_50 ; None ; None ; 3.923 ns ;
; N/A ; 49.58 MHz ( period = 20.169 ns ) ; HOUR:19|cnt0[2] ; HOUR:19|cnt1[1] ; CLK_50 ; CLK_50 ; None ; None ; 3.913 ns ;
; N/A ; 49.60 MHz ( period = 20.162 ns ) ; HOUR:19|cnt0[0] ; HOUR:19|cnt0[3] ; CLK_50 ; CLK_50 ; None ; None ; 3.906 ns ;
; N/A ; 49.60 MHz ( period = 20.161 ns ) ; HOUR:19|cnt0[0] ; HOUR:19|cnt0[2] ; CLK_50 ; CLK_50 ; None ; None ; 3.905 ns ;
; N/A ; 49.66 MHz ( period = 20.136 ns ) ; HOUR:19|cnt0[2] ; HOUR:19|cnt0[1] ; CLK_50 ; CLK_50 ; None ; None ; 3.880 ns ;
; N/A ; 49.67 MHz ( period = 20.132 ns ) ; HOUR:19|cnt0[1] ; HOUR:19|cnt1[2] ; CLK_50 ; CLK_50 ; None ; None ; 3.876 ns ;
; N/A ; 50.00 MHz ( period = 19.999 ns ) ; HOUR:19|cnt0[1] ; HOUR:19|cnt0[3] ; CLK_50 ; CLK_50 ; None ; None ; 3.743 ns ;
; N/A ; 50.01 MHz ( period = 19.998 ns ) ; HOUR:19|cnt0[1] ; HOUR:19|cnt0[2] ; CLK_50 ; CLK_50 ; None ; None ; 3.742 ns ;
; N/A ; 50.08 MHz ( period = 19.967 ns ) ; HOUR:19|cnt0[3] ; HOUR:19|cnt0[1] ; CLK_50 ; CLK_50 ; None ; None ; 3.711 ns ;
; N/A ; 50.28 MHz ( period = 19.888 ns ) ; HOUR:19|cnt0[2] ; HOUR:19|cnt0[3] ; CLK_50 ; CLK_50 ; None ; None ; 3.632 ns ;
; N/A ; 50.28 MHz ( period = 19.887 ns ) ; HOUR:19|cnt0[2] ; HOUR:19|cnt0[2] ; CLK_50 ; CLK_50 ; None ; None ; 3.631 ns ;
; N/A ; 50.49 MHz ( period = 19.804 ns ) ; HOUR:19|cnt1[0] ; HOUR:19|cnt1[1] ; CLK_50 ; CLK_50 ; None ; None ; 3.548 ns ;
; N/A ; 50.69 MHz ( period = 19.728 ns ) ; HOUR:19|cnt0[1] ; HOUR:19|cnt1[0] ; CLK_50 ; CLK_50 ; None ; None ; 3.472 ns ;
; N/A ; 50.71 MHz ( period = 19.719 ns ) ; HOUR:19|cnt0[3] ; HOUR:19|cnt0[3] ; CLK_50 ; CLK_50 ; None ; None ; 3.463 ns ;
; N/A ; 50.72 MHz ( period = 19.718 ns ) ; HOUR:19|cnt0[3] ; HOUR:19|cnt0[2] ; CLK_50 ; CLK_50 ; None ; None ; 3.462 ns ;
; N/A ; 50.79 MHz ( period = 19.687 ns ) ; HOUR:19|cnt0[3] ; HOUR:19|cnt1[3] ; CLK_50 ; CLK_50 ; None ; None ; 3.431 ns ;
; N/A ; 50.96 MHz ( period = 19.625 ns ) ; HOUR:19|cnt1[0] ; HOUR:19|cnt0[1] ; CLK_50 ; CLK_50 ; None ; None ; 3.369 ns ;
; N/A ; 50.96 MHz ( period = 19.622 ns ) ; HOUR:19|cnt1[3] ; HOUR:19|cnt0[1] ; CLK_50 ; CLK_50 ; None ; None ; 3.366 ns ;
; N/A ; 51.07 MHz ( period = 19.581 ns ) ; HOUR:19|cnt0[0] ; HOUR:19|cnt1[3] ; CLK_50 ; CLK_50 ; None ; None ; 3.325 ns ;
; N/A ; 51.10 MHz ( period = 19.571 ns ) ; HOUR:19|cnt0[2] ; HOUR:19|cnt1[3] ; CLK_50 ; CLK_50 ; None ; None ; 3.315 ns ;
; N/A ; 51.61 MHz ( period = 19.377 ns ) ; HOUR:19|cnt1[0] ; HOUR:19|cnt0[3] ; CLK_50 ; CLK_50 ; None ; None ; 3.121 ns ;
; N/A ; 51.61 MHz ( period = 19.376 ns ) ; HOUR:19|cnt1[0] ; HOUR:19|cnt0[2] ; CLK_50 ; CLK_50 ; None ; None ; 3.120 ns ;
; N/A ; 51.62 MHz ( period = 19.374 ns ) ; HOUR:19|cnt1[3] ; HOUR:19|cnt0[3] ; CLK_50 ; CLK_50 ; None ; None ; 3.118 ns ;
; N/A ; 51.62 MHz ( period = 19.373 ns ) ; HOUR:19|cnt1[3] ; HOUR:19|cnt0[2] ; CLK_50 ; CLK_50 ; None ; None ; 3.117 ns ;
; N/A ; 51.63 MHz ( period = 19.370 ns ) ; HOUR:19|cnt0[3] ; HOUR:19|cnt1[2] ; CLK_50 ; CLK_50 ; None ; None ; 3.114 ns ;
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