dds.jhd

来自「《Verilog-HDL实践与应用系统设计》一书中的光盘源文件」· JHD 代码 · 共 12 行

JHD
12 行
字号 
MODULE DDS
   SUBMODULE CNT10
   SUBMODULE FULLADDER
   SUBMODULE R_SYDFF
MODULE CNT10
MODULE FULLADDER
   SUBMODULE ADDER
   SUBMODULE F_ADDER
MODULE R_SYDFF
MODULE F_ADDER
MODULE ADDER

dds.jhd - 源码说明

本页面展示了「《Verilog-HDL实践与应用系统设计》一书中的光盘源文件」中的 dds.jhd 源码文件，采用 JHD 编程语言编写，共 12 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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