📄 urat.fit.rpt
字号:
; Auto Packed Registers -- Cyclone ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Perform Physical Synthesis for Combinational Logic ; Off ; Off ;
; Perform Register Duplication ; Off ; Off ;
; Perform Register Retiming ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Logic Cell Insertion - Logic Duplication ; Auto ; Auto ;
; Auto Register Duplication ; Auto ; Auto ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
+----------------------------------------------------+--------------------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/程序/uart/urat.pin.
+------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+--------------------+
; Resource ; Usage ;
+---------------------------------------------+--------------------+
; Total logic elements ; 73 / 4,000 ( 2 % ) ;
; -- Combinational with no register ; 44 ;
; -- Register only ; 4 ;
; -- Combinational with a register ; 25 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 37 ;
; -- 3 input functions ; 17 ;
; -- 2 input functions ; 14 ;
; -- 1 input functions ; 2 ;
; -- 0 input functions ; 3 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 66 ;
; -- arithmetic mode ; 7 ;
; -- qfbk mode ; 4 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 11 ;
; -- asynchronous clear/load mode ; 29 ;
; ; ;
; Total LABs ; 11 / 400 ( 3 % ) ;
; Logic elements in carry chains ; 8 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 15 / 249 ( 6 % ) ;
; -- Clock pins ; 0 / 2 ( 0 % ) ;
; Global signals ; 3 ;
; M4Ks ; 0 / 17 ( 0 % ) ;
; Total memory bits ; 0 / 78,336 ( 0 % ) ;
; Total RAM block bits ; 0 / 78,336 ( 0 % ) ;
; PLLs ; 0 / 2 ( 0 % ) ;
; Global clocks ; 3 / 8 ( 38 % ) ;
; Maximum fan-out node ; rst ;
; Maximum fan-out ; 29 ;
; Highest non-global fan-out signal ; state_tras[1] ;
; Highest non-global fan-out ; 21 ;
; Total fan-out ; 315 ;
; Average fan-out ; 3.46 ;
+---------------------------------------------+--------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; clk ; C7 ; 2 ; 6 ; 18 ; 3 ; 9 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; key_input ; G15 ; 3 ; 29 ; 14 ; 1 ; 18 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; rst ; M10 ; 4 ; 24 ; 0 ; 2 ; 29 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; rxd ; E15 ; 3 ; 29 ; 16 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; clkout ; G13 ; 3 ; 29 ; 14 ; 3 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; en ; E14 ; 3 ; 29 ; 17 ; 4 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; out_data[0] ; R11 ; 4 ; 20 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; out_data[1] ; R14 ; 4 ; 28 ; 0 ; 4 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; out_data[2] ; U15 ; 4 ; 28 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; out_data[3] ; P12 ; 4 ; 26 ; 0 ; 4 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; out_data[4] ; T12 ; 4 ; 22 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; out_data[5] ; V12 ; 4 ; 22 ; 0 ; 5 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; out_data[6] ; U11 ; 4 ; 20 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; out_data[7] ; U14 ; 4 ; 26 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; txd ; F16 ; 3 ; 29 ; 16 ; 5 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
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