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📄 uart.fit.rpt

📁 基于FPGA的UART实现 用VHDL编程
💻 RPT
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;      - txd:inst1|txds             ; 1                 ; OFF     ;
;      - rxd:inst|r_ready           ; 0                 ; ON      ;
;      - txd:inst1|xcnt16[4]~283    ; 0                 ; ON      ;
;      - txd:inst1|xbitcnt[0]~660   ; 0                 ; ON      ;
;      - rxd:inst|state.r_stop      ; 1                 ; OFF     ;
;      - rxd:inst|rbuf[7]~279       ; 0                 ; ON      ;
;      - rxd:inst|state.r_start     ; 1                 ; OFF     ;
;      - rxd:inst|state.r_sample    ; 1                 ; OFF     ;
;      - rxd:inst|Decoder0~104      ; 0                 ; ON      ;
;      - rxd:inst|state.r_wait      ; 1                 ; OFF     ;
;      - rxd:inst|\pro2:count[2]    ; 1                 ; OFF     ;
;      - rxd:inst|\pro2:count[1]    ; 1                 ; OFF     ;
;      - rxd:inst|\pro2:count[3]    ; 1                 ; OFF     ;
;      - rxd:inst|\pro2:count[0]    ; 1                 ; OFF     ;
;      - rxd:inst|state.r_center    ; 1                 ; OFF     ;
;      - rxd:inst|\pro2:rcnt[0]~55  ; 0                 ; ON      ;
; clk                               ;                   ;         ;
; rxd                               ;                   ;         ;
;      - rxd:inst|\pro2:rbufs[5]    ; 0                 ; ON      ;
;      - rxd:inst|\pro2:rbufs[6]    ; 0                 ; ON      ;
;      - rxd:inst|\pro2:rbufs[4]    ; 0                 ; ON      ;
;      - rxd:inst|\pro2:rbufs[7]    ; 0                 ; ON      ;
;      - rxd:inst|\pro2:rbufs[2]    ; 0                 ; ON      ;
;      - rxd:inst|\pro2:rbufs[1]    ; 0                 ; ON      ;
;      - rxd:inst|\pro2:rbufs[0]    ; 0                 ; ON      ;
;      - rxd:inst|\pro2:rbufs[3]    ; 0                 ; ON      ;
;      - rxd:inst|state.r_start     ; 0                 ; ON      ;
;      - rxd:inst|state.r_center    ; 0                 ; ON      ;
;      - rxd:inst|\pro2:rcnt[0]~55  ; 0                 ; ON      ;
;      - rxd:inst|Selector2~81      ; 0                 ; ON      ;
;      - rxd:inst|\pro2:count[0]~74 ; 0                 ; ON      ;
+-----------------------------------+-------------------+---------+


+--------------------------------------------------------------------------------------------------------------------------------------+
; Control Signals                                                                                                                      ;
+----------------------------+---------------+---------+----------------------------+--------+----------------------+------------------+
; Name                       ; Location      ; Fan-Out ; Usage                      ; Global ; Global Resource Used ; Global Line Name ;
+----------------------------+---------------+---------+----------------------------+--------+----------------------+------------------+
; clk                        ; PIN_17        ; 33      ; Clock                      ; yes    ; Global Clock         ; GCLK1            ;
; fre:inst4|bclk             ; LC_X8_Y6_N9   ; 102     ; Clock                      ; yes    ; Global Clock         ; GCLK2            ;
; reset                      ; PIN_36        ; 21      ; Async. clear, Clock enable ; yes    ; Global Clock         ; GCLK3            ;
; rxd:inst|\pro2:count[0]~74 ; LC_X18_Y8_N0  ; 4       ; Clock enable               ; no     ; --                   ; --               ;
; rxd:inst|\pro2:rcnt[0]~55  ; LC_X17_Y4_N6  ; 32      ; Clock enable               ; no     ; --                   ; --               ;
; rxd:inst|rbuf[7]~279       ; LC_X18_Y9_N4  ; 8       ; Clock enable               ; no     ; --                   ; --               ;
; rxd:inst|state.r_sample    ; LC_X17_Y4_N7  ; 35      ; Sync. clear                ; no     ; --                   ; --               ;
; txd:inst1|state.x_shift    ; LC_X20_Y11_N7 ; 36      ; Sync. clear                ; no     ; --                   ; --               ;
; txd:inst1|xbitcnt[0]~660   ; LC_X20_Y7_N8  ; 32      ; Clock enable               ; no     ; --                   ; --               ;
; txd:inst1|xcnt16[4]~282    ; LC_X21_Y11_N8 ; 5       ; Sync. clear                ; no     ; --                   ; --               ;
; txd:inst1|xcnt16[4]~283    ; LC_X20_Y11_N9 ; 5       ; Clock enable               ; no     ; --                   ; --               ;
+----------------------------+---------------+---------+----------------------------+--------+----------------------+------------------+


+----------------------------------------------------------------------------------+
; Global & Other Fast Signals                                                      ;
+----------------+-------------+---------+----------------------+------------------+
; Name           ; Location    ; Fan-Out ; Global Resource Used ; Global Line Name ;
+----------------+-------------+---------+----------------------+------------------+
; clk            ; PIN_17      ; 33      ; Global Clock         ; GCLK1            ;
; fre:inst4|bclk ; LC_X8_Y6_N9 ; 102     ; Global Clock         ; GCLK2            ;
; reset          ; PIN_36      ; 21      ; Global Clock         ; GCLK3            ;
+----------------+-------------+---------+----------------------+------------------+


+--------------------------------------+
; Non-Global High Fan-Out Signals      ;
+----------------------------+---------+
; Name                       ; Fan-Out ;
+----------------------------+---------+
; txd:inst1|state.x_shift    ; 36      ;
; rxd:inst|state.r_sample    ; 35      ;
; rxd:inst|\pro2:rcnt[0]~55  ; 32      ;
; txd:inst1|xbitcnt[0]~660   ; 32      ;
; rxd                        ; 13      ;
; rxd:inst|\pro2:rcnt[2]     ; 10      ;
; rxd:inst|\pro2:rcnt[1]     ; 10      ;
; rxd:inst|\pro2:rcnt[0]     ; 10      ;
; rxd:inst|Decoder0~104      ; 8       ;
; rxd:inst|rbuf[7]~279       ; 8       ;
; rxd:inst|\pro2:count[0]    ; 6       ;
; rxd:inst|state.r_wait      ; 6       ;
; rxd:inst|state~96          ; 5       ;
; rxd:inst|\pro2:count[1]    ; 5       ;
; fre:inst4|Equal0~309       ; 5       ;
; txd:inst1|xcnt16[4]~283    ; 5       ;
; txd:inst1|xcnt16[4]~282    ; 5       ;
; txd:inst1|state.x_wait     ; 5       ;
; txd:inst1|state.x_stop     ; 5       ;
; fre:inst4|Add0~538         ; 5       ;
; fre:inst4|Add0~532         ; 5       ;
; fre:inst4|Add0~518         ; 5       ;
; fre:inst4|Add0~508         ; 5       ;
; fre:inst4|Add0~498         ; 5       ;
; fre:inst4|Add0~484         ; 5       ;
; rxd:inst|\pro2:rcnt[25]~6  ; 5       ;
; rxd:inst|\pro2:rcnt[20]~6  ; 5       ;
; rxd:inst|\pro2:rcnt[15]~6  ; 5       ;
; rxd:inst|\pro2:rcnt[10]~6  ; 5       ;
; rxd:inst|\pro2:rcnt[5]~6   ; 5       ;
; rxd:inst|\pro2:rcnt[0]~54  ; 5       ;
; txd:inst1|xbitcnt[25]~652  ; 5       ;
; txd:inst1|xbitcnt[20]~647  ; 5       ;
; txd:inst1|xbitcnt[15]~642  ; 5       ;
; txd:inst1|xbitcnt[10]~637  ; 5       ;
; txd:inst1|xbitcnt[5]~632   ; 5       ;
; txd:inst1|xbitcnt[1]       ; 5       ;
; txd:inst1|xbitcnt[0]~628   ; 5       ;
; txd:inst1|xbitcnt[0]       ; 5       ;
; txd:inst1|xcnt16[4]        ; 5       ;
; rxd:inst|\pro2:count[0]~74 ; 4       ;
; rxd:inst|Equal0~30         ; 4       ;
; rxd:inst|state.r_center    ; 4       ;
; rxd:inst|\pro2:count[2]    ; 4       ;
; rxd:inst|state.r_start     ; 4       ;
; rxd:inst|r_ready           ; 4       ;
; txd:inst1|LessThan0~66     ; 4       ;
; txd:inst1|state.x_idle     ; 4       ;
; txd:inst1|xcnt16[2]        ; 4       ;
; txd:inst1|xcnt16[1]        ; 4       ;
+----------------------------+---------+


+----------------------------------------------------+
; Interconnect Usage Summary                         ;
+----------------------------+-----------------------+
; Interconnect Resource Type ; Usage                 ;
+----------------------------+-----------------------+
; C4s                        ; 102 / 8,840 ( 1 % )   ;
; Direct links               ; 92 / 11,506 ( < 1 % ) ;
; Global clocks              ; 3 / 8 ( 38 % )        ;
; LAB clocks                 ; 17 / 156 ( 11 % )     ;
; LUT chains                 ; 14 / 2,619 ( < 1 % )  ;
; Local interconnects        ; 227 / 11,506 ( 2 % )  ;
; M4K buffers                ; 0 / 468 ( 0 % )       ;
; R4s                        ; 58 / 7,520 ( < 1 % )  ;
+----------------------------+-----------------------+

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