📄 seg7led.tan.rpt
字号:
; Report Combined Fast/Slow Timing ; Off ; ; ; ;
; Ignore Clock Settings ; Off ; ; ; ;
; Analyze latches as synchronous elements ; On ; ; ; ;
; Enable Recovery/Removal analysis ; Off ; ; ; ;
; Enable Clock Latency ; Off ; ; ; ;
; Use TimeQuest Timing Analyzer ; Off ; ; ; ;
; Minimum Core Junction Temperature ; 0 ; ; ; ;
; Maximum Core Junction Temperature ; 85 ; ; ; ;
; Number of source nodes to report per destination node ; 10 ; ; ; ;
; Number of destination nodes to report ; 10 ; ; ; ;
; Number of paths to report ; 200 ; ; ; ;
; Report Minimum Timing Checks ; Off ; ; ; ;
; Use Fast Timing Models ; Off ; ; ; ;
; Report IO Paths Separately ; Off ; ; ; ;
; Perform Multicorner Analysis ; On ; ; ; ;
; Reports the worst-case path for each clock domain and analysis ; Off ; ; ; ;
+----------------------------------------------------------------+--------------------+------+----+-------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; clk ; ; User Pin ; None ; 0.000 ns ; 0.000 ns ; -- ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'clk' ;
+-----------------------------------------+-----------------------------------------------------+---------------------------+---------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+---------------------------+---------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[22] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[19] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[18] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[17] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[20] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[21] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[16] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[31] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[30] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[28] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[27] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[29] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[25] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[23] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[24] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 184.09 MHz ( period = 5.432 ns ) ; int_div:inst6|clk_div[28] ; int_div:inst6|clk_div[26] ; clk ; clk ; None ; None ; 5.168 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[22] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[19] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[18] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[17] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[20] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[21] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[16] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[31] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[30] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[28] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[27] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[29] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[25] ; clk ; clk ; None ; None ; 5.076 ns ;
; N/A ; 187.27 MHz ( period = 5.340 ns ) ; int_div:inst6|clk_div[20] ; int_div:inst6|clk_div[23] ; clk ; clk ; None ; None ; 5.076 ns ;
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