seg7led.sta.rpt
来自「Verilog HDL源码」· RPT 代码 · 共 496 行 · 第 1/5 页
RPT
496 行
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[17] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|div_out ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[2] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[22] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[19] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[18] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[11] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[14] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[13] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[1] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[20] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[21] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[31] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[6] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[7] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[8] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[9] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[16] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[15] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[12] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[10] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[11] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[0] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[23] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[26] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[24] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[25] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[29] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[28] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[27] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[30] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[0] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[8] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[5] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[4] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[3] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[2] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; clk ; Rise ; int_div:inst6|clk_div[1] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[7] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[6] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[5] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[10] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[9] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[13] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[14] ;
; -1.857 ; 1.000 ; 2.857 ; Period ; int_div:inst6|div_out ; Rise ; lpm_counter0:inst|lpm_counter:lpm_counter_component|cntr_88i:auto_generated|counter_reg_bit[15] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[13] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[12] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[11] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[10] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[9] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[6] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[8] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[7] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[2] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[5] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[4] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[3] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[1] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[0] ;
; 0.108 ; 0.324 ; 0.216 ; High ; clk ; Rise ; segmain:inst1|count[14] ;
; 0.109 ; 0.325 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|div_out ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[17] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[22] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[19] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[18] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[20] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[21] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[31] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[16] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[23] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[26] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[24] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[25] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[29] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[28] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[27] ;
; 0.110 ; 0.326 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[30] ;
; 0.111 ; 0.327 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[14] ;
; 0.111 ; 0.327 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[13] ;
; 0.111 ; 0.327 ; 0.216 ; High ; clk ; Rise ; int_div:inst6|clk_div[6] ;
+--------+--------------+----------------+--------+-----------------------+------------+-------------------------------------------------------------------------------------------------+
+------------------------------------------------+
; Fast 1200mV 0C Model Setup Summary ;
+-----------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------+--------+---------------+
; clk ; -0.794 ; -25.100 ;
; int_div:inst6|div_out ; -0.240 ; -1.088 ;
+-----------------------+--------+---------------+
+------------------------------------------------+
; Fast 1200mV 0C Model Hold Summary ;
+-----------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------+--------+---------------+
; clk ; -1.763 ; -1.763 ;
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