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📄 snake.fit.rpt

📁 利用VHDL语言编写的一个蛇形的程序
💻 RPT
📖 第 1 页 / 共 5 页
字号:
; 223      ; 184        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 224      ; 185        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 225      ; 186        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 226      ; 187        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 227      ; 188        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 228      ; 189        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 229      ;            ;          ; VCCINT         ; power  ;              ; 1.5V    ; --         ;                 ;
; 230      ;            ; 1        ; GND            ; gnd    ;              ;         ; --         ;                 ;
; 231      ;            ; 2        ; VCCIO2         ; power  ;              ; 3.3V    ; --         ;                 ;
; 232      ;            ; 1        ; GND            ; gnd    ;              ;         ; --         ;                 ;
; 233      ; 190        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 234      ; 191        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 235      ; 192        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 236      ; 193        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 237      ; 194        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 238      ; 195        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 239      ; 196        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
; 240      ; 197        ; 2        ; GND*           ;        ;              ;         ; Column I/O ;                 ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+


+------------------------------------------------------------------+
; Output Pin Load For Reported TCO                                 ;
+---------------------+-------+------------------------------------+
; I/O Standard        ; Load  ; Termination Resistance             ;
+---------------------+-------+------------------------------------+
; LVTTL               ; 10 pF ; Not Available                      ;
; LVCMOS              ; 10 pF ; Not Available                      ;
; 2.5 V               ; 10 pF ; Not Available                      ;
; 1.8 V               ; 10 pF ; Not Available                      ;
; 1.5 V               ; 10 pF ; Not Available                      ;
; SSTL-3 Class I      ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II     ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I      ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II     ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 30 pF ; (See SSTL-2)                       ;
; 3.3-V PCI           ; 10 pF ; 25 Ohm                             ;
; LVDS                ; 4 pF  ; 100 Ohm                            ;
; RSDS                ; 0 pF  ; 100 Ohm                            ;
+---------------------+-------+------------------------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity                                                                                                                                                     ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+
; |Snake                     ; 144 (144)   ; 72           ; 0           ; 18   ; 0            ; 72 (72)      ; 12 (12)           ; 60 (60)          ; 29 (29)         ; |Snake              ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------+


+----------------------------------------------------------------------------------+
; Delay Chain Summary                                                              ;
+---------+----------+---------------+---------------+-----------------------+-----+
; Name    ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+---------+----------+---------------+---------------+-----------------------+-----+
; CLK     ; Input    ; OFF           ; OFF           ; --                    ; --  ;
; RST     ; Input    ; ON            ; ON            ; --                    ; --  ;
; SCAN[1] ; Output   ; --            ; --            ; --                    ; --  ;
; SCAN[2] ; Output   ; --            ; --            ; --                    ; --  ;
; SCAN[3] ; Output   ; --            ; --            ; --                    ; --  ;
; SCAN[4] ; Output   ; --            ; --            ; --                    ; --  ;
; SCAN[5] ; Output   ; --            ; --            ; --                    ; --  ;
; SCAN[6] ; Output   ; --            ; --            ; --                    ; --  ;
; SCAN[7] ; Output   ; --            ; --            ; --                    ; --  ;
; SCAN[8] ; Output   ; --            ; --            ; --                    ; --  ;
; SEG7[1] ; Output   ; --            ; --            ; --                    ; --  ;
; SEG7[2] ; Output   ; --            ; --            ; --                    ; --  ;
; SEG7[3] ; Output   ; --            ; --            ; --                    ; --  ;
; SEG7[4] ; Output   ; --            ; --            ; --                    ; --  ;
; SEG7[5] ; Output   ; --            ; --            ; --                    ; --  ;
; SEG7[6] ; Output   ; --            ; --            ; --                    ; --  ;
; SEG7[7] ; Output   ; --            ; --            ; --                    ; --  ;
; SEG7[8] ; Output   ; --            ; --            ; --                    ; --  ;
+---------+----------+---------------+---------------+-----------------------+-----+


+---------------------------------------------------+
; Pad To Core Delay Chain Fanout                    ;
+---------------------+-------------------+---------+
; Source Pin / Fanout ; Pad To Core Index ; Setting ;
+---------------------+-------------------+---------+
; CLK                 ;                   ;         ;
; RST                 ;                   ;         ;
;      - snak[17]     ; 0                 ; ON      ;
;      - snak[23]     ; 0                 ; ON      ;
;      - snak[15]     ; 0                 ; ON      ;
;      - snak[31]     ; 0                 ; ON      ;
;      - q[1]         ; 0                 ; ON      ;
;      - snak[7]      ; 0                 ; ON      ;
;      - q[3]         ; 0                 ; ON      ;
;      - snak[20]     ; 0                 ; ON      ;
;      - q[5]         ; 0                 ; ON      ;
;      - q[6]         ; 0                 ; ON      ;
;      - snak[26]     ; 0                 ; ON      ;
;      - q[7]         ; 0                 ; ON      ;
;      - snak[1]      ; 0                 ; ON      ;
;      - q[8]         ; 0                 ; ON      ;
;      - snak[6]      ; 0                 ; ON      ;
;      - q[2]         ; 0                 ; ON      ;
;      - loop[3]      ; 0                 ; ON      ;
;      - loop[0]      ; 0                 ; ON      ;
;      - loop[1]      ; 0                 ; ON      ;
;      - loop[2]      ; 0                 ; ON      ;
;      - loop[4]      ; 0                 ; ON      ;
;      - sign         ; 0                 ; ON      ;
;      - loopn[1]     ; 0                 ; ON      ;
;      - loopn[0]     ; 0                 ; ON      ;
;      - snak~525     ; 0                 ; ON      ;
;      - snak~533     ; 0                 ; ON      ;
;      - snak~535     ; 0                 ; ON      ;
;      - snak~536     ; 0                 ; ON      ;
+---------------------+-------------------+---------+


+-------------------------------------------------------------------------------------------------------+
; Control Signals                                                                                       ;
+------------+--------------+---------+--------------+--------+----------------------+------------------+
; Name       ; Location     ; Fan-Out ; Usage        ; Global ; Global Resource Used ; Global Line Name ;
+------------+--------------+---------+--------------+--------+----------------------+------------------+
; CLK        ; PIN_28       ; 25      ; Clock        ; yes    ; Global clock         ; GCLK2            ;
; RST        ; PIN_1        ; 28      ; Sync. clear  ; no     ; --                   ; --               ;
; Select~816 ; LC_X7_Y5_N2  ; 4       ; Clock enable ; no     ; --                   ; --               ;
; clk_2HZ    ; LC_X8_Y10_N0 ; 31      ; Clock        ; yes    ; Global clock         ; GCLK3            ;
; count[8]   ; LC_X6_Y14_N2 ; 17      ; Clock        ; yes    ; Global clock         ; GCLK1            ;
; sign       ; LC_X6_Y8_N4  ; 18      ; Sync. load   ; no     ; --                   ; --               ;
+------------+--------------+---------+--------------+--------+----------------------+------------------+


+-----------------------------------------------------------------------------+
; Global & Other Fast Signals                                                 ;
+----------+--------------+---------+----------------------+------------------+
; Name     ; Location     ; Fan-Out ; Global Resource Used ; Global Line Name ;
+----------+--------------+---------+----------------------+------------------+
; CLK      ; PIN_28       ; 25      ; Global clock         ; GCLK2            ;
; clk_2HZ  ; LC_X8_Y10_N0 ; 31      ; Global clock         ; GCLK3            ;
; count[8] ; LC_X6_Y14_N2 ; 17      ; Global clock         ; GCLK1            ;
+----------+--------------+---------+----------------------+------------------+


+---------------------------------+
; Non-Global High Fan-Out Signals ;
+----------------+----------------+
; Name           ; Fan-Out        ;
+----------------+----------------+
; RST            ; 28             ;
; loop[2]        ; 21             ;
; loop[1]        ; 21             ;

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