counter.fit.rpt

verilog写的频率计程序的计数模块,

+----------------------------------------------------------------------------------------+
; Fitter Device Options                                                                  ;
+----------------------------------------------+-----------------------------------------+
; Option                                       ; Setting                                 ;
+----------------------------------------------+-----------------------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off                                     ;
; Enable device-wide reset (DEV_CLRn)          ; Off                                     ;
; Enable device-wide output enable (DEV_OE)    ; Off                                     ;
; Enable INIT_DONE output                      ; Off                                     ;
; Configuration scheme                         ; Passive Serial                          ;
; Reserve all unused pins                      ; As output driving an unspecified signal ;
; Security bit                                 ; Off                                     ;
; Base pin-out file on sameframe device        ; Off                                     ;
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+------------------+
; Fitter Equations ;
+------------------+
The equations can be found in E:/戴仙金/书/Verilog书/源代码/cymometer/counter/counter.fit.eqn.


+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/戴仙金/书/Verilog书/源代码/cymometer/counter/counter.pin.


+--------------------------------------------------------------+
; Fitter Resource Usage Summary                                ;
+-------------------------------+------------------------------+
; Resource                      ; Usage                        ;
+-------------------------------+------------------------------+
; Logic cells                   ; 25 / 160 ( 15 % )            ;
; Registers                     ; 25 / 160 ( 15 % )            ;
; Number of pterms used         ; 89                           ;
; User inserted logic elements  ; 0                            ;
; I/O pins                      ; 32 / 64 ( 50 % )             ;
;     -- Clock pins             ; 1 / 2 ( 50 % )               ;
;     -- Dedicated input pins   ; 0 / 2 ( 0 % )                ;
; Global signals                ; 1                            ;
; Shareable expanders           ; 0 / 160 ( 0 % )              ;
; Parallel expanders            ; 0 / 150 ( 0 % )              ;
; Cells using turbo bit         ; 25 / 160 ( 15 % )            ;
; Maximum fan-out node          ; lpm_counter:Q0_rtl_0|dffs[0] ;
; Maximum fan-out               ; 26                           ;
; Total fan-out                 ; 436                          ;
; Average fan-out               ; 7.65                         ;
+-------------------------------+------------------------------+


+--------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins                                                                                                                                 ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; I/O Standard ; Location assigned by ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; CLR  ; 81    ; --       ; 10  ; 25                    ; 0                  ; no     ; no             ; TTL          ; Fitter               ;
; EN   ; 63    ; --       ; 8   ; 25                    ; 0                  ; no     ; no             ; TTL          ; Fitter               ;
; F_IN ; 83    ; --       ; --  ; 25                    ; 0                  ; yes    ; no             ; TTL          ; Fitter               ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+


+--------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins                                                                                                                          ;
+-------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+
; Name  ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ;
+-------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+
; F_OUT ; 8     ; --       ; 1   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q0[0] ; 41    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q0[1] ; 40    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q0[2] ; 37    ; --       ; 5   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q0[3] ; 33    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q1[0] ; 31    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q1[1] ; 30    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q1[2] ; 29    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q1[3] ; 28    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q2[0] ; 27    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q2[1] ; 25    ; --       ; 3   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q2[2] ; 24    ; --       ; 3   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q2[3] ; 20    ; --       ; 3   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q3[0] ; 21    ; --       ; 3   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q3[1] ; 18    ; --       ; 2   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q3[2] ; 22    ; --       ; 3   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q3[3] ; 17    ; --       ; 2   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q4[0] ; 16    ; --       ; 2   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q4[1] ; 15    ; --       ; 2   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q4[2] ; 12    ; --       ; 2   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q4[3] ; 11    ; --       ; 1   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;
; Q5[0] ; 10    ; --       ; 1   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ;