📄 bldcm_con.xml

📁 verlog hdl无刷电机控制程序,已在modelsim仿真

💻 XML

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<interfaceDefinition version='1.1' language='verilog' kind='module' name='bldcm_con'>
    <portList>

      <port name='clk' direction='input' type='' kind='' />
      <port name='dir' direction='input' type='' kind='' />
      <port name='hall' direction='input' type='[2:0]' kind='' />
      <port name='pwmout' direction='output' type='[5:0]' kind='regvector' />

    </portList>
</interfaceDefinition>

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