📄 config_dac.fit.rpt
字号:
; spi_sck ; 125 ; 2 ; 14 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; spi_sdio ; 60 ; 4 ; 14 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 7 / 19 ( 37 % ) ; 3.3V ; -- ;
; 2 ; 8 / 23 ( 35 % ) ; 3.3V ; -- ;
; 3 ; 14 / 23 ( 61 % ) ; 3.3V ; -- ;
; 4 ; 5 / 24 ( 21 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; 1 ; 0 ; 1 ; ~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; On ;
; 2 ; 1 ; 1 ; ~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; On ;
; 3 ; 2 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 4 ; 3 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 5 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 6 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 7 ; 10 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 8 ; 11 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 9 ; 12 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 10 ; 13 ; 1 ; #TDO ; output ; ; ; -- ; ; -- ; -- ;
; 11 ; 14 ; 1 ; #TMS ; input ; ; ; -- ; ; -- ; -- ;
; 12 ; 15 ; 1 ; #TCK ; input ; ; ; -- ; ; -- ; -- ;
; 13 ; 16 ; 1 ; #TDI ; input ; ; ; -- ; ; -- ; -- ;
; 14 ; 17 ; 1 ; ^DATA0 ; input ; ; ; -- ; ; -- ; -- ;
; 15 ; 18 ; 1 ; ^DCLK ; ; ; ; -- ; ; -- ; -- ;
; 16 ; 19 ; 1 ; ^nCE ; ; ; ; -- ; ; -- ; -- ;
; 17 ; 20 ; 1 ; clk ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 18 ; 21 ; 1 ; resetb ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 20 ; 22 ; 1 ; ^nCONFIG ; ; ; ; -- ; ; -- ; -- ;
; 21 ; 23 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 22 ; 24 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 23 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 24 ; 25 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 25 ; 26 ; 1 ; busy ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 26 ; 27 ; 1 ; wr_data[1] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 27 ; 28 ; 1 ; wr_data[7] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 28 ; 32 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 29 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 30 ; 40 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 31 ; 41 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 32 ; 42 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 33 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 34 ; ; ; GND_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 35 ; ; ; VCCD_PLL1 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 36 ; ; ; GND_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 37 ; ; ; VCCA_PLL1 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 38 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 39 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 40 ; 43 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 41 ; 44 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 42 ; 45 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 43 ; 46 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 44 ; 47 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 45 ; 48 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 46 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 47 ; 49 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 48 ; 50 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 49 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 50 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 51 ; 52 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 52 ; 53 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 53 ; 57 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 54 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 55 ; 58 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 56 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 57 ; 59 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 58 ; 60 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 59 ; 63 ; 4 ; spi_sdo ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 60 ; 64 ; 4 ; spi_sdio ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 61 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 62 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 63 ; 72 ; 4 ; wr_rd_addr[0] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 64 ; 75 ; 4 ; wr_data[0] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 65 ; 76 ; 4 ; wr_data[4] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 66 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 67 ; 79 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 68 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 69 ; 80 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 70 ; 81 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 71 ; 82 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 72 ; 83 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 73 ; 84 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 74 ; 85 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 75 ; 86 ; 3 ; rd_data[5] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 76 ; 87 ; 3 ; ~LVDS41p/nCEO~ ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 77 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 78 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 79 ; 95 ; 3 ; wr_en ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 80 ; 97 ; 3 ; wr_data[5] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 81 ; 98 ; 3 ; rd_data[4] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 82 ; 99 ; 3 ; ^nSTATUS ; ; ; ; -- ; ; -- ; -- ;
; 83 ; 100 ; 3 ; ^CONF_DONE ; ; ; ; -- ; ; -- ; -- ;
; 84 ; 101 ; 3 ; ^MSEL1 ; ; ; ; -- ; ; -- ; -- ;
; 85 ; 102 ; 3 ; ^MSEL0 ; ; ; ; -- ; ; -- ; -- ;
; 86 ; 103 ; 3 ; rd_en ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 87 ; 104 ; 3 ; rd_data[1] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 88 ; 105 ; 3 ; wr_rd_addr[4] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 89 ; 106 ; 3 ; wr_data[3] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
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