dled._prj

来自「dp_xiliux 的 CPLD Verilog设计实验,7个LED演示.代码测」· _PRJ 代码 · 共 5 行

_PRJ

5 行

insert  `timescale 1ns/1ns
include 
include dled.v
include d:/Xilinx_WebPACK/verilog/src/iSE/unisim_comp.v

dled._prj - 源码说明

本页面展示了「dp_xiliux 的 CPLD Verilog设计实验,7个LED演示.代码测试通过.」中的 dled._prj 源码文件，采用 _PRJ 编程语言编写，共 5 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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