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📄 dds.fit.rpt

📁 在quartus软件下用VHDL语言实现DDS
💻 RPT
📖 第 1 页 / 共 5 页
字号:
; DA2[6]   ; 21    ; 1        ; 0            ; 20           ; 1           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; DA2[7]   ; 39    ; 1        ; 0            ; 11           ; 1           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; DA2[8]   ; 42    ; 1        ; 0            ; 6            ; 0           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; DA2[9]   ; 44    ; 1        ; 0            ; 6            ; 2           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; DA2_mode ; 6     ; 1        ; 0            ; 24           ; 0           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; DA_clk   ; 38    ; 1        ; 0            ; 11           ; 0           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; a        ; 169   ; 3        ; 53           ; 23           ; 1           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; b        ; 170   ; 3        ; 53           ; 23           ; 0           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; c        ; 167   ; 3        ; 53           ; 22           ; 0           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; d        ; 168   ; 3        ; 53           ; 23           ; 2           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; dig0     ; 160   ; 3        ; 53           ; 20           ; 1           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; dig1     ; 159   ; 3        ; 53           ; 20           ; 2           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; dig2     ; 162   ; 3        ; 53           ; 21           ; 2           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; dig3     ; 161   ; 3        ; 53           ; 20           ; 0           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; dig4     ; 136   ; 3        ; 53           ; 5            ; 0           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; dig5     ; 137   ; 3        ; 53           ; 6            ; 2           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; dig6     ; 138   ; 3        ; 53           ; 6            ; 1           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; dig7     ; 139   ; 3        ; 53           ; 6            ; 0           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; e        ; 165   ; 3        ; 53           ; 22           ; 2           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; f        ; 166   ; 3        ; 53           ; 22           ; 1           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
; g        ; 163   ; 3        ; 53           ; 21           ; 1           ; no              ; no                     ; no            ; no             ; no              ; no         ; no            ; no       ; Off          ; LVTTL        ; 24mA             ; Off         ; User                 ; Unspecified ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+


+------------------------------------------------------------+
; I/O Bank Usage                                             ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage            ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1        ; 24 / 44 ( 54 % ) ; 3.3V          ; --           ;
; 2        ; 1 / 42 ( 2 % )   ; 3.3V          ; --           ;
; 3        ; 22 / 45 ( 48 % ) ; 3.3V          ; --           ;
; 4        ; 0 / 42 ( 0 % )   ; 3.3V          ; --           ;
+----------+------------------+---------------+--------------+


+--------------------------------------------------------------------------------------------------------------------+
; All Package Pins                                                                                                   ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir.   ; I/O Standard ; Voltage ; I/O Type   ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; 1        ; 0          ; 1        ; DA2[1]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 2        ; 1          ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 3        ; 2          ; 1        ; DA2[0]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 4        ; 3          ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 5        ; 4          ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 6        ; 5          ; 1        ; DA2_mode       ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 7        ; 6          ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 8        ; 7          ; 1        ; DA1_mode       ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 9        ;            ; 1        ; VCCIO1         ; power  ;              ; 3.3V    ; --         ;                 ;
; 10       ;            ;          ; GND            ; gnd    ;              ;         ; --         ;                 ;
; 11       ; 8          ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 12       ; 9          ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 13       ; 10         ; 1        ; DA1[8]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 14       ; 11         ; 1        ; DA1[7]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 15       ; 12         ; 1        ; DA2[3]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 16       ; 13         ; 1        ; DA1[6]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 17       ; 14         ; 1        ; DA2[4]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 18       ; 15         ; 1        ; DA1[5]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 19       ; 16         ; 1        ; DA2[5]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 20       ; 17         ; 1        ; DA1[4]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 21       ; 18         ; 1        ; DA2[6]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 22       ;            ; 1        ; VCCIO1         ; power  ;              ; 3.3V    ; --         ;                 ;
; 23       ; 28         ; 1        ; DA1[3]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 24       ; 29         ; 1        ; *~nCSO~ / GND* ; output ; LVTTL        ;         ; Row I/O    ; N               ;
; 25       ; 30         ; 1        ; ^DATA0         ; input  ;              ;         ; --         ;                 ;
; 26       ; 31         ; 1        ; ^nCONFIG       ;        ;              ;         ; --         ;                 ;
; 27       ;            ;          ; VCCA_PLL1      ; power  ;              ; 1.5V    ; --         ;                 ;
; 28       ; 32         ; 1        ; GND+           ;        ;              ;         ; Row I/O    ;                 ;
; 29       ; 33         ; 1        ; GND+           ;        ;              ;         ; Row I/O    ;                 ;
; 30       ;            ;          ; GNDA_PLL1      ; gnd    ;              ;         ; --         ;                 ;
; 31       ;            ;          ; GNDG_PLL1      ; gnd    ;              ;         ; --         ;                 ;
; 32       ; 34         ; 1        ; ^nCEO          ;        ;              ;         ; --         ;                 ;
; 33       ; 35         ; 1        ; ^nCE           ;        ;              ;         ; --         ;                 ;
; 34       ; 36         ; 1        ; ^MSEL0         ;        ;              ;         ; --         ;                 ;
; 35       ; 37         ; 1        ; ^MSEL1         ;        ;              ;         ; --         ;                 ;
; 36       ; 38         ; 1        ; ^DCLK          ; bidir  ;              ;         ; --         ;                 ;
; 37       ; 39         ; 1        ; *~ASDO~ / GND* ; output ; LVTTL        ;         ; Row I/O    ; N               ;
; 38       ; 40         ; 1        ; DA_clk         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 39       ; 41         ; 1        ; DA2[7]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 40       ;            ;          ; GND            ; gnd    ;              ;         ; --         ;                 ;
; 41       ; 52         ; 1        ; DA1[2]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 42       ; 53         ; 1        ; DA2[8]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 43       ; 54         ; 1        ; DA1[1]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 44       ; 55         ; 1        ; DA2[9]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 45       ; 56         ; 1        ; DA1[0]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 46       ; 57         ; 1        ; DA1[9]         ; output ; LVTTL        ;         ; Row I/O    ; Y               ;
; 47       ; 58         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 48       ; 59         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 49       ; 60         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 50       ; 61         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 51       ;            ; 1        ; VCCIO1         ; power  ;              ; 3.3V    ; --         ;                 ;
; 52       ;            ;          ; GND            ; gnd    ;              ;         ; --         ;                 ;
; 53       ; 62         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 54       ; 63         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 55       ; 64         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 56       ; 65         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 57       ; 66         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 58       ; 67         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 59       ; 68         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 60       ; 69         ; 1        ; RESERVED_INPUT ;        ;              ;         ; Row I/O    ;                 ;
; 61       ; 70         ; 4        ; RESERVED_INPUT ;        ;              ;         ; Column I/O ;                 ;
; 62       ; 71         ; 4        ; RESERVED_INPUT ;        ;              ;         ; Column I/O ;                 ;
; 63       ; 72         ; 4        ; RESERVED_INPUT ;        ;              ;         ; Column I/O ;                 ;
; 64       ; 73         ; 4        ; RESERVED_INPUT ;        ;              ;         ; Column I/O ;                 ;
; 65       ; 74         ; 4        ; RESERVED_INPUT ;        ;              ;         ; Column I/O ;                 ;
; 66       ; 75         ; 4        ; RESERVED_INPUT ;        ;              ;         ; Column I/O ;                 ;
; 67       ; 76         ; 4        ; RESERVED_INPUT ;        ;              ;         ; Column I/O ;                 ;
; 68       ; 77         ; 4        ; RESERVED_INPUT ;        ;              ;         ; Column I/O ;                 ;

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