📄 00115.html
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<title>14.2 事件仿真</title>
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<a href="#" onmousedown="showPopup(this, 'popup00295');"><img src="seealsolink.png" border="0" alt="" title=""></a> SystemVerilog 3.1a语言参考手册</div>
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14.2 事件仿真</div>
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<a name="描述"></a><div class="Element11">
<div class="Element10">
<p class="Element10">
SystemVerilog语言根据一个分布式事件执行模型定义。本章详细描述了分布式事件仿真以便提供一个语境来描述SystemVerilog结构的含义和有效解释。这些最终的定义为仿真提供了标准的SystemVerilog参考算法，所有遵从这个标准的仿真器都应该实现这些算法。注意，这些定义具有许多选择，并且不同的仿真器之间的某些执行细节也有些差别。另外，除了本章描述的算法外，SystemVerilog仿真器可以自由地使用不同的算法，只要用户可见的效果与这些参考算法保持一致。 </p>
<p class="Element10">
</p>
<p class="Element10">
一个SystemVerilog描述包含了连接的执行线程或进程。进程是可以计算的对象，它们可以具有状态，并且可以响应输入上的变化以产生输出。进程是并发调度的元素，例如<span style="color: #0000FF">initial</span>块。进程的例子包括但不限于原语、<span style="color: #0000FF">initial</span>、<span style="color: #0000FF">always</span>、<span style="color: #0000FF">always_comb</span>、<span style="color: #0000FF">always_latch</span>以及<span style="color: #0000FF">always_ff</span>过程块、连续赋值、异步任务、以及过程赋值语句。 </p>
<p class="Element10">
</p>
<p class="Element10">
在被仿真的系统描述中，一个线网或变量的每一个变化都被认为是一个更新事件。 </p>
<p class="Element10">
</p>
<p class="Element10">
进程敏感于更新事件。当一个更新事件被执行的时候，敏感于这个事件的所有进程都会以任意顺序计算。一个进程的计算也是一个事件，这个事件被称为计算事件。 </p>
<p class="Element10">
</p>
<p class="Element10">
计算事件还包含PLI回调，这些PLI回调是执行模型中的一些点，其中用户定义的外部例程能够从仿真核中被调用。 </p>
<p class="Element10">
</p>
<p class="Element10">
除了事件之外，仿真器的另外一个关键方面是时间。术语仿真时间被用来指代由仿真器维护的时间值，它用来建模正在仿真的系统描述所花费的时间。在本章中，术语时间可以与仿真时间互换使用。 </p>
<p class="Element10">
</p>
<p class="Element10">
为了支持清晰并且可预测的交互作用，单个时隙被划分成多个区域，在这些区域中规定了特定执行类型排序的事件被调度。这就使得当被测设计处于一个稳定状态的时候特性和检查器能够采样数据。特性表达式可以被安全地计算，并且测试平台能够与特性和检查器以零延时相互作用，而这些都是以一个可预测的方式进行。这种机制还允许设计、时钟传输具有非零的延时，和/或激励和响应被自由地混合并与周期精确的描述相一致。</p></div>
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<td>
<font size=2>除非特别声明，原文版权归作者所有，如有转摘请注明原作者以及译者（<a href="http://www.fpgatech.net/" target="_blank">FPGA技术网</a>）信息。<br />
如果您对本主题有何建议或意见，请登陆<a href="http://www.fpgatech.net/forum/forumdisplay.php?fid=18" target="_blank">FPGA开发者家园</a>提交，您的参与是我们前进的动力。</font>
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