watch.done

来自「一个用VHDL编程基于CPLD的EDA实验板开发可以实现顺计时和倒计时的秒表。要」· DONE 代码 · 共 2 行

DONE
2 行
字号 
Wed Mar 12 09:47:48 2008

watch.done - 源码说明

本页面展示了「一个用VHDL编程基于CPLD的EDA实验板开发可以实现顺计时和倒计时的秒表。要求计时的范围为00.0S~99.9S」中的 watch.done 源码文件，采用 DONE 编程语言编写，共 2 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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