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📄 ch_fir.map.rpt

📁 基于分布式算法的FPGA实现的FIR滤波器源码
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📖 第 1 页 / 共 3 页
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; CH_FIR.bdf                         ; yes             ; User Block Diagram/Schematic File  ; D:/altera/70/quartus/CH_FIR/CH_FIR.bdf                             ;
; altsyncram.tdf                     ; yes             ; Megafunction                       ; d:/altera/70/quartus/libraries/megafunctions/altsyncram.tdf        ;
; stratix_ram_block.inc              ; yes             ; Megafunction                       ; d:/altera/70/quartus/libraries/megafunctions/stratix_ram_block.inc ;
; lpm_mux.inc                        ; yes             ; Megafunction                       ; d:/altera/70/quartus/libraries/megafunctions/lpm_mux.inc           ;
; lpm_decode.inc                     ; yes             ; Megafunction                       ; d:/altera/70/quartus/libraries/megafunctions/lpm_decode.inc        ;
; aglobal70.inc                      ; yes             ; Megafunction                       ; d:/altera/70/quartus/libraries/megafunctions/aglobal70.inc         ;
; a_rdenreg.inc                      ; yes             ; Megafunction                       ; d:/altera/70/quartus/libraries/megafunctions/a_rdenreg.inc         ;
; altrom.inc                         ; yes             ; Megafunction                       ; d:/altera/70/quartus/libraries/megafunctions/altrom.inc            ;
; altram.inc                         ; yes             ; Megafunction                       ; d:/altera/70/quartus/libraries/megafunctions/altram.inc            ;
; altdpram.inc                       ; yes             ; Megafunction                       ; d:/altera/70/quartus/libraries/megafunctions/altdpram.inc          ;
; altqpram.inc                       ; yes             ; Megafunction                       ; d:/altera/70/quartus/libraries/megafunctions/altqpram.inc          ;
; db/altsyncram_jp61.tdf             ; yes             ; Auto-Generated Megafunction        ; D:/altera/70/quartus/CH_FIR/db/altsyncram_jp61.tdf                 ;
; Serial_adder4.vhd                  ; yes             ; Other                              ; D:/altera/70/quartus/CH_FIR/Serial_adder4.vhd                      ;
+------------------------------------+-----------------+------------------------------------+--------------------------------------------------------------------+


+-----------------------------------------------------+
; Analysis & Synthesis Resource Usage Summary         ;
+---------------------------------------------+-------+
; Resource                                    ; Usage ;
+---------------------------------------------+-------+
; Estimated Total logic elements              ; 116   ;
;                                             ;       ;
; Total combinational functions               ; 47    ;
; Logic element usage by number of LUT inputs ;       ;
;     -- 4 input functions                    ; 7     ;
;     -- 3 input functions                    ; 35    ;
;     -- <=2 input functions                  ; 5     ;
;                                             ;       ;
; Logic elements by mode                      ;       ;
;     -- normal mode                          ; 37    ;
;     -- arithmetic mode                      ; 10    ;
;                                             ;       ;
; Total registers                             ; 116   ;
;     -- Dedicated logic registers            ; 116   ;
;     -- I/O registers                        ; 0     ;
;                                             ;       ;
; I/O pins                                    ; 0     ;
; Total memory bits                           ; 160   ;
; Maximum fan-out node                        ; clk   ;
; Maximum fan-out                             ; 126   ;
; Total fan-out                               ; 458   ;
; Average fan-out                             ; 2.36  ;
+---------------------------------------------+-------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity                                                                                                                                                                                                      ;
+-------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+--------------------------------------------------------------------------------------------+
; Compilation Hierarchy Node                      ; LC Combinationals ; LC Registers ; Memory Bits ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; Full Hierarchy Name                                                                        ;
+-------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+--------------------------------------------------------------------------------------------+
; |CH_FIR                                         ; 47 (0)            ; 116 (0)      ; 160         ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR                                                                                    ;
;    |LATCH8:inst1|                               ; 0 (0)             ; 11 (11)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|LATCH8:inst1                                                                       ;
;    |controller:inst3|                           ; 10 (0)            ; 9 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|controller:inst3                                                                   ;
;       |cc:inst|                                 ; 5 (5)             ; 4 (4)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|controller:inst3|cc:inst                                                           ;
;       |div9:inst1|                              ; 5 (5)             ; 5 (5)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|controller:inst3|div9:inst1                                                        ;
;    |input_process:inst|                         ; 16 (0)            ; 75 (0)       ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst                                                                 ;
;       |Serial_adder4:inst|                      ; 8 (0)             ; 4 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|Serial_adder4:inst                                              ;
;          |serial_adder:\label1:0:serial_adderx| ; 2 (2)             ; 1 (1)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|Serial_adder4:inst|serial_adder:\label1:0:serial_adderx         ;
;          |serial_adder:\label1:1:serial_adderx| ; 2 (2)             ; 1 (1)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|Serial_adder4:inst|serial_adder:\label1:1:serial_adderx         ;
;          |serial_adder:\label1:2:serial_adderx| ; 2 (2)             ; 1 (1)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|Serial_adder4:inst|serial_adder:\label1:2:serial_adderx         ;
;          |serial_adder:\label1:3:serial_adderx| ; 2 (2)             ; 1 (1)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|Serial_adder4:inst|serial_adder:\label1:3:serial_adderx         ;
;       |ptos:inst2|                              ; 8 (8)             ; 8 (8)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|ptos:inst2                                                      ;
;       |shiftregister:inst1|                     ; 0 (0)             ; 63 (0)       ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|shiftregister:inst1                                             ;
;          |shift_reg:\label2:0:shift_regx|       ; 0 (0)             ; 9 (9)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|shiftregister:inst1|shift_reg:\label2:0:shift_regx              ;
;          |shift_reg:\label2:1:shift_regx|       ; 0 (0)             ; 9 (9)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|shiftregister:inst1|shift_reg:\label2:1:shift_regx              ;
;          |shift_reg:\label2:2:shift_regx|       ; 0 (0)             ; 9 (9)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|shiftregister:inst1|shift_reg:\label2:2:shift_regx              ;
;          |shift_reg:\label2:3:shift_regx|       ; 0 (0)             ; 9 (9)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|shiftregister:inst1|shift_reg:\label2:3:shift_regx              ;
;          |shift_reg:\label2:4:shift_regx|       ; 0 (0)             ; 9 (9)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|shiftregister:inst1|shift_reg:\label2:4:shift_regx              ;
;          |shift_reg:\label2:5:shift_regx|       ; 0 (0)             ; 9 (9)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|shiftregister:inst1|shift_reg:\label2:5:shift_regx              ;
;          |shift_reg:\label2:6:shift_regx|       ; 0 (0)             ; 9 (9)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|input_process:inst|shiftregister:inst1|shift_reg:\label2:6:shift_regx              ;
;    |mac:inst2|                                  ; 21 (0)            ; 21 (0)       ; 160         ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|mac:inst2                                                                          ;
;       |rom:inst1|                               ; 0 (0)             ; 0 (0)        ; 160         ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|mac:inst2|rom:inst1                                                                ;
;          |altsyncram:altsyncram_component|      ; 0 (0)             ; 0 (0)        ; 160         ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|mac:inst2|rom:inst1|altsyncram:altsyncram_component                                ;
;             |altsyncram_jp61:auto_generated|    ; 0 (0)             ; 0 (0)        ; 160         ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|mac:inst2|rom:inst1|altsyncram:altsyncram_component|altsyncram_jp61:auto_generated ;
;       |sa:inst|                                 ; 21 (21)           ; 21 (21)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |CH_FIR|mac:inst2|sa:inst                                                                  ;
+-------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+--------------------------------------------------------------------------------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis RAM Summary                                                                                                                                                         ;
+-----------------------------------------------------------------------------------------------+------+------+--------------+--------------+--------------+--------------+------+---------+
; Name                                                                                          ; Type ; Mode ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Size ; MIF     ;
+-----------------------------------------------------------------------------------------------+------+------+--------------+--------------+--------------+--------------+------+---------+
; mac:inst2|rom:inst1|altsyncram:altsyncram_component|altsyncram_jp61:auto_generated|ALTSYNCRAM ; AUTO ; ROM  ; 16           ; 10           ; --           ; --           ; 160  ; rom.mif ;
+-----------------------------------------------------------------------------------------------+------+------+--------------+--------------+--------------+--------------+------+---------+


Encoding Type:  One-Hot
+----------------------------------------------------------------------------------------------+
; State Machine - |CH_FIR|controller:inst3|cc:inst|present_state                               ;
+------------------+------------------+------------------+------------------+------------------+
; Name             ; present_state.s3 ; present_state.s2 ; present_state.s1 ; present_state.s0 ;
+------------------+------------------+------------------+------------------+------------------+
; present_state.s0 ; 0                ; 0                ; 0                ; 0                ;
; present_state.s1 ; 0                ; 0                ; 1                ; 1                ;
; present_state.s2 ; 0                ; 1                ; 0                ; 1                ;
; present_state.s3 ; 1                ; 0                ; 0                ; 1                ;
+------------------+------------------+------------------+------------------+------------------+


+------------------------------------------------------+
; General Register Statistics                          ;
+----------------------------------------------+-------+
; Statistic                                    ; Value ;
+----------------------------------------------+-------+
; Total registers                              ; 116   ;
; Number of registers using Synchronous Clear  ; 0     ;
; Number of registers using Synchronous Load   ; 0     ;
; Number of registers using Asynchronous Clear ; 0     ;
; Number of registers using Asynchronous Load  ; 0     ;
; Number of registers using Clock Enable       ; 22    ;
; Number of registers using Preset             ; 0     ;
+----------------------------------------------+-------+


+-----------------------------------------------------------------------------------------------------------+
; Source assignments for mac:inst2|rom:inst1|altsyncram:altsyncram_component|altsyncram_jp61:auto_generated ;
+---------------------------------+--------------------+------+---------------------------------------------+
; Assignment                      ; Value              ; From ; To                                          ;
+---------------------------------+--------------------+------+---------------------------------------------+
; OPTIMIZE_POWER_DURING_SYNTHESIS ; NORMAL_COMPILATION ; -    ; -                                           ;
+---------------------------------+--------------------+------+---------------------------------------------+


+--------------------------------------------------------------------------------------------------+
; Parameter Settings for User Entity Instance: mac:inst2|rom:inst1|altsyncram:altsyncram_component ;
+------------------------------------+----------------------+--------------------------------------+
; Parameter Name                     ; Value                ; Type                                 ;
+------------------------------------+----------------------+--------------------------------------+
; BYTE_SIZE_BLOCK                    ; 8                    ; Untyped                              ;
; AUTO_CARRY_CHAINS                  ; ON                   ; AUTO_CARRY                           ;
; IGNORE_CARRY_BUFFERS               ; OFF                  ; IGNORE_CARRY                         ;
; AUTO_CASCADE_CHAINS                ; ON                   ; AUTO_CASCADE                         ;
; IGNORE_CASCADE_BUFFERS             ; OFF                  ; IGNORE_CASCADE                       ;
; WIDTH_BYTEENA                      ; 1                    ; Untyped                              ;
; OPERATION_MODE                     ; ROM                  ; Untyped                              ;
; WIDTH_A                            ; 10                   ; Signed Integer                       ;
; WIDTHAD_A                          ; 4                    ; Signed Integer                       ;
; NUMWORDS_A                         ; 16                   ; Signed Integer                       ;

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