filter.hier_info

来自「基于FPGA的uart控制器」· HIER_INFO 代码 · 共 12 行

HIER_INFO
12 行
字号 
|filter
baud_clk => samples[0].CLK
baud_clk => rxd_sync~reg0.CLK
rst => samples[0].PRESET
rst => rxd_sync~reg0.PRESET
rxd => reduce_nor~0.IN1
rxd => samples[0].DATAIN
rxd => reduce_nor~1.IN1
rxd_sync <= rxd_sync~reg0.DB_MAX_OUTPUT_PORT_TYPE

filter.hier_info - 源码说明

本页面展示了「基于FPGA的uart控制器」中的 filter.hier_info 源码文件，采用 HIER_INFO 编程语言编写，共 12 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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