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📄 adc.fit.rpt

📁 用verilog编程实现的基于FPGA的AD数据采集程序
💻 RPT
📖 第 1 页 / 共 4 页
字号:
; 183   ; GND+          ;              ;
; 184   ; GND+          ;              ;
; 185   ; VCC_INT       ;              ;
; 186   ; data_out7[2]  ; LVTTL/LVCMOS ;
; 187   ; data_out2[0]  ; LVTTL/LVCMOS ;
; 188   ; GND           ;              ;
; 189   ; data_out7[10] ; LVTTL/LVCMOS ;
; 190   ; data_out8[7]  ; LVTTL/LVCMOS ;
; 191   ; GND*          ;              ;
; 192   ; data_out7[6]  ; LVTTL/LVCMOS ;
; 193   ; data_out8[4]  ; LVTTL/LVCMOS ;
; 194   ; VCC_IO        ;              ;
; 195   ; GND*          ;              ;
; 196   ; data_out5[1]  ; LVTTL/LVCMOS ;
; 197   ; GND*          ;              ;
; 198   ; data_out6[1]  ; LVTTL/LVCMOS ;
; 199   ; data_out8[6]  ; LVTTL/LVCMOS ;
; 200   ; GND*          ;              ;
; 201   ; VCC_INT       ;              ;
; 202   ; data_out4[9]  ; LVTTL/LVCMOS ;
; 203   ; data_out6[2]  ; LVTTL/LVCMOS ;
; 204   ; GND*          ;              ;
; 205   ; data_out3[3]  ; LVTTL/LVCMOS ;
; 206   ; GND*          ;              ;
; 207   ; data_out3[6]  ; LVTTL/LVCMOS ;
; 208   ; data_out2[3]  ; LVTTL/LVCMOS ;
+-------+---------------+--------------+


+------------------------------------------------------------------------+
; Control Signals                                                        ;
+----------------------+---------+---------+--------------+--------------+
; Name                 ; Pin #   ; Fan-Out ; Usage        ; Global Usage ;
+----------------------+---------+---------+--------------+--------------+
; ad_sts               ; 103     ; 13      ; Clock        ; Non-global   ;
; clk                  ; 79      ; 4       ; Clock        ; Pin          ;
; did:inst3|CLK_OUT    ; LC1_F26 ; 2       ; Clock        ; Internal     ;
; adc_1:inst|always0~0 ; LC6_H2  ; 1       ; Clock enable ; Non-global   ;
+----------------------+---------+---------+--------------+--------------+


+------------------------------------------------+
; Global & Other Fast Signals                    ;
+-------------------+---------+---------+--------+
; Name              ; Pin #   ; Fan-Out ; Global ;
+-------------------+---------+---------+--------+
; clk               ; 79      ; 4       ; yes    ;
; did:inst3|CLK_OUT ; LC1_F26 ; 2       ; yes    ;
+-------------------+---------+---------+--------+


+----------------------------------------+
; Non-Global High Fan-Out Signals        ;
+------------------------------+---------+
; Name                         ; Fan-Out ;
+------------------------------+---------+
; ad_sts                       ; 13      ;
; did:inst3|num[0]~114         ; 4       ;
; adc_4:inst11|f_r~1           ; 4       ;
; did:inst3|num[1]~113         ; 3       ;
; did:inst3|num[2]~115         ; 3       ;
; adc_1:inst|flag~3            ; 2       ;
; adc_3:inst10|data_out[6]~17  ; 1       ;
; adc_3:inst10|data_out[10]~13 ; 1       ;
; data_in[11]                  ; 1       ;
; data_in[0]                   ; 1       ;
; data_in[1]                   ; 1       ;
; data_in[2]                   ; 1       ;
; data_in[3]                   ; 1       ;
; adc_1:inst|always0~2         ; 1       ;
; data_in[5]                   ; 1       ;
; data_in[6]                   ; 1       ;
; data_in[7]                   ; 1       ;
; data_in[8]                   ; 1       ;
; data_in[9]                   ; 1       ;
; data_in[10]                  ; 1       ;
; adc_1:inst|control~1         ; 1       ;
; adc_3:inst10|data_out[5]~18  ; 1       ;
; adc_3:inst10|data_out[0]~23  ; 1       ;
; adc_3:inst10|data_out[1]~22  ; 1       ;
; data_in[4]                   ; 1       ;
; adc_3:inst10|data_out[3]~20  ; 1       ;
; adc_3:inst10|data_out[4]~19  ; 1       ;
; adc_3:inst10|data_out[7]~16  ; 1       ;
; adc_3:inst10|data_out[9]~14  ; 1       ;
; adc_3:inst10|data_out[2]~21  ; 1       ;
; adc_3:inst10|data_out[8]~15  ; 1       ;
; adc_3:inst10|data_out[11]~12 ; 1       ;
+------------------------------+---------+


+----------------------------------------------------------------------------------------------+
; Peripheral Signals                                                                           ;
+-------------------+---------+-------+-----------------+---------------------------+----------+
; Peripheral Signal ; Source  ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+-------------------+---------+-------+-----------------+---------------------------+----------+
; did:inst3|CLK_OUT ; LC1_F26 ; Clock ; no              ; yes                       ; +ve      ;
+-------------------+---------+-------+-----------------+---------------------------+----------+


+-------------------------------------------+
; LAB                                       ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0                        ; 620            ;
; 1                        ; 1              ;
; 2                        ; 0              ;
; 3                        ; 0              ;
; 4                        ; 1              ;
; 5                        ; 0              ;
; 6                        ; 0              ;
; 7                        ; 1              ;
; 8                        ; 1              ;
+--------------------------+----------------+


+----------------------------------------------+
; Local Routing Interconnect                   ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+
; 0                           ; 622            ;
; 1                           ; 0              ;
; 2                           ; 0              ;
; 3                           ; 2              ;
+-----------------------------+----------------+


+---------------------------------------------+
; LAB External Interconnect                   ;
+----------------------------+----------------+
; LAB External Interconnects ; Number of LABs ;
+----------------------------+----------------+
; 0                          ; 621            ;
; 1                          ; 0              ;
; 2                          ; 1              ;
; 3                          ; 0              ;
; 4                          ; 0              ;
; 5                          ; 1              ;
; 6                          ; 0              ;
; 7                          ; 0              ;
; 8                          ; 1              ;
+----------------------------+----------------+


+-------------------------------------------------------------------------------------------+
; Row Interconnect                                                                          ;
+-------+----------------------+-----------------------------+------------------------------+
; Row   ; Interconnect Used    ; Left Half Interconnect Used ; Right Half Interconnect Used ;
+-------+----------------------+-----------------------------+------------------------------+
;  A    ;  0 / 208 ( 0 % )     ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  B    ;  0 / 208 ( 0 % )     ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  C    ;  0 / 208 ( 0 % )     ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  D    ;  6 / 208 ( 2 % )     ;  8 / 104 ( 7 % )            ;  0 / 104 ( 0 % )             ;
;  E    ;  0 / 208 ( 0 % )     ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  F    ;  1 / 208 ( < 1 % )   ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  G    ;  0 / 208 ( 0 % )     ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  H    ;  2 / 208 ( < 1 % )   ;  7 / 104 ( 6 % )            ;  0 / 104 ( 0 % )             ;
;  I    ;  0 / 208 ( 0 % )     ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  J    ;  0 / 208 ( 0 % )     ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  K    ;  0 / 208 ( 0 % )     ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
;  L    ;  2 / 208 ( < 1 % )   ;  0 / 104 ( 0 % )            ;  0 / 104 ( 0 % )             ;
; Total ;  11 / 2496 ( < 1 % ) ;  15 / 1248 ( 1 % )          ;  0 / 1248 ( 0 % )            ;
+-------+----------------------+-----------------------------+------------------------------+


+----------------------------+
; LAB Column Interconnect    ;
+-------+--------------------+
; Col.  ; Interconnect Used  ;
+-------+--------------------+
; 1     ;  1 / 24 ( 4 % )    ;
; 2     ;  1 / 24 ( 4 % )    ;
; 3     ;  1 / 24 ( 4 % )    ;
; 4     ;  1 / 24 ( 4 % )    ;
; 5     ;  1 / 24 ( 4 % )    ;
; 6     ;  1 / 24 ( 4 % )    ;
; 7     ;  1 / 24 ( 4 % )    ;
; 8     ;  1 / 24 ( 4 % )    ;
; 9     ;  1 / 24 ( 4 % )    ;
; 10    ;  0 / 24 ( 0 % )    ;
; 11    ;  2 / 24 ( 8 % )    ;
; 12    ;  1 / 24 ( 4 % )    ;
; 13    ;  1 / 24 ( 4 % )    ;
; 14    ;  1 / 24 ( 4 % )    ;
; 15    ;  1 / 24 ( 4 % )    ;
; 16    ;  1 / 24 ( 4 % )    ;
; 17    ;  0 / 24 ( 0 % )    ;
; 18    ;  1 / 24 ( 4 % )    ;
; 19    ;  0 / 24 ( 0 % )    ;
; 20    ;  0 / 24 ( 0 % )    ;
; 21    ;  0 / 24 ( 0 % )    ;
; 22    ;  0 / 24 ( 0 % )    ;
; 23    ;  0 / 24 ( 0 % )    ;
; 24    ;  0 / 24 ( 0 % )    ;
; 25    ;  0 / 24 ( 0 % )    ;
; 26    ;  0 / 24 ( 0 % )    ;
; 27    ;  0 / 24 ( 0 % )    ;
; 28    ;  0 / 24 ( 0 % )    ;
; 29    ;  0 / 24 ( 0 % )    ;
; 30    ;  0 / 24 ( 0 % )    ;
; 31    ;  0 / 24 ( 0 % )    ;
; 32    ;  0 / 24 ( 0 % )    ;
; 33    ;  0 / 24 ( 0 % )    ;
; 34    ;  0 / 24 ( 0 % )    ;
; 35    ;  0 / 24 ( 0 % )    ;
; 36    ;  0 / 24 ( 0 % )    ;
; 37    ;  0 / 24 ( 0 % )    ;
; 38    ;  0 / 24 ( 0 % )    ;
; 39    ;  0 / 24 ( 0 % )    ;
; 40    ;  0 / 24 ( 0 % )    ;
; 41    ;  0 / 24 ( 0 % )    ;
; 42    ;  0 / 24 ( 0 % )    ;
; 43    ;  0 / 24 ( 0 % )    ;
; 44    ;  0 / 24 ( 0 % )    ;
; 45    ;  0 / 24 ( 0 % )    ;

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