light.tan.rpt

自己写的一个VHDL程序

+----------------------------------------------------------------+--------------------+------+----+-------------+
; Device Name                                                    ; EPM7128SLC84-7     ;      ;    ;             ;
; Timing Models                                                  ; Final              ;      ;    ;             ;
; Default hold multicycle                                        ; Same as Multicycle ;      ;    ;             ;
; Cut paths between unrelated clock domains                      ; On                 ;      ;    ;             ;
; Cut off read during write signal paths                         ; On                 ;      ;    ;             ;
; Cut off feedback from I/O pins                                 ; On                 ;      ;    ;             ;
; Report Combined Fast/Slow Timing                               ; Off                ;      ;    ;             ;
; Ignore Clock Settings                                          ; Off                ;      ;    ;             ;
; Analyze latches as synchronous elements                        ; On                 ;      ;    ;             ;
; Enable Recovery/Removal analysis                               ; Off                ;      ;    ;             ;
; Enable Clock Latency                                           ; Off                ;      ;    ;             ;
; Use TimeQuest Timing Analyzer                                  ; Off                ;      ;    ;             ;
; Number of source nodes to report per destination node          ; 10                 ;      ;    ;             ;
; Number of destination nodes to report                          ; 10                 ;      ;    ;             ;
; Number of paths to report                                      ; 200                ;      ;    ;             ;
; Report Minimum Timing Checks                                   ; Off                ;      ;    ;             ;
; Use Fast Timing Models                                         ; Off                ;      ;    ;             ;
; Report IO Paths Separately                                     ; Off                ;      ;    ;             ;
; Perform Multicorner Analysis                                   ; Off                ;      ;    ;             ;
; Reports the worst-case path for each clock domain and analysis ; Off                ;      ;    ;             ;
+----------------------------------------------------------------+--------------------+------+----+-------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary                                                                                                                                                             ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type     ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clk25MHz        ;                    ; User Pin ; None             ; 0.000 ns      ; 0.000 ns     ; --       ; N/A                   ; N/A                 ; N/A    ;              ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+


+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'Clk25MHz'                                                                                                                                                                                                                                                                                       ;
+-----------------------------------------+-----------------------------------------------------+-------------------------------------------------+-------------------------------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack                                   ; Actual fmax (period)                                ; From                                            ; To                                              ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+-------------------------------------------------+-------------------------------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A                                     ; 23.81 MHz ( period = 42.000 ns )                    ; controller:inst|numa[0]                         ; display:inst5|display[2]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 12.000 ns               ;
; N/A                                     ; 23.81 MHz ( period = 42.000 ns )                    ; controller:inst|numa[4]                         ; display:inst5|display[2]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 12.000 ns               ;
; N/A                                     ; 23.81 MHz ( period = 42.000 ns )                    ; controller:inst|numa[2]                         ; display:inst5|display[2]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 12.000 ns               ;
; N/A                                     ; 26.60 MHz ( period = 37.600 ns )                    ; controller:inst|numa[0]                         ; display:inst5|display[4]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 26.60 MHz ( period = 37.600 ns )                    ; controller:inst|numa[1]                         ; display:inst5|display[4]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 26.60 MHz ( period = 37.600 ns )                    ; controller:inst|numa[4]                         ; display:inst5|display[4]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 26.60 MHz ( period = 37.600 ns )                    ; controller:inst|numa[3]                         ; display:inst5|display[4]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 26.60 MHz ( period = 37.600 ns )                    ; controller:inst|numa[2]                         ; display:inst5|display[4]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 26.60 MHz ( period = 37.600 ns )                    ; controller:inst|numa[0]                         ; display:inst5|display[6]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 26.60 MHz ( period = 37.600 ns )                    ; controller:inst|numa[1]                         ; display:inst5|display[6]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 26.60 MHz ( period = 37.600 ns )                    ; controller:inst|numa[4]                         ; display:inst5|display[6]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 26.60 MHz ( period = 37.600 ns )                    ; controller:inst|numa[3]                         ; display:inst5|display[6]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 26.60 MHz ( period = 37.600 ns )                    ; controller:inst|numa[2]                         ; display:inst5|display[6]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 9.800 ns                ;
; N/A                                     ; 29.41 MHz ( period = 34.000 ns )                    ; controller:inst|numa[1]                         ; display:inst2|display[4]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 8.000 ns                ;
; N/A                                     ; 29.41 MHz ( period = 34.000 ns )                    ; controller:inst|numa[4]                         ; display:inst2|display[4]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 8.000 ns                ;
; N/A                                     ; 29.41 MHz ( period = 34.000 ns )                    ; controller:inst|numa[3]                         ; display:inst2|display[4]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 8.000 ns                ;
; N/A                                     ; 29.41 MHz ( period = 34.000 ns )                    ; controller:inst|numa[2]                         ; display:inst2|display[4]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 8.000 ns                ;
; N/A                                     ; 29.41 MHz ( period = 34.000 ns )                    ; controller:inst|numa[1]                         ; display:inst5|display[3]                        ; Clk25MHz   ; Clk25MHz ; None                        ; None                      ; 8.000 ns                ;