📄 fir.fit.rpt
字号:
; 45 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 46 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 47 ; 51 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 48 ; 52 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 49 ; 55 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 50 ; 56 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 51 ; 57 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 52 ; 58 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 53 ; 59 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 54 ; 60 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 55 ; 61 ; 3 ; Din[8] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 56 ; 62 ; 3 ; Din[0] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 57 ; 63 ; 3 ; Din[2] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 58 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 59 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 60 ; 68 ; 3 ; ^CONF_DONE ; ; ; ; -- ; ; -- ; -- ;
; 61 ; 69 ; 3 ; ^nSTATUS ; ; ; ; -- ; ; -- ; -- ;
; 62 ; 70 ; 3 ; #TCK ; input ; ; ; -- ; ; -- ; -- ;
; 63 ; 71 ; 3 ; #TMS ; input ; ; ; -- ; ; -- ; -- ;
; 64 ; 72 ; 3 ; #TDO ; output ; ; ; -- ; ; -- ; -- ;
; 65 ; 73 ; 3 ; Din[1] ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 66 ; 75 ; 3 ; clear ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 67 ; 77 ; 3 ; #TDI ; input ; ; ; -- ; ; -- ; -- ;
; 68 ; 78 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 69 ; 79 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 70 ; 80 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 71 ; 81 ; 3 ; Dout[0] ; output ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 72 ; 82 ; 3 ; Dout[1] ; output ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 73 ; 84 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 74 ; 87 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 75 ; 88 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 76 ; 89 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 77 ; 90 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 78 ; 93 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 79 ; 94 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 80 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 81 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 82 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 83 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 84 ; 95 ; 2 ; Dout[6] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 85 ; 96 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 86 ; 99 ; 2 ; Dout[3] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 87 ; 100 ; 2 ; Dout[2] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 88 ; 101 ; 2 ; Dout[5] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 89 ; 105 ; 2 ; Din[7] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 90 ; 106 ; 2 ; Din[6] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 91 ; 109 ; 2 ; Din[3] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 92 ; 110 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 93 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 94 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 95 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 96 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 97 ; 111 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 98 ; 112 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 99 ; 115 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 100 ; 116 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
+----------+------------+----------+-------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 10 pF ; (See SSTL-2) ;
+---------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+-------------+--------------+-------------+------+------+--------------+--------------+-------------------+------------------+-----------------+------------+-----------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; M4Ks ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name ;
+----------------------------+-------------+--------------+-------------+------+------+--------------+--------------+-------------------+------------------+-----------------+------------+-----------------------+
; |fir ; 594 (0) ; 329 ; 0 ; 0 ; 21 ; 0 ; 265 (0) ; 136 (0) ; 193 (0) ; 397 (0) ; 0 (0) ; |fir ;
; |add111414:inst34| ; 14 (14) ; 8 ; 0 ; 0 ; 0 ; 0 ; 6 (6) ; 0 (0) ; 8 (8) ; 14 (14) ; 0 (0) ; |fir|add111414:inst34 ;
; |add141415:inst37| ; 8 (8) ; 8 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 8 (8) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|add141415:inst37 ;
; |add151415:inst35| ; 15 (15) ; 15 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 15 (15) ; 15 (15) ; 0 (0) ; |fir|add151415:inst35 ;
; |add151710:inst19| ; 10 (10) ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 10 (10) ; 10 (10) ; 0 (0) ; |fir|add151710:inst19 ;
; |add161717:inst36| ; 16 (16) ; 16 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 16 (16) ; 16 (16) ; 0 (0) ; |fir|add161717:inst36 ;
; |add9910:inst20| ; 10 (10) ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 10 (10) ; 10 (10) ; 0 (0) ; |fir|add9910:inst20 ;
; |add9910:inst21| ; 10 (10) ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 10 (10) ; 10 (10) ; 0 (0) ; |fir|add9910:inst21 ;
; |add9910:inst22| ; 10 (10) ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 10 (10) ; 10 (10) ; 0 (0) ; |fir|add9910:inst22 ;
; |add9910:inst23| ; 10 (10) ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 10 (10) ; 10 (10) ; 0 (0) ; |fir|add9910:inst23 ;
; |add9910:inst3| ; 10 (10) ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 10 (10) ; 10 (10) ; 0 (0) ; |fir|add9910:inst3 ;
; |add9910:inst4| ; 10 (10) ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 10 (10) ; 10 (10) ; 0 (0) ; |fir|add9910:inst4 ;
; |dff9:inst10| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst10 ;
; |dff9:inst11| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst11 ;
; |dff9:inst14| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst14 ;
; |dff9:inst15| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst15 ;
; |dff9:inst16| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst16 ;
; |dff9:inst17| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst17 ;
; |dff9:inst18| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst18 ;
; |dff9:inst5| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst5 ;
; |dff9:inst6| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst6 ;
; |dff9:inst7| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst7 ;
; |dff9:inst8| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst8 ;
; |dff9:inst9| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst9 ;
; |dff9:inst| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; |fir|dff9:inst ;
; |mult212:inst25| ; 69 (69) ; 16 ; 0 ; 0 ; 0 ; 0 ; 53 (53) ; 3 (3) ; 13 (13) ; 55 (55) ; 0 (0) ; |fir|mult212:inst25 ;
; |mult25:inst26| ; 44 (44) ; 14 ; 0 ; 0 ; 0 ; 0 ; 30 (30) ; 3 (3) ; 11 (11) ; 31 (31) ; 0 (0) ; |fir|mult25:inst26 ;
; |mult29:inst27| ; 71 (71) ; 14 ; 0 ; 0 ; 0 ; 0 ; 57 (57) ; 1 (1) ; 13 (13) ; 54 (54) ; 0 (0) ; |fir|mult29:inst27 ;
; |mult3:inst28| ; 11 (11) ; 11 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 11 (11) ; 11 (11) ; 0 (0) ; |fir|mult3:inst28 ;
; |mult45:inst29| ; 71 (71) ; 15 ; 0 ; 0 ; 0 ; 0 ; 56 (56) ; 2 (2) ; 13 (13) ; 57 (57) ; 0 (0) ; |fir|mult45:inst29 ;
; |mult92:inst31| ; 71 (71) ; 15 ; 0 ; 0 ; 0 ; 0 ; 56 (56) ; 2 (2) ; 13 (13) ; 57 (57) ; 0 (0) ; |fir|mult92:inst31 ;
; |sub171517:inst38| ; 17 (17) ; 10 ; 0 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 10 (10) ; 17 (17) ; 0 (0) ; |fir|sub171517:inst38 ;
+----------------------------+-------------+--------------+-------------+------+------+--------------+--------------+-------------------+------------------+-----------------+------------+-----------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+----------------------------------------------------------------------------------+
; Delay Chain Summary ;
+---------+----------+---------------+---------------+-----------------------+-----+
; Name ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+---------+----------+---------------+---------------+-----------------------+-----+
; clk ; Input ; OFF ; OFF ; -- ; -- ;
; clear ; Input ; OFF ; OFF ; -- ; -- ;
; Din[8] ; Input ; ON ; ON ; -- ; -- ;
; Din[7] ; Input ; ON ; ON ; -- ; -- ;
; Din[4] ; Input ; ON ; ON ; -- ; -- ;
; Din[5] ; Input ; ON ; ON ; -- ; -- ;
; Din[6] ; Input ; ON ; ON ; -- ; -- ;
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