📄 fir.fit.rpt
字号:
; -- 2 input functions ; 72 ;
; -- 1 input functions ; 68 ;
; -- 0 input functions ; 70 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 232 ;
; -- arithmetic mode ; 362 ;
; -- qfbk mode ; 0 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 70 ;
; -- asynchronous clear/load mode ; 117 ;
; ; ;
; Total LABs ; 77 / 291 ( 26 % ) ;
; Logic elements in carry chains ; 397 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 21 / 65 ( 32 % ) ;
; -- Clock pins ; 2 / 2 ( 100 % ) ;
; Global signals ; 2 ;
; M4Ks ; 0 / 13 ( 0 % ) ;
; Total memory bits ; 0 / 59,904 ( 0 % ) ;
; Total RAM block bits ; 0 / 59,904 ( 0 % ) ;
; PLLs ; 0 / 1 ( 0 % ) ;
; Global clocks ; 2 / 8 ( 25 % ) ;
; Maximum fan-out node ; clk ;
; Maximum fan-out ; 329 ;
; Highest non-global fan-out signal ; add9910:inst20|Dout[9] ;
; Highest non-global fan-out ; 25 ;
; Total fan-out ; 2092 ;
; Average fan-out ; 3.39 ;
+---------------------------------------------+------------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Din[0] ; 56 ; 3 ; 27 ; 3 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[1] ; 65 ; 3 ; 27 ; 7 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[2] ; 57 ; 3 ; 27 ; 4 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[3] ; 91 ; 2 ; 8 ; 14 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[4] ; 42 ; 4 ; 20 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[5] ; 37 ; 4 ; 12 ; 0 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[6] ; 90 ; 2 ; 10 ; 14 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[7] ; 89 ; 2 ; 12 ; 14 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; Din[8] ; 55 ; 3 ; 27 ; 3 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; clear ; 66 ; 3 ; 27 ; 8 ; 3 ; 117 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; clk ; 10 ; 1 ; 0 ; 8 ; 2 ; 329 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; Dout[0] ; 71 ; 3 ; 27 ; 10 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; Dout[1] ; 72 ; 3 ; 27 ; 10 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; Dout[2] ; 87 ; 2 ; 16 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; Dout[3] ; 86 ; 2 ; 18 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; Dout[4] ; 39 ; 4 ; 16 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; Dout[5] ; 88 ; 2 ; 16 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; Dout[6] ; 84 ; 2 ; 20 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; Dout[7] ; 4 ; 1 ; 0 ; 11 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; Dout[8] ; 38 ; 4 ; 16 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; Dout[9] ; 36 ; 4 ; 10 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
+-----------------------------------------------------------+
; I/O Bank Usage ;
+----------+-----------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+-----------------+---------------+--------------+
; 1 ; 4 / 14 ( 29 % ) ; 3.3V ; -- ;
; 2 ; 7 / 17 ( 41 % ) ; 3.3V ; -- ;
; 3 ; 7 / 17 ( 41 % ) ; 3.3V ; -- ;
; 4 ; 5 / 17 ( 29 % ) ; 3.3V ; -- ;
+----------+-----------------+---------------+--------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+-------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+-------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; 1 ; 0 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 2 ; 1 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 3 ; 2 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 4 ; 4 ; 1 ; Dout[7] ; output ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 5 ; 8 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 6 ; 9 ; 1 ; +~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 7 ; 10 ; 1 ; ^DATA0 ; input ; ; ; -- ; ; -- ; -- ;
; 8 ; 11 ; 1 ; ^nCONFIG ; ; ; ; -- ; ; -- ; -- ;
; 9 ; ; ; VCCA_PLL1 ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 10 ; 12 ; 1 ; clk ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 11 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 12 ; 14 ; 1 ; ^nCEO ; ; ; ; -- ; ; -- ; -- ;
; 13 ; 15 ; 1 ; ^nCE ; ; ; ; -- ; ; -- ; -- ;
; 14 ; 16 ; 1 ; ^MSEL0 ; ; ; ; -- ; ; -- ; -- ;
; 15 ; 17 ; 1 ; ^MSEL1 ; ; ; ; -- ; ; -- ; -- ;
; 16 ; 18 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ; -- ; -- ;
; 17 ; 19 ; 1 ; +~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 18 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 20 ; 23 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 21 ; 24 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 22 ; 25 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 23 ; 26 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 24 ; 27 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 25 ; 28 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 26 ; 29 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 27 ; 30 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 28 ; 33 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 29 ; 34 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 30 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 31 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 32 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 33 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 34 ; 35 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 35 ; 36 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 36 ; 39 ; 4 ; Dout[9] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 37 ; 40 ; 4 ; Din[5] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 38 ; 44 ; 4 ; Dout[8] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 39 ; 45 ; 4 ; Dout[4] ; output ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 40 ; 46 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 41 ; 49 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 42 ; 50 ; 4 ; Din[4] ; input ; LVTTL ; ; Column I/O ; N ; no ; Off ;
; 43 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 44 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
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