fifo.v

来自「Vlerilog HDL高级数字设计源码」· Verilog 代码 · 共 8 行

V
8 行
字号 
vti_encoding:SR|utf8-nl
vti_timelastmodified:TR|13 Jun 2002 00:56:06 -0000
vti_extenderversion:SR|5.0.2.4330
vti_lineageid:SR|{02B126E0-1CF0-4891-BC9D-57E1FBD18AE4}
vti_cacheddtm:TX|13 Jun 2002 00:56:06 -0000
vti_filesize:IR|3482
vti_backlinkinfo:VX|

fifo.v - 源码说明

本页面展示了「Vlerilog HDL高级数字设计源码」中的 fifo.v 源码文件，采用 Verilog 编程语言编写，共 8 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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