📄 data_rom.fit.rpt
字号:
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; Slow Slew Rate ; Off ; Off ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers -- Stratix/Stratix GX ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Perform Physical Synthesis for Combinational Logic ; Off ; Off ;
; Perform Register Duplication ; Off ; Off ;
; Perform Register Retiming ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Logic Cell Insertion - Logic Duplication ; Auto ; Auto ;
; Auto Register Duplication ; Auto ; Auto ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
+----------------------------------------------------+--------------------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in D:/altera/quartus60/program/DDS/data_rom.pin.
+-----------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+-------------------------------------------------------------------------+
; Resource ; Usage ;
+---------------------------------------------+-------------------------------------------------------------------------+
; Total logic elements ; 171 / 10,570 ( 2 % ) ;
; -- Combinational with no register ; 64 ;
; -- Register only ; 16 ;
; -- Combinational with a register ; 91 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 60 ;
; -- 3 input functions ; 39 ;
; -- 2 input functions ; 51 ;
; -- 1 input functions ; 12 ;
; -- 0 input functions ; 9 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 151 ;
; -- arithmetic mode ; 20 ;
; -- qfbk mode ; 3 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 47 ;
; -- asynchronous clear/load mode ; 58 ;
; ; ;
; Total LABs ; 20 / 1,057 ( 2 % ) ;
; Logic elements in carry chains ; 24 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 24 / 336 ( 7 % ) ;
; -- Clock pins ; 3 / 16 ( 19 % ) ;
; Global signals ; 7 ;
; M512s ; 0 / 94 ( 0 % ) ;
; M4Ks ; 2 / 60 ( 3 % ) ;
; M-RAMs ; 0 / 1 ( 0 % ) ;
; Total memory bits ; 8,192 / 920,448 ( < 1 % ) ;
; Total RAM block bits ; 9,216 / 920,448 ( 1 % ) ;
; DSP block 9-bit elements ; 0 / 48 ( 0 % ) ;
; PLLs ; 0 / 6 ( 0 % ) ;
; Global clocks ; 7 / 16 ( 44 % ) ;
; Regional clocks ; 0 / 16 ( 0 % ) ;
; Fast regional clocks ; 0 / 8 ( 0 % ) ;
; SERDES transmitters ; 0 / 44 ( 0 % ) ;
; SERDES receivers ; 0 / 44 ( 0 % ) ;
; Maximum fan-out node ; altera_internal_jtag~TDO ;
; Maximum fan-out ; 115 ;
; Highest non-global fan-out signal ; sld_hub:sld_hub_inst|sld_jtag_state_machine:jtag_state_machine|state[4] ;
; Highest non-global fan-out ; 30 ;
; Total fan-out ; 795 ;
; Average fan-out ; 3.99 ;
+---------------------------------------------+-------------------------------------------------------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; address[0] ; AA15 ; 8 ; 12 ; 0 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; address[1] ; D14 ; 3 ; 17 ; 31 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; address[2] ; V14 ; 8 ; 17 ; 0 ; 4 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; address[3] ; L20 ; 2 ; 0 ; 19 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; address[4] ; N14 ; 8 ; 17 ; 0 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; address[5] ; E14 ; 3 ; 17 ; 31 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; address[6] ; K16 ; 3 ; 12 ; 31 ; 4 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; address[7] ; W15 ; 8 ; 17 ; 0 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; address[8] ; U14 ; 8 ; 17 ; 0 ; 3 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
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