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电路原理图 VHDL/FPGA/Verilog 人工审核无毒

DDS信号发生器

所属分类 VHDL/FPGA/Verilog
文件大小 1084 K
文件格式 RAR 文件
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资料详细技术说明

DDS信号发生器，能产生多种波形，正玄波，三角波，方波，频率可调，相位可调

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1 FILE
add32.tan.rpt 116.2 KB
包内组件
2 FILE
adderful1.fit.smsg 411 B
包内组件
3 FILE
add32.qpf 899 B
包内组件
4 FILE
adderful.map.summary 317 B
包内组件
5 FILE
add32.fit.summary 407 B
包内组件
6 FILE
adderful.tan.summary 1.1 KB
包内组件
7 FILE
adderful.pof 512.2 KB
包内组件
8 FILE
adder32.vhd 1.7 KB
包内组件
9 FILE
data_rom.vhd 5.7 KB
包内组件
10 FILE
data_rom.map.rpt 59.7 KB
包内组件
11 FILE
adderful.map.rpt 15.3 KB
包内组件
12 FILE
data_rom.fit.smsg 629 B
包内组件

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