_primary.vhd

来自「同步及异步时序电路fifo源程序及其测试程序.rar - fifo源程序」· VHDL 代码 · 共 10 行

library verilog;
use verilog.vl_types.all;
entity t_FIFO_Buffer is
    generic(
        stack_width     : integer := 32;
        stack_height    : integer := 8;
        stack_ptr_width : integer := 4
    );
end t_FIFO_Buffer;