adder4.spl

来自「这是个基于 Xilinx Spartan3 的加法器」· SPL 代码 · 共 12 行

SPL
12 行
字号 
[Inputs]
cin
=ina[3:0]=
=inb[3:0]=
[Outputs]
cout
=sum[3:0]=
[BiDir]
[ATTRIBUTES]
VeriModel adder4

adder4.spl - 源码说明

本页面展示了「这是个基于 Xilinx Spartan3 的加法器」中的 adder4.spl 源码文件，采用 SPL 编程语言编写，共 12 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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