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基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码

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; Control Signals                                                                                ;
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; Name    ; Location ; Fan-Out ; Usage        ; Global ; Global Resource Used ; Global Line Name ;
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; EN1     ; PIN_43   ; 12      ; Clock        ; yes    ; On                   ; --               ;
; EN2     ; PIN_44   ; 14      ; Clock enable ; no     ; --                   ; --               ;
; rtl~383 ; SEXP2    ; 3       ; Clock enable ; no     ; --                   ; --               ;
; rtl~384 ; SEXP6    ; 3       ; Clock enable ; no     ; --                   ; --               ;
; rtl~385 ; SEXP9    ; 3       ; Clock enable ; no     ; --                   ; --               ;
; rtl~386 ; SEXP14   ; 3       ; Clock enable ; no     ; --                   ; --               ;
; rtl~387 ; SEXP11   ; 3       ; Clock enable ; no     ; --                   ; --               ;
; rtl~403 ; SEXP26   ; 1       ; Clock enable ; no     ; --                   ; --               ;
; rtl~404 ; SEXP24   ; 1       ; Clock enable ; no     ; --                   ; --               ;
; rtl~405 ; SEXP23   ; 2       ; Clock enable ; no     ; --                   ; --               ;
; rtl~406 ; SEXP20   ; 1       ; Clock enable ; no     ; --                   ; --               ;
; rtl~407 ; SEXP17   ; 1       ; Clock enable ; no     ; --                   ; --               ;
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+---------------------------------------------------------------------+
; Global & Other Fast Signals                                         ;
+------+----------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+------+----------+---------+----------------------+------------------+
; EN1  ; PIN_43   ; 12      ; On                   ; --               ;
+------+----------+---------+----------------------+------------------+


+------------------------------------------------+
; Non-Global High Fan-Out Signals                ;
+--------------------------------------+---------+
; Name                                 ; Fan-Out ;
+--------------------------------------+---------+
; lpm_counter:month0_rtl_0|dffs[1]     ; 26      ;
; month1[0]~reg0                       ; 24      ;
; lpm_counter:month0_rtl_0|dffs[3]     ; 23      ;
; lpm_counter:day1_rtl_1|dffs[0]       ; 21      ;
; lpm_counter:month0_rtl_0|dffs[2]     ; 21      ;
; lpm_counter:month0_rtl_0|dffs[0]     ; 19      ;
; lpm_counter:day0_rtl_2|dffs[0]       ; 19      ;
; lpm_counter:day0_rtl_2|dffs[1]       ; 18      ;
; lpm_counter:day1_rtl_1|dffs[1]       ; 17      ;
; lpm_counter:day0_rtl_2|dffs[2]       ; 17      ;
; lpm_counter:day0_rtl_2|dffs[3]       ; 17      ;
; EN2                                  ; 14      ;
; rtl~387                              ; 3       ;
; rtl~386                              ; 3       ;
; rtl~385                              ; 3       ;
; rtl~384                              ; 3       ;
; rtl~383                              ; 3       ;
; rtl~405                              ; 2       ;
; rtl~407                              ; 1       ;
; rtl~406                              ; 1       ;
; rtl~404                              ; 1       ;
; rtl~403                              ; 1       ;
; ~GND~4                               ; 1       ;
; ~GND~3                               ; 1       ;
; ~GND~2                               ; 1       ;
; ~GND~1                               ; 1       ;
; ~GND~0                               ; 1       ;
; lpm_counter:day1_rtl_1|dffs[1]~237   ; 1       ;
; lpm_counter:day1_rtl_1|dffs[1]~231   ; 1       ;
; lpm_counter:day1_rtl_1|dffs[1]~228   ; 1       ;
; lpm_counter:day1_rtl_1|dffs[0]~222   ; 1       ;
; lpm_counter:day1_rtl_1|dffs[0]~217   ; 1       ;
; lpm_counter:month0_rtl_0|dffs[0]~305 ; 1       ;
; lpm_counter:day0_rtl_2|dffs[2]~154   ; 1       ;
; lpm_counter:day0_rtl_2|dffs[3]~149   ; 1       ;
; lpm_counter:day0_rtl_2|dffs[0]~143   ; 1       ;
; lpm_counter:day0_rtl_2|dffs[0]~140   ; 1       ;
; lpm_counter:month0_rtl_0|dffs[1]~299 ; 1       ;
; lpm_counter:month0_rtl_0|dffs[1]~296 ; 1       ;
; lpm_counter:month0_rtl_0|dffs[0]~288 ; 1       ;
; lpm_counter:month0_rtl_0|dffs[0]~287 ; 1       ;
; lpm_counter:month0_rtl_0|dffs[0]~285 ; 1       ;
; EO1~reg0                             ; 1       ;
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+-----------------------------------------------+
; Interconnect Usage Summary                    ;
+----------------------------+------------------+
; Interconnect Resource Type ; Usage            ;
+----------------------------+------------------+
; Output enables             ; 0 / 6 ( 0 % )    ;
; PIA buffers                ; 24 / 72 ( 33 % ) ;
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