auto_verify_ddr_timing.tcl

来自「这个是基于NIOS II的FPGA平台的一个CF卡的接口模块」· TCL 代码 · 共 13 行

TCL
13 行
字号 
package require ::quartus::project


set project_name standard
set current_revision [get_current_revision $project_name]


project_open -revision $current_revision $project_name

#SourceList
source verify_timing_for_ddr_sdram.tcl
#EndSourceList

auto_verify_ddr_timing.tcl - 源码说明

本页面展示了「这个是基于NIOS II的FPGA平台的一个CF卡的接口模块」中的 auto_verify_ddr_timing.tcl 源码文件，采用 TCL 编程语言编写，共 13 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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