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该程序设计了一个产生PCM码流时序信号的模块

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~E 1 ".\src\pcm.vhd" 4 pcm
~A 1 ".\src\pcm.vhd" 0 arch_pcm
~C 1 ".\src\test_pcm.vhd" 0 cfg_test_pcm
~E 1 ".\src\test_pcm.vhd" 4 test_pcm
~A 1 ".\src\test_pcm.vhd" 0 arch_test_pcm