📄 fifoasi.pin
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--
-- This is a Quartus II output file. It is for reporting purposes only, and is
-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
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-- NC : No Connect. This pin has no internal connection to the device.
-- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.5V).
-- VCCIO : Dedicated power pin, which MUST be connected to VCC
-- of its bank.
-- Bank 1: 3.3V
-- Bank 2: 3.3V
-- Bank 3: 3.3V
-- Bank 4: 3.3V
-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
-- It can also be used to report unused dedicated pins. The connection
-- on the board for unused dedicated pins depends on whether this will
-- be used in a future design. One example is device migration. When
-- using device migration, refer to the device pin-tables. If it is a
-- GND pin in the pin table or if it will not be used in a future design
-- for another purpose the it MUST be connected to GND. If it is an unused
-- dedicated pin, then it can be connected to a valid signal on the board
-- (low, high, or toggling) if that signal is required for a different
-- revision of the design.
-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
-- This pin should be connected to GND. It may also be connected to a
-- valid signal on the board (low, high, or toggling) if that signal
-- is required for a different revision of the design.
-- GND* : Unused I/O pin. This pin can either be left unconnected or
-- connected to GND. Connecting this pin to GND will improve the
-- device's immunity to noise.
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Quartus II Version 4.1 Build 181 06/29/2004 SJ Full Version
CHIP "fifoasi" ASSIGNED TO AN: EP1C4F324C8
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
-------------------------------------------------------------------------------------------------------------
GND : A1 : gnd : : : 1 :
VCCINT : A2 : power : : 1.5V : :
GND : A3 : gnd : : : 1 :
TXCTD0 : A4 : output : LVTTL : : 2 : Y
VCCIO2 : A5 : power : : 3.3V : 2 :
GND* : A6 : : : : 2 :
RXDD[6] : A7 : input : LVTTL : : 2 : Y
RXDD[2] : A8 : input : LVTTL : : 2 : Y
RXSTD1 : A9 : input : LVTTL : : 2 : Y
GND* : A10 : : : : 2 :
GND* : A11 : : : : 2 :
TXDC[0] : A12 : output : LVTTL : : 2 : Y
TXDC[6] : A13 : output : LVTTL : : 2 : Y
VCCIO2 : A14 : power : : 3.3V : 2 :
RXDC[0] : A15 : input : LVTTL : : 2 : Y
GND : A16 : gnd : : : 1 :
VCCINT : A17 : power : : 1.5V : :
GND : A18 : gnd : : : 1 :
VCCINT : B1 : power : : 1.5V : :
GND : B2 : gnd : : : 1 :
GND* : B3 : : : : 2 :
INTD : B4 : output : LVTTL : : 2 : Y
GND* : B5 : : : : 2 :
TXDD[4] : B6 : output : LVTTL : : 2 : Y
RXDD[7] : B7 : input : LVTTL : : 2 : Y
RXDD[3] : B8 : input : LVTTL : : 2 : Y
RXSTD2 : B9 : input : LVTTL : : 2 : Y
GND* : B10 : : : : 2 :
INTC : B11 : output : LVTTL : : 2 : Y
TXDC[1] : B12 : output : LVTTL : : 2 : Y
TXDC[7] : B13 : output : LVTTL : : 2 : Y
RXDC[3] : B14 : input : LVTTL : : 2 : Y
RXSTC2 : B15 : input : LVTTL : : 2 : Y
RXSTC1 : B16 : input : LVTTL : : 2 : Y
GND : B17 : gnd : : : 1 :
VCCINT : B18 : power : : 1.5V : :
GND : C1 : gnd : : : 1 :
GND* : C2 : : : : 1 :
GND* : C3 : : : : 1 :
GND* : C4 : : : : 2 :
TXDD[0] : C5 : output : LVTTL : : 2 : Y
TXDD[3] : C6 : output : LVTTL : : 2 : Y
TXDD[7] : C7 : output : LVTTL : : 2 : Y
RXDD[1] : C8 : input : LVTTL : : 2 : Y
RXSTD0 : C9 : input : LVTTL : : 2 : Y
GND* : C10 : : : : 2 :
TXCTABCD[2] : C11 : output : LVTTL : : 2 : Y
TXDC[2] : C12 : output : LVTTL : : 2 : Y
TXDC[4] : C13 : output : LVTTL : : 2 : Y
GND* : C14 : : : : 2 :
RXDC[1] : C15 : input : LVTTL : : 2 : Y
RXSTC0 : C16 : input : LVTTL : : 2 : Y
GND* : C17 : : : : 3 :
GND : C18 : gnd : : : 1 :
GND* : D1 : : : : 1 :
GND* : D2 : : : : 1 :
GND* : D3 : : : : 1 :
GND* : D4 : : : : 1 :
TXCTABCD[3] : D5 : output : LVTTL : : 2 : Y
TXDD[5] : D6 : output : LVTTL : : 2 : Y
LFI[3] : D7 : input : LVTTL : : 2 : Y
RXDD[0] : D8 : input : LVTTL : : 2 : Y
GND* : D9 : : : : 2 :
GND* : D10 : : : : 2 :
TXCTC0 : D11 : output : LVTTL : : 2 : Y
TXDC[3] : D12 : output : LVTTL : : 2 : Y
TXDC[5] : D13 : output : LVTTL : : 2 : Y
RXDC[2] : D14 : input : LVTTL : : 2 : Y
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