📄 uart.tan.rpt
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; N/A ; 199.52 MHz ( period = 5.012 ns ) ; uart:U_2|divider:U_divider|rCnt[2] ; uart:U_2|divider:U_divider|rCnt[8] ; clk ; clk ; None ; None ; 4.750 ns ;
; N/A ; 199.52 MHz ( period = 5.012 ns ) ; uart:U_2|divider:U_divider|rCnt[2] ; uart:U_2|divider:U_divider|rCnt[9] ; clk ; clk ; None ; None ; 4.750 ns ;
; N/A ; 199.52 MHz ( period = 5.012 ns ) ; uart:U_2|divider:U_divider|rCnt[2] ; uart:U_2|divider:U_divider|rCnt[10] ; clk ; clk ; None ; None ; 4.750 ns ;
; N/A ; 199.52 MHz ( period = 5.012 ns ) ; uart:U_2|divider:U_divider|rCnt[2] ; uart:U_2|divider:U_divider|rCnt[11] ; clk ; clk ; None ; None ; 4.750 ns ;
; N/A ; 200.48 MHz ( period = 4.988 ns ) ; uart:U_2|rxd:U_receiver|rStatRxCur.RX_STOP ; uart:U_2|rxd:U_receiver|rStatRxCur.RX_DONE ; clk ; clk ; None ; None ; 4.727 ns ;
; N/A ; 200.52 MHz ( period = 4.987 ns ) ; uart:U_2|txd:U_transmitter|rTxBitCnt[0] ; uart:U_2|txd:U_transmitter|rParVal ; clk ; clk ; None ; None ; 4.726 ns ;
; N/A ; 200.52 MHz ( period = 4.987 ns ) ; uart:U_2|rUCSZ2 ; uart:U_2|txd:U_transmitter|rParVal ; clk ; clk ; None ; None ; 4.726 ns ;
; N/A ; 200.56 MHz ( period = 4.986 ns ) ; uart:U_2|rxd:U_receiver|rStatRxCur.RX_STOP ; uart:U_2|rxd:U_receiver|rStatRxCur.RX_ENDING ; clk ; clk ; None ; None ; 4.725 ns ;
; N/A ; 200.68 MHz ( period = 4.983 ns ) ; uart:U_2|rxd:U_receiver|rStatRxCur.RX_STOP ; uart:U_2|rxd:U_receiver|rStatRxCur.RX_SYNC ; clk ; clk ; None ; None ; 4.722 ns ;
; N/A ; 200.72 MHz ( period = 4.982 ns ) ; uart:U_2|txd:U_transmitter|rTxBitCnt[2] ; uart:U_2|txd:U_transmitter|rTxdTmp ; clk ; clk ; None ; None ; 4.722 ns ;
; N/A ; 200.92 MHz ( period = 4.977 ns ) ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_STOP2 ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_DATA ; clk ; clk ; None ; None ; 4.716 ns ;
; N/A ; 201.13 MHz ( period = 4.972 ns ) ; uart:U_2|txd:U_transmitter|rTxBitCnt[3] ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_STOP1 ; clk ; clk ; None ; None ; 4.711 ns ;
; N/A ; 201.29 MHz ( period = 4.968 ns ) ; uart:U_2|divider:U_divider|rPlsTick ; uart:U_2|txd:U_transmitter|rPlsStatChanged ; clk ; clk ; None ; None ; 4.706 ns ;
; N/A ; 201.53 MHz ( period = 4.962 ns ) ; uart:U_2|rUCSZ0 ; uart:U_2|txd:U_transmitter|rPlsStatChanged ; clk ; clk ; None ; None ; 4.701 ns ;
; N/A ; 201.78 MHz ( period = 4.956 ns ) ; uart:U_2|rUCSZ1 ; uart:U_2|txd:U_transmitter|rParVal ; clk ; clk ; None ; None ; 4.695 ns ;
; N/A ; 201.82 MHz ( period = 4.955 ns ) ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_START ; uart:U_2|txd:U_transmitter|rPlsStatChanged ; clk ; clk ; None ; None ; 4.694 ns ;
; N/A ; 202.10 MHz ( period = 4.948 ns ) ; uart:U_2|txd:U_transmitter|rTxBitCnt[0] ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_DATA ; clk ; clk ; None ; None ; 4.687 ns ;
; N/A ; 202.10 MHz ( period = 4.948 ns ) ; uart:U_2|rUCSZ2 ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_DATA ; clk ; clk ; None ; None ; 4.687 ns ;
; N/A ; 203.25 MHz ( period = 4.920 ns ) ; uart:U_2|txd:U_transmitter|rTxBitCnt[2] ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_PARITY ; clk ; clk ; None ; None ; 4.659 ns ;
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; N/A ; 203.46 MHz ( period = 4.915 ns ) ; uart:U_2|divider:U_divider|rCnt[8] ; uart:U_2|divider:U_divider|rCnt[0] ; clk ; clk ; None ; None ; 4.655 ns ;
; N/A ; 203.46 MHz ( period = 4.915 ns ) ; uart:U_2|divider:U_divider|rCnt[8] ; uart:U_2|divider:U_divider|rCnt[1] ; clk ; clk ; None ; None ; 4.655 ns ;
; N/A ; 203.46 MHz ( period = 4.915 ns ) ; uart:U_2|divider:U_divider|rCnt[8] ; uart:U_2|divider:U_divider|rCnt[2] ; clk ; clk ; None ; None ; 4.655 ns ;
; N/A ; 203.46 MHz ( period = 4.915 ns ) ; uart:U_2|divider:U_divider|rCnt[8] ; uart:U_2|divider:U_divider|rCnt[3] ; clk ; clk ; None ; None ; 4.655 ns ;
; N/A ; 203.46 MHz ( period = 4.915 ns ) ; uart:U_2|divider:U_divider|rCnt[8] ; uart:U_2|divider:U_divider|rCnt[4] ; clk ; clk ; None ; None ; 4.655 ns ;
; N/A ; 203.46 MHz ( period = 4.915 ns ) ; uart:U_2|divider:U_divider|rCnt[8] ; uart:U_2|divider:U_divider|rCnt[5] ; clk ; clk ; None ; None ; 4.655 ns ;
; N/A ; 203.54 MHz ( period = 4.913 ns ) ; uart:U_2|rxd:U_receiver|rStatRxCur.RX_DONE ; uart:U_2|rxd:U_receiver|rStatRxCur.RX_ENDING ; clk ; clk ; None ; None ; 4.652 ns ;
; N/A ; 203.67 MHz ( period = 4.910 ns ) ; uart:U_2|rxd:U_receiver|rStatRxCur.RX_DONE ; uart:U_2|rxd:U_receiver|rStatRxCur.RX_SYNC ; clk ; clk ; None ; None ; 4.649 ns ;
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; N/A ; 203.92 MHz ( period = 4.904 ns ) ; uart:U_2|rUCSZ0 ; uart:U_2|txd:U_transmitter|rTxDatSft[2] ; clk ; clk ; None ; None ; 4.644 ns ;
; N/A ; 203.92 MHz ( period = 4.904 ns ) ; uart:U_2|rUCSZ0 ; uart:U_2|txd:U_transmitter|rTxDatSft[3] ; clk ; clk ; None ; None ; 4.644 ns ;
; N/A ; 203.92 MHz ( period = 4.904 ns ) ; uart:U_2|rUCSZ0 ; uart:U_2|txd:U_transmitter|rTxDatSft[4] ; clk ; clk ; None ; None ; 4.644 ns ;
; N/A ; 203.92 MHz ( period = 4.904 ns ) ; uart:U_2|rUCSZ0 ; uart:U_2|txd:U_transmitter|rTxDatSft[5] ; clk ; clk ; None ; None ; 4.644 ns ;
; N/A ; 203.92 MHz ( period = 4.904 ns ) ; uart:U_2|rUCSZ0 ; uart:U_2|txd:U_transmitter|rTxDatSft[6] ; clk ; clk ; None ; None ; 4.644 ns ;
; N/A ; 204.12 MHz ( period = 4.899 ns ) ; uart:U_2|rRXEN ; uart:U_2|rxd:U_receiver|rFlgFraErr ; clk ; clk ; None ; None ; 4.637 ns ;
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; N/A ; 204.42 MHz ( period = 4.892 ns ) ; uart:U_2|divider:U_divider|rCnt[7] ; uart:U_2|divider:U_divider|rCnt[7] ; clk ; clk ; None ; None ; 4.631 ns ;
; N/A ; 204.42 MHz ( period = 4.892 ns ) ; uart:U_2|divider:U_divider|rCnt[7] ; uart:U_2|divider:U_divider|rCnt[8] ; clk ; clk ; None ; None ; 4.631 ns ;
; N/A ; 204.42 MHz ( period = 4.892 ns ) ; uart:U_2|divider:U_divider|rCnt[7] ; uart:U_2|divider:U_divider|rCnt[9] ; clk ; clk ; None ; None ; 4.631 ns ;
; N/A ; 204.42 MHz ( period = 4.892 ns ) ; uart:U_2|divider:U_divider|rCnt[7] ; uart:U_2|divider:U_divider|rCnt[10] ; clk ; clk ; None ; None ; 4.631 ns ;
; N/A ; 204.42 MHz ( period = 4.892 ns ) ; uart:U_2|divider:U_divider|rCnt[7] ; uart:U_2|divider:U_divider|rCnt[11] ; clk ; clk ; None ; None ; 4.631 ns ;
; N/A ; 205.76 MHz ( period = 4.860 ns ) ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_DATA ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_STOP1 ; clk ; clk ; None ; None ; 4.599 ns ;
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; N/A ; 205.93 MHz ( period = 4.856 ns ) ; uart:U_2|divider:U_divider|rCnt[0] ; uart:U_2|divider:U_divider|rCnt[7] ; clk ; clk ; None ; None ; 4.594 ns ;
; N/A ; 205.93 MHz ( period = 4.856 ns ) ; uart:U_2|divider:U_divider|rCnt[0] ; uart:U_2|divider:U_divider|rCnt[8] ; clk ; clk ; None ; None ; 4.594 ns ;
; N/A ; 205.93 MHz ( period = 4.856 ns ) ; uart:U_2|divider:U_divider|rCnt[0] ; uart:U_2|divider:U_divider|rCnt[9] ; clk ; clk ; None ; None ; 4.594 ns ;
; N/A ; 205.93 MHz ( period = 4.856 ns ) ; uart:U_2|divider:U_divider|rCnt[0] ; uart:U_2|divider:U_divider|rCnt[10] ; clk ; clk ; None ; None ; 4.594 ns ;
; N/A ; 205.93 MHz ( period = 4.856 ns ) ; uart:U_2|divider:U_divider|rCnt[0] ; uart:U_2|divider:U_divider|rCnt[11] ; clk ; clk ; None ; None ; 4.594 ns ;
; N/A ; 206.23 MHz ( period = 4.849 ns ) ; uart:U_2|rRXEN ; uart:U_2|rxd:U_receiver|rFlgDone ; clk ; clk ; None ; None ; 4.588 ns ;
; N/A ; 206.31 MHz ( period = 4.847 ns ) ; uart:U_2|rRXEN ; uart:U_2|rxd:U_receiver|rFlgOverRun ; clk ; clk ; None ; None ; 4.586 ns ;
; N/A ; 206.53 MHz ( period = 4.842 ns ) ; uart:U_2|txd:U_transmitter|rTxBitCnt[2] ; uart:U_2|txd:U_transmitter|rParVal ; clk ; clk ; None ; None ; 4.581 ns ;
; N/A ; 206.74 MHz ( period = 4.837 ns ) ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_STOP1 ; uart:U_2|txd:U_transmitter|rStatTxCur.TX_DATA ; clk ; clk ; None ; None ; 4.576 ns ;
; N/A ; 207.00 MHz ( period = 4.831 ns ) ; uart:U_2|rUCSZ1 ⌨️ 快捷键说明
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