💻 一个串口的完整FPGA工程 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 test.wsdt
4.41 KB
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2
📄 uarttest.dni
398 B
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3
📄 test.dbgdt
7.09 KB
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4
📄 test.cspy.bat
2.35 KB
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5
📄 uarttest.cspy.bat
2.35 KB
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6
📄 test.dni
492 B
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7
📄 uarttest.wsdt
3.93 KB
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8
📄 uartctrl.c
1.91 KB
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9
📋 fpgainc.h
940 B
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10
📄 uarttest.ewp
49.68 KB
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11
📄 uarttest.dep
2.74 KB
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12
📋 stdinc.h
277 B
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13
📋 uartctrl.h
789 B
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14
📄 uarttest.ewd
42.06 KB
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15
📄 main.c
605 B
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16
📄 uarttest.eww
162 B
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17
📄 uart.cdf
324 B
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18
📄 uart.tan.rpt
64 KB
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19
📄 uart.map.summary
403 B
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20
📄 uart.qws
601 B
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21
📄 uart.done
26 B
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22
📄 uart.qpf
905 B
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23
📃 tcl_stacktrace.txt
2.14 KB
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24
📄 uart.mpf
32.67 KB
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25
⚙️ verilog.asm
0 B
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26
📄 _primary.dat
0 B
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27
📄 _primary.vhd
1.46 KB
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28
⚙️ verilog.asm
0 B
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29
📄 _primary.dat
0 B
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30
📄 _primary.vhd
909 B
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31
⚙️ verilog.asm
0 B
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32
📄 _primary.dat
0 B
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33
📄 _primary.vhd
593 B
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34
📄 _info
1.73 KB
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35
⚙️ verilog.asm
0 B
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36
📄 _primary.dat
0 B
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37
📄 _primary.vhd
327 B
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38
⚙️ verilog.asm
0 B
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39
📄 _primary.dat
0 B
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40
📄 _primary.vhd
325 B
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41
⚙️ verilog.asm
0 B
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42
📄 _primary.dat
0 B
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43
📄 _primary.vhd
932 B
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44
⚙️ verilog.asm
0 B
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45
📄 _primary.dat
0 B
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46
📄 _primary.vhd
1.93 KB
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47
⚙️ verilog.asm
0 B
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48
📄 _primary.dat
0 B
查看源码
49
📄 _primary.vhd
608 B
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50
📄 _info
82 B
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