提供《基于FPGA的新的DDS+PLL时钟发生器》完整技术工程技术资料下载（归档大小 143 K），包含相关硬件原理图参考、开发文档或源代码工程。
基于VXI总线用DDS+PLL技术实现精密时钟源
资料详细技术说明
DDS（直接数字频率合成）技术是一门在频率合成领域的新兴技术，具有响应时间短，
精度高等优点。而PLL（Phase Locked Loop）锁相环技术虽然工作速度慢，但稳定可靠。VXI 总线具有
精度高等优点。而PLL（Phase Locked Loop）锁相环技术虽然工作速度慢，但稳定可靠。VXI 总线具有
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