键控加/减计数器,将20MHz系统时钟经分频器后可得到5M、1M、100K、10K、5K、1K、10Hz、1Hz

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  标签： 100K 10K 1Hz MHz

  上传时间： 2014-01-17

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  标签： 实验 AVR 单片机 减

  上传时间： 2016-10-19

  上传用户：wqxstar

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  标签： MHz 50 计数器 时钟

  上传时间： 2017-06-18

  上传用户：lanjisu111

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  资源简介：DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低.

  标签： signal_out signal_in DPLL 模

  上传时间： 2013-12-26

  上传用户：希酱大魔王

• AVR单片机atmega16的定时计数器T0实现四位加减计数器免费下载

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  标签： atmega AVR 16 单片机

  上传时间： 2015-08-12

  上传用户：R50974

• 加减计数器免费下载

  资源简介：加减计数器，其实也没什么，想要就拿去了，给我拿别人的东西才重要

  标签： 减 计数器

  上传时间： 2013-12-16

  上传用户：a673761058

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  标签： PROTEUS 2106 UCOS LPC

  上传时间： 2013-12-23

  上传用户：woshiayin

• N分频器则是一个简单的除N 计数器。分频器对脉冲加减电路的输出脉冲再进行N分频免费下载

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  标签： N分频 计数器 分频器 减

  上传时间： 2017-05-04

  上传用户：royzhangsz

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  标签： 表达式 分 减 操作

  上传时间： 2014-01-17

  上传用户：yan2267246

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  标签： 89C C51 数码管 程序

  上传时间： 2013-12-30

  上传用户：lnnn30

• 计数器,分频器,锁存器,驱动器分册免费下载

  资源简介：计数器,分频器,锁存器,驱动器分册

  标签： 计数器 分频器 分 锁存器

  上传时间： 2013-04-15

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  标签： 338 5.7 集成电路

  上传时间： 2013-04-24

  上传用户：kiklkook

• 数字电路讲座:寄存器计数器分频器免费下载

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  标签： 数字电路 寄存器 分频器 讲座

  上传时间： 2013-10-27

  上传用户：DXM35

• 决定系统时钟频率的寄存器免费下载

  资源简介：关于系统时钟的一些寄存器

  标签： 系统时钟 寄存器 频率

  上传时间： 2013-11-12

  上传用户：萍水相逢

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  标签： 管理系统 解压

  上传时间： 2014-01-12

  上传用户：aig85

• UC/FS做的文件系统很好.高版本的一般只有库文件.CF卡是一种很方便的存储设备。网上可得到的CF卡的驱动程序少三个文件：初始化、读和写。本代码测试读写成功。免费下载

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  标签： UC FS CF 文件系统

  上传时间： 2015-04-22

  上传用户：hustfanenze

• 用VHDL编写的8位全加器,数字分频器等程序免费下载

  资源简介：用VHDL编写的8位全加器,数字分频器等程序

  标签： VHDL 8位 编写 全加器

  上传时间： 2013-12-16

  上传用户：ztj182002

• 第7章数字系统设计实例 7.1 半整数分频器的设计 7.2 音乐发生器 7.3 2FSK/2PSK信号产生器 7.4 实用多功能电子表 7.5 交通灯控制器 7.6 数字频率计免费下载

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  标签： 7.1 7.2 7.3 FSK

  上传时间： 2015-06-23

  上传用户：tianyi223

• 数控分频器设计:对于一个加法计数器免费下载

  资源简介：数控分频器设计:对于一个加法计数器，装载不同的计数初始值时，会有不同频率的溢出输出信号。计数器溢出时，输出‘1’电平，同时溢出时的‘1’电平反馈给计数器的输入端作为装载信号；否则输出‘0’电平。

  标签： 数控 分频器 加法 计数器

  上传时间： 2015-07-16

  上传用户：wxhwjf

• 本文件介绍的是用VerilogHDL语言设计分频器和32位计数器.免费下载

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  标签： VerilogHDL 语言 分频器 计数器

  上传时间： 2013-12-15

  上传用户：缥缈

• 本文介绍了两种分频系数为整数或半整数的可控分频器的设计方法。其中之一可以实现50％的奇数分频。利用VHDL语言编程免费下载

  资源简介：本文介绍了两种分频系数为整数或半整数的可控分频器的设计方法。其中之一可以实现50％的奇数分频。利用VHDL语言编程，并用QUARTERS||4.0进行仿真，用 FPGA 芯片实现。 关键词：半整数，可控分频器，VHDL, FPGA

  标签： VHDL 分频 整数 系数

  上传时间： 2015-11-27

  上传用户：tyler

• 分频电路的VHDL设计,在你的设计中,如果有用到分频电路的话,他将帮组你了解分频电路免费下载

  资源简介：分频电路的VHDL设计,在你的设计中,如果有用到分频电路的话,他将帮组你了解分频电路

  标签： VHDL 分频电路

  上传时间： 2013-12-20

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• 电子通信系统的建模与仿真 第4章 电子线路仿真试验 4.1 信号合并 4.2 微积分 4.3 触发器 4.4 分频器 4.5 使能开关 4.6 编程开关 4.7 移位寄存器免费下载

  资源简介：电子通信系统的建模与仿真 第4章 电子线路仿真试验 4.1 信号合并 4.2 微积分 4.3 触发器 4.4 分频器 4.5 使能开关 4.6 编程开关 4.7 移位寄存器 4.8 整流电路 4.9 驻波演示 4.10 超外差式接收机

  标签： 4.1 4.2 4.3 4.4

  上传时间： 2016-09-06

  上传用户：zwei41

• 应用VHDL语言将高稳晶振分频得到1pps免费下载

  资源简介：应用VHDL语言将高稳晶振分频得到1pps，使用GPS的1pps信号作为触发

  标签： VHDL 1pps 语言 晶振

  上传时间： 2016-10-15

  上传用户：lo25643

• 利用计数器和分频器设计一个实时的时钟。一共需要1个模24计数器、2个模6计数器、2个模10计数器、一个生成1Hz的分频器和6个数码管解码器。最终用HEX5~HEX4显示小时（0~23）免费下载

  资源简介：利用计数器和分频器设计一个实时的时钟。一共需要1个模24计数器、2个模6计数器、2个模10计数器、一个生成1Hz的分频器和6个数码管解码器。最终用HEX5~HEX4显示小时（0~23），用HEX3~HEX2显示分钟（0~59），用HEX1~HEX0显示秒钟（0~59）。

  标签： HEX 计数器 模 1Hz

  上传时间： 2014-12-20

  上传用户：dbs012280

• 本系统采用51单片机和一些用做分频器的数字芯片免费下载

  资源简介：本系统采用51单片机和一些用做分频器的数字芯片，用液晶显示频率值。可以精确到小数点后两位，响应时间短。

  标签： 51单片机 分频器 数字芯片

  上传时间： 2013-12-03

  上传用户：ztj182002

• VHDL程序来让蜂鸣器发出音乐的声音 这种电路设计要分好几个模块 主要思路是用ROM记录乐谱 然后用分频器分频 还有就是用计数器读取乐谱 另外还可以扩展 使其显示音符免费下载

  资源简介：VHDL程序来让蜂鸣器发出音乐的声音 这种电路设计要分好几个模块 主要思路是用ROM记录乐谱 然后用分频器分频 还有就是用计数器读取乐谱 另外还可以扩展 使其显示音符 这是一个做好了的 就是ROM没填谱

  标签： VHDL ROM 程序 电路设计

  上传时间： 2017-08-03

  上传用户：ruan2570406

• 计数器,分频器,锁存器,驱动器分册 338页 5.7M.pdf免费下载

  资源简介：器件数据手册专辑 120册 2.15G计数器,分频器,锁存器,驱动器分册 338页 5.7M.pdf

  标签：

  上传时间： 2014-05-05

  上传用户：时代将军

• 四位计数器 计数器是数字系统中用得较多的基本逻辑器件。它不仅能记录输入时钟脉冲的个数免费下载

  资源简介：四位计数器 计数器是数字系统中用得较多的基本逻辑器件。它不仅能记录输入时钟脉冲的个数，还可以实现分频、定时、产生节拍脉冲和脉冲序列等。例如，计算机中的时序发生器、分频器、指令计数器等都要使用计数器。

  标签： 计数器 数字系统 脉冲 逻辑器件

  上传时间： 2013-12-22

  上传用户：maizezhen

• 该程序实现一个频率计免费下载

  资源简介：该程序实现一个频率计，测量范围：1-49999999赫兹，用8为数码管扫描显示出被测信号的频率。 INT_DIV模块用于对系统的频率进行分频，此模块的输出信号为被测信号的频率，可以自己设定分频系数，验证频率计的功能，实际应用中，可去掉此模块，直接把待测信号加...

  标签： 程序 频率计

  上传时间： 2013-12-30

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