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电路原理图 VHDL/FPGA/Verilog 人工审核无毒

其中的EPLL、MY_DQ和MY_DQS模块是用Altera的IP产生器MegaWizard产生的

所属分类 VHDL/FPGA/Verilog
文件大小 25 K
文件格式 RAR 文件
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资料详细技术说明

其中的EPLL、MY_DQ和MY_DQS模块是用Altera的IP产生器MegaWizard产生的

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datapath.qpf 1.5 KB
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3 FILE
datapath.bdf 32.3 KB
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4 FILE
my_dq.bsf 4.3 KB
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my_dqs_inst.v 274 B
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my_dqs_bb.v 7.1 KB
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my_dq_bb.v 4.8 KB
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my_dq.v 15.5 KB
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my_dqs.v 10.8 KB
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epll.bsf 4.9 KB
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11 FILE
my_dq_inst.v 248 B
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12 FILE
my_dqs.bsf 4.2 KB
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