《设计与验证VerilogHDL》源码实例和 Verilog规范 - 免费下载

VHDL/FPGA/Verilog资源文件大小：5556 K

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文件格式

RAR

所属分类

VHDL/FPGA/Verilog

上传用户

ahkid

上传时间

2017-04-18 00:52

文件大小

5556 K

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推荐指数

⭐⭐⭐⭐⭐ (5/5)

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《设计与验证VerilogHDL》源码实例和 Verilog规范

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📂 共 471 个源码文件点击文件名可在线查看源代码

1 📄

mod_copy1.plg

大小: 23 B

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2 📄

mod_copy1.msg

大小: 476 B

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3 📄

mod_copy2.plg

大小: 23 B

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4 📄

decode.srr

大小: 19.92 KB

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5 📄

decode.plg

大小: 236 B

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6 📄

decode.srm

大小: 25.16 KB

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7 📄

decode.edn

大小: 54.79 KB

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8 📄

decode.tlg

大小: 2.05 KB

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9 📄

generic.srd

大小: 21.24 KB

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10 📄

decode.prf

大小: 245 B

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11 📄

decode.srs

大小: 8.74 KB

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12 📄

autoconstraint_top.sdc

大小: 168 B

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13 📄

top.plg

大小: 448 B

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14 📄

top.msg

大小: 1.25 KB

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15 📄

top.srm

大小: 24.85 KB

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