本文用VHDL在CPLD器件上实现一种8 b数字频率计测频系统 - 免费下载

VHDL/FPGA/Verilog资源文件大小：220 K

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VHDL/FPGA/Verilog

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2013-12-18 11:46

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本文用VHDL在CPLD器件上实现一种8 b数字频率计测频系统，能够用十进制数码显示被测信号的频率，不仅能够测量正弦波、方波和三角波等信号的频率，而且还能对其他多种物理量进行测量。具有体积小、可靠性高、功耗低的特点。

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基于vhdl语言设计数字频率计.doc

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