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VHDL/FPGA/Verilog
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用VHDL写的运动计时表程序
用VHDL写的运动计时表程序
VHDL/FPGA/Verilog
315 K
29 次下载
2014-01-25
资源详细信息
文件格式
RAR
文件大小
315 K
资源分类
VHDL/FPGA/Verilog
上传者
wuweixiong123
发布时间
2014-01-25 18:45
下载统计
29
次
所需积分
2 积分
用VHDL写的运动计时表程序 - 资源详细说明
用VHDL写的运动计时表程序,用Modelsim仿真已经通过,帖出来与大家分享。
用VHDL写的运动计时表程序 - 源码文件列表
本资源包含 56 个源码文件
支持在线预览,点击文件名即可查看
1
ngdbuild.xmsgs
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2
xst.xmsgs
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3
verilog.asm
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4
_primary.dat
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_primary.vhd
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_info
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verilog.asm
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_primary.dat
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_primary.vhd
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verilog.asm
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_primary.dat
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verilog.asm
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